為了實現(xiàn)快速準確地觀測電機轉(zhuǎn)速，在直接轉(zhuǎn)矩控制系統(tǒng)的基礎(chǔ)上，采用了基于電機轉(zhuǎn)子磁鏈的MRAS速度辨識方法對系統(tǒng)進行速度估計，并通過DSP實現(xiàn)無速度傳感器的直接轉(zhuǎn)矩控制。利用Matlab對系統(tǒng)進行仿真分析，仿真結(jié)果表明，該方案的設(shè)計方法正確可行。
標簽： DSP 速度傳感器 控制 系統(tǒng)研究
上傳時間： 2013-11-17
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以O(shè)MAP3530為硬件平臺，以DVSDK為軟件工具，介紹了協(xié)同開發(fā)環(huán)境的搭建方法。說明了OMAP3530中ARM和DSP協(xié)同開發(fā)的兩種方法，并對兩種方法的優(yōu)缺點進行了比較。
上傳時間： 2013-11-18
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介紹了一種基于多DSP的并行處理系統(tǒng)設(shè)計與實現(xiàn)，以及其在分布式雷達組網(wǎng)航跡融合中的實際應(yīng)用。重點介紹了該系統(tǒng)由1塊系統(tǒng)主板和4塊TS201處理板卡組成的原理和結(jié)構(gòu)，即系統(tǒng)內(nèi)主板與處理板卡的板級并行設(shè)計、單塊板卡多DSP并行結(jié)構(gòu)的設(shè)計、板級間，單塊板卡內(nèi)傳輸通道的設(shè)計。通過具體應(yīng)用說明，該多DSP并行處理系統(tǒng)充分體現(xiàn)了航跡融合的實時、高速特性，作為硬件處理平臺具備高速、通用的特點。
標簽： DSP 并行處理 系統(tǒng)研究
上傳時間： 2014-09-01
上傳用戶：671145514
介紹了軟件動態(tài)鏈接技術(shù)的概念和特點，提出了基于TI TMS320系列DSP的軟件動態(tài)鏈接技術(shù)。該技術(shù)解決了可重配置的DSP系統(tǒng)中關(guān)于軟件二進制目標代碼的動態(tài)加載和卸載的問題。采用該技術(shù)的軟件重配置方案已成功運用于某多功能通信系統(tǒng)，為基于其他系列DSP的可重構(gòu)數(shù)字處理系統(tǒng)提供了一定的參考，在無人值守設(shè)備、多功能信號處理設(shè)備方面具有一定的應(yīng)用價值。
上傳時間： 2013-10-14
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軟件無線電的思想已推廣到無線電通信領(lǐng)域, 該技術(shù)依托于寬頻段、特性均勻的天線, 高速的ADö DA 芯片,可編程大規(guī)模邏輯門陣列, 通用高速的DSP 數(shù)字信號處理芯片等硬件技術(shù)。介紹了AM 調(diào)制和解調(diào)的數(shù)字化實現(xiàn)方法, 給出了基于TM S320C32 DSP 芯片實現(xiàn)AM 調(diào)制解調(diào)算法的主要源程序。經(jīng)測試, 該軟件設(shè)計在軟件無線電硬件平臺上運行良好, 整個系統(tǒng)的各項性能指標均達到設(shè)計的要求。
標簽： DSP 軟件無線電 AM調(diào)制 解調(diào)算法
上傳時間： 2013-10-09
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《DSP原理及其C編程開發(fā)技術(shù)》是一本關(guān)于數(shù)字波形產(chǎn)生、數(shù)字濾波器設(shè)計、數(shù)字信號處理工具及技術(shù)應(yīng)用的最新綜合性教材。全書共包含9章及7個附錄，前8章分別介紹了DSP開發(fā)系統(tǒng)、DSK的輸入輸出、C6x系列處理器的體系結(jié)構(gòu)和指令集、有限沖激響應(yīng)濾波器、無限沖激響應(yīng)濾波器、快速傅里葉變換、自適應(yīng)濾波器、程序代碼優(yōu)化技術(shù)等內(nèi)容，第9章為DSP的應(yīng)用及學(xué)生的一些課程設(shè)計。每章開始主要介紹基本理論，然后給出一些具體例子和必要的背景知識，最后給出了一些結(jié)論性的實驗。通過大量實驗和工程課題的DSP實時實現(xiàn)實例，該書為讀者提供了學(xué)習(xí)數(shù)字信號處理的快速而實用的方法。為了便于讀者理解，書中提到的所有程序?qū)嵗伎梢詮木W(wǎng)站上免費下載。
標簽： DSP 編程 開發(fā)技術(shù) 電子書
上傳時間： 2013-10-12
上傳用戶：牧羊人8920
電子發(fā)燒友網(wǎng)核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測試了復(fù)數(shù)高性能浮點數(shù)字信號處理（DSP）設(shè)計。獨立技術(shù)分析公司Berkeley設(shè)計技術(shù)有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發(fā)套件上簡單方便的高效實現(xiàn)Altera浮點DSP設(shè)計流程，同時驗證了要求較高的浮點DSP應(yīng)用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。 Altera的浮點DSP設(shè)計流程經(jīng)過規(guī)劃，能夠快速適應(yīng)可參數(shù)賦值接口的設(shè)計更改，其工作環(huán)境包括來自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級模塊庫，支持FPGA設(shè)計人員比傳統(tǒng)HDL設(shè)計更迅速的實現(xiàn)并驗證復(fù)數(shù)浮點算法。這一設(shè)計流程非常適合設(shè)計人員在應(yīng)用中采用高性能 DSP，這些應(yīng)用包括，雷達、無線基站、工業(yè)自動化、儀表和醫(yī)療圖像等。
上傳時間： 2015-01-01
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本文是基于Arria V和Cyclone V精度可調(diào)DSP模塊的高性能DSP應(yīng)用與實現(xiàn)（英文資料）
標簽： DSP Cyclone Arria 精度可調(diào)
上傳時間： 2013-10-27
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介紹了一種基于DSP和FPGA的磁鐵電源控制器的設(shè)計方案，闡述了該控制器硬件系統(tǒng)的組成，包括信號調(diào)理電路、中間數(shù)據(jù)處理部分、后端的驅(qū)動電路。同時給出了DSP和FPGA之間通過SPI接口通信的具體流程和輸出PWM波形死區(qū)部分的控制流程。設(shè)計的磁鐵電源控制器有很好的控制和運算能力，同時具有很好的靈活性和可靠性。
上傳時間： 2013-11-16
上傳用戶：1051290259
Alter FPGA的設(shè)計流程以及DSP設(shè)計.
上傳時間： 2013-11-07
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