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DUT

  • MEMS傳感器的靜止帶寬測試

    對于采用MEMS加速度計和陀螺儀的工業系統而言,優化帶寬可能是關鍵考慮因素。這代表著精度(噪聲)與響應時間之間的一種經典權衡。雖然多數MEMS傳感器制造商都會給出典型帶寬指標,往往還需要驗證傳感器或整個系統的實際帶寬。在確定加速度計和陀螺儀的帶寬特性時,一般需要使用振動臺或其他機械激勵源。要精確確定特性,需要全面了解應用于受測器件(DUT)的運動。在此過程中需要管理多種潛在誤差源。在機械帶寬測定中,一個常見的誤差源是諧振。導致機械諧振的原因有多種,包括激勵源維護不當、DUT與激勵源耦合不良以及基準傳感器放置等。這些誤差的隔離十分耗時,可能給至關重要的項目進度帶來風險。  

    標簽: MEMS 傳感器 帶寬測試

    上傳時間: 2013-11-01

    上傳用戶:王小奇

  • 多音頻訊號的量測及分析系統--DAQ Card的應用

    量測/測試所面臨之問題 此測試驗證上,要使用NI公司之LAB VIEW及DAQ CARD來取代AUDIO PRECISION及其所附軟體ATS。首先需克服硬體解析度上的差異,再來是FFT(FAST FOURIER TRANSFORM,快速傳立業轉換)演算未予的撰寫,這將會影響MULTI-TONE訊號上PEAK值的偵測。另外,以RS-232為I/O介面,并呼叫客戶所提供之DLL檔來與DUT內的IC溝通,但因LAB VIEW無法直接呼叫其STRUCTURE,故需用VC++再編譯一層新的DLL來供LAB VIEW使用。

    標簽: Card DAQ 音頻訊號

    上傳時間: 2013-12-13

    上傳用戶:longlong12345678

  • UART 4 UART參考設計,Xilinx提供VHDL代碼

    UART 4 UART參考設計,Xilinx提供VHDL代碼 uart_vhdl This zip file contains the following folders:  \vhdl_source  -- Source VHDL files:      uart.vhd  - top level file      txmit.vhd - transmit portion of uart      rcvr.vhd -  - receive portion of uart \vhdl_testfixture  -- VHDL Testbench files. This files only include the testbench behavior, they         do not instantiate the DUT. This can easily be done in a top-level VHDL          file or a schematic. This folder contains the following files:      txmit_tb.vhd  -- Test bench for txmit.vhd.      rcvr_tf.vhd  -- Test bench for rcvr.vhd.

    標簽: UART Xilinx VHDL 參考設計

    上傳時間: 2013-11-07

    上傳用戶:jasson5678

  • UART 4 UART參考設計,Xilinx提供VHDL代碼

    UART 4 UART參考設計,Xilinx提供VHDL代碼 uart_vhdl This zip file contains the following folders:  \vhdl_source  -- Source VHDL files:      uart.vhd  - top level file      txmit.vhd - transmit portion of uart      rcvr.vhd -  - receive portion of uart \vhdl_testfixture  -- VHDL Testbench files. This files only include the testbench behavior, they         do not instantiate the DUT. This can easily be done in a top-level VHDL          file or a schematic. This folder contains the following files:      txmit_tb.vhd  -- Test bench for txmit.vhd.      rcvr_tf.vhd  -- Test bench for rcvr.vhd.

    標簽: UART Xilinx VHDL 參考設計

    上傳時間: 2013-11-02

    上傳用戶:18862121743

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