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FPGA-VLSI

  • 一種基于FPGA-VLSI的設(shè)計方案及實(shí)現(xiàn)

    一種基于FPGA-VLSI的設(shè)計方案及實(shí)現(xiàn)

    標(biāo)簽: FPGA-VLSI 設(shè)計方案

    上傳時間: 2013-08-26

    上傳用戶:zhyiroy

  • 一種基于FPGA-VLSI的設(shè)計方案及實(shí)現(xiàn)

    一種基于FPGA-VLSI的設(shè)計方案及實(shí)現(xiàn)

    標(biāo)簽: FPGA-VLSI 設(shè)計方案

    上傳時間: 2013-12-12

    上傳用戶:erkuizhang

  • Adaboost算法的VLSI設(shè)計研究和FPGA實(shí)現(xiàn).rar

    隨著計算機(jī)科學(xué)在人機(jī)交互領(lǐng)域的極大發(fā)展,作為人臉信息處理中的一項(xiàng)關(guān)鍵技術(shù),人臉檢測現(xiàn)在已經(jīng)成為模式識別,計算機(jī)視覺和人機(jī)交互領(lǐng)域不可缺少的一部分。但是,人臉檢測算法存在計算量大、速度慢等缺點(diǎn)。軟件實(shí)現(xiàn)方式無法達(dá)到實(shí)時處理要求,而現(xiàn)有的硬件實(shí)現(xiàn)需要占用大量硬件資源。 本文針對現(xiàn)有人臉檢測硬件實(shí)現(xiàn)的缺點(diǎn),通過對Adaboost算法和現(xiàn)有硬件結(jié)構(gòu)的分析,提出了雙流水線硬件檢測架構(gòu):掃描窗口流水線、特征向量流水線。并在Vertex-II Pro FPGA平臺驗(yàn)證成功,達(dá)到實(shí)時檢測的標(biāo)準(zhǔn)。具體工作和創(chuàng)新點(diǎn)包括如下幾點(diǎn): 介紹了人臉檢測的原理以及人臉檢測經(jīng)典算法。其中,詳細(xì)介紹了Adaboost算法。 對現(xiàn)有的結(jié)構(gòu)進(jìn)行詳細(xì)分析。指出現(xiàn)有各架構(gòu)的缺點(diǎn),即資源占用多,檢測速度慢。針對這兩個問題,本文提出了一個適合嵌入式應(yīng)用的掃描窗口、特征向量雙流水線檢測硬件架構(gòu),詳細(xì)說明了該架構(gòu)的工作原理,并在該架構(gòu)基礎(chǔ)上,通過加入預(yù)測加載技術(shù),進(jìn)一步提高檢測速度。隨后,采用存儲器訪問效率,架構(gòu)內(nèi)部存儲單元大小,檢測時間長短,運(yùn)算單元數(shù)量四個標(biāo)準(zhǔn),詳細(xì)比較了新架構(gòu)和現(xiàn)有架構(gòu)的差別,顯示出新架構(gòu)的優(yōu)勢。 基于提出的架構(gòu),給出了Adaboost人臉檢測系統(tǒng)的VLSI實(shí)現(xiàn)方案。本文中,采用自頂向下的設(shè)計方法將人臉檢測系統(tǒng)分成若干個子模塊,然后對每個子模塊進(jìn)行詳細(xì)的設(shè)計和說明,給出了每個子模塊的硬件架構(gòu)、狀態(tài)轉(zhuǎn)換以及verilog實(shí)現(xiàn)后的仿真波形。 采用Xilinx公司的VII Pro FPGA開發(fā)板完成人臉檢測系統(tǒng)的硬件驗(yàn)證。FPGA驗(yàn)證結(jié)果表明對于QCIF分辨率的視頻圖像,人臉檢測系統(tǒng)能夠達(dá)到50fps的檢測速度,滿足實(shí)時檢測的要求。

    標(biāo)簽: Adaboost VLSI FPGA

    上傳時間: 2013-06-15

    上傳用戶:1193169035

  • IEEE 802.16a RS-CC編譯碼VLSI算法研究及FPGA實(shí)現(xiàn)

      本論文依據(jù)IEEE802.16a物理層對RS-CC碼的參數(shù)要求,研究了RS-CC碼的高速編、譯碼的VLSI硬件算法,同時對FPGA開發(fā)技術(shù)進(jìn)行了研究,以VerilogHDL為描述語言,在Xilinx公司的FPGA上實(shí)現(xiàn)了高速的RS-CC編、譯碼器。RS譯碼器中,錯誤位置多項(xiàng)式和錯誤值多項(xiàng)式的求解采用無求逆單元,并具有規(guī)則數(shù)據(jù)流、易于VLSI實(shí)現(xiàn)的改進(jìn)的歐幾里德算法(MEA);CC譯碼器由采用模歸一化路徑度量的全并行的“加比選(ACS)”模塊和具有脈動陣列結(jié)構(gòu)的幸存路徑回溯模塊組成。  在實(shí)現(xiàn)RS-CC譯碼器的過程中,分別從算法上和根據(jù)FPGA的結(jié)構(gòu)特點(diǎn)上,對譯碼器做了一些優(yōu)化工作,降低了硬件資源占有率和提高了譯碼速度。  此外,還搭建了以Xilinx公司40萬等效門的FPGASpartan-Ⅲ400-4PQ208為主體,以Cypress公司的USB2.0芯片CY7C68013為高速數(shù)據(jù)接口的硬件試驗(yàn)平臺,并在此試驗(yàn)平臺上實(shí)現(xiàn)了文中的高速RS-CC編譯碼系統(tǒng)。

    標(biāo)簽: 802.16 RS-CC IEEE FPGA

    上傳時間: 2013-06-03

    上傳用戶:lx9076

  • H264幀間預(yù)測算法研究與FPGA設(shè)計.rar

    隨著數(shù)字化技術(shù)的飛速發(fā)展,數(shù)字視頻信號的傳輸技術(shù)更是受到人們的關(guān)注。相比較其它類型的信息傳輸如文本和數(shù)據(jù),視頻通信需要占用更多的帶寬資源,因此為了實(shí)現(xiàn)在帶寬受限的條件下的傳輸,視頻源必須經(jīng)過大量壓縮。盡管現(xiàn)在的網(wǎng)絡(luò)狀況不斷地改善,但相對與快速增長的視頻業(yè)務(wù)而言,網(wǎng)絡(luò)帶寬資源仍然是遠(yuǎn)遠(yuǎn)不夠的。2003年3月,新一代視頻壓縮標(biāo)準(zhǔn)H.264/AVC的推出,使視頻壓縮研究進(jìn)入了一個新的層次。H.264標(biāo)準(zhǔn)中包含了很多先進(jìn)的視頻壓縮編碼方法,與以前的視頻編碼標(biāo)準(zhǔn)相比具有明顯的進(jìn)步。在相同視覺感知質(zhì)量的情況下,H.264的編碼效率比H.263提高了一倍左右,并且有更好的網(wǎng)絡(luò)友好性。然而,高編碼壓縮率是以很高的計算復(fù)雜度為代價的,H.264標(biāo)準(zhǔn)的計算復(fù)雜度約為H.263的3倍,所以在實(shí)際應(yīng)用中必須對其算法進(jìn)行優(yōu)化以減低其計算復(fù)雜度。 @@ 本文首先介紹了H.264標(biāo)準(zhǔn)的研究背景,分析了國內(nèi)外H.264硬件系統(tǒng)的研究現(xiàn)狀,并介紹了本文的主要工作。 @@ 接著對H.264編碼標(biāo)準(zhǔn)的理論知識、關(guān)鍵技術(shù)分別進(jìn)行了介紹。 @@ 對H.264塊匹配運(yùn)動估計算法進(jìn)行研究,對經(jīng)典的塊匹配運(yùn)動估計算法通過對比分析,三步、二維等算法在搜索效率上優(yōu)于全搜索算法,而全搜索算法在數(shù)據(jù)流的規(guī)則性和均勻性有著自己的優(yōu)越性。 @@ 針對塊匹配運(yùn)動估計全搜索算法的VLSI結(jié)構(gòu)的特點(diǎn),提出改進(jìn)的塊匹配運(yùn)動估計全搜索算法。本文基于對數(shù)據(jù)流的分析,對硬件尋址進(jìn)行了研究。通過一次完整的全搜索數(shù)據(jù)流分析,改進(jìn)的塊匹配運(yùn)動估計算法在時鐘周期、PE資源消耗方面得到優(yōu)化。 @@ 最后基于FPGA平臺對整像素運(yùn)動估計模塊進(jìn)行了研究。首先對運(yùn)動估計模塊結(jié)構(gòu)進(jìn)行了功能子模塊劃分;然后對每個子模塊進(jìn)行設(shè)計和仿真和對整個運(yùn)動估計模塊進(jìn)行聯(lián)合仿真驗(yàn)證。 @@關(guān)鍵詞:H.264;FPGA;QuartusⅡ;幀間預(yù)測;運(yùn)動估計;塊匹配

    標(biāo)簽: H264 FPGA 幀間預(yù)測

    上傳時間: 2013-04-24

    上傳用戶:zttztt2005

  • 基于FPGA的數(shù)字圖像處理的研究.rar

    圖像是人類智能活動重要的信息來源之一,是人類相互交流和認(rèn)識世界的主要媒體。隨著信息高速公路、數(shù)字地球概念的提出,人們對圖像處理技術(shù)的需求與日劇增,同時VLSI技術(shù)的發(fā)展給圖像處理技術(shù)的應(yīng)用提供了廣闊的平臺。圖像處理技術(shù)是圖像識別和分析的基礎(chǔ),所以圖像處理技術(shù)對整個圖像工程來說就非常重要,對圖像處理技術(shù)的實(shí)現(xiàn)的研究也就具有重要的理論意義與實(shí)用價值,包括對傳統(tǒng)算法的改進(jìn)和硬件實(shí)現(xiàn)的研究。仿生算法的興起為圖像處理問題的解決提供了一條十分有效的新途徑;FPGA技術(shù)的發(fā)展為圖像處理的硬件實(shí)現(xiàn)提供了有效的平臺。 @@ 本文在詳細(xì)介紹鄰域圖像處理算法及其數(shù)據(jù)結(jié)構(gòu)、遺傳算法和蟻群算法基本原理的基礎(chǔ)上,將其應(yīng)用于圖像增強(qiáng)和圖像分割的圖像處理問題之中,并將其用FPGA技術(shù)實(shí)現(xiàn)。論文中采用遺傳算法自適應(yīng)的確定非線性變換函數(shù)的參數(shù)對圖像進(jìn)行增強(qiáng),在采用FPGA來實(shí)現(xiàn)的過程中先對系統(tǒng)進(jìn)行模塊劃分,主要分為初始化模塊、選擇模塊、適應(yīng)度模塊、控制模塊等,然后利用VHDL語言描述各個功能模塊,為了提高設(shè)計效率,利用IP核進(jìn)行存儲器設(shè)計,利用DSP Builder進(jìn)行數(shù)學(xué)運(yùn)算處理。時序控制是整個系統(tǒng)設(shè)計的核心,為盡量避免毛刺現(xiàn)象,各模塊的時序控制都是采用單進(jìn)程的Moore狀態(tài)機(jī)實(shí)現(xiàn)的。在圖像分割環(huán)節(jié)中,圖像分割問題轉(zhuǎn)換為求圖像的最大熵問題,采用蟻群算法對改進(jìn)的最大熵確定的適應(yīng)度函數(shù)進(jìn)行優(yōu)化,并對基于FPGA和蟻群算法實(shí)現(xiàn)圖像分割的各個模塊設(shè)計進(jìn)行了詳細(xì)介紹。 @@ 對實(shí)驗(yàn)結(jié)果進(jìn)行分析表明遺傳算法和蟻群算法在數(shù)字圖像處理中的使用明顯改善了處理的效果,在利用FPGA實(shí)現(xiàn)遺傳算法和蟻群算法的整個設(shè)計過程中由于充分發(fā)揮了FPGA的并行計算能力及流水線技術(shù)的應(yīng)用,大大提高算法的運(yùn)行速度。 @@關(guān)鍵詞:圖像處理;遺傳算法;蟻群算法;FPGA

    標(biāo)簽: FPGA 數(shù)字圖像處理

    上傳時間: 2013-06-03

    上傳用戶:小火車?yán)怖怖?/p>

  • 基于FPGA的實(shí)時圖像采集與處理系統(tǒng)研究.rar

    隨著數(shù)碼技術(shù)的不斷發(fā)展,數(shù)字圖像處理的應(yīng)用領(lǐng)域不斷擴(kuò)大,其實(shí)時處理技術(shù)成為研究的熱點(diǎn)。VLSI技術(shù)的迅猛發(fā)展為數(shù)字圖像實(shí)時處理技術(shù)提供了硬件基礎(chǔ)。其中FPGA(現(xiàn)場可編程門陣列)的特點(diǎn)使其非常適用于進(jìn)行一些基于像素級的圖像處理。 傳統(tǒng)的圖像顯示系統(tǒng)必須連接到PC才能觀察圖像視頻,存在著高速實(shí)時性、穩(wěn)定性問題。本設(shè)計脫離高清晰工業(yè)相機(jī)必須與PC連接才可以觀看到高清晰圖像的束縛,實(shí)現(xiàn)系統(tǒng)的小型化。針對130萬像素彩色1/2英寸鎂光CMOS圖像傳感器,提出用硬件實(shí)現(xiàn)Bayer格式到RGB格式轉(zhuǎn)換的設(shè)計方案,完成由黑白圖像到高清彩色圖像的轉(zhuǎn)換,用SDRAM作緩存,輸出標(biāo)準(zhǔn)VGA信號,可直接連接VGA顯示器、投影儀等設(shè)備進(jìn)行實(shí)時的視頻圖像觀看,與模擬相機(jī)740X576分辨率(480線)圖像相比,設(shè)計圖像畫質(zhì)相當(dāng)于1280X1024分辨率(750線),最高幀率25fps,整個結(jié)構(gòu)應(yīng)用FPGA作為主控制器,用少量的緩存代替?zhèn)鹘y(tǒng)的大容量存儲,加快了運(yùn)算速率,減小了電路規(guī)模,滿足圖像實(shí)時處理的要求,使展現(xiàn)出來的視頻圖像得到質(zhì)的飛躍。可以廣泛應(yīng)用于工業(yè)控制和遠(yuǎn)程監(jiān)控等領(lǐng)域。 論文研究的重點(diǎn)是采用altera公司EP2C芯片前端驅(qū)動CMOS圖像傳感器,實(shí)時采集Bayer圖像象素,分析研究CFA圖像插值算法,實(shí)現(xiàn)了基于FPGA的實(shí)時線性插值算法,能夠?qū)斎胧敲肯袼?bit、分辨率為1280×1204的Bayer模式圖像數(shù)據(jù)進(jìn)行實(shí)時重構(gòu),輸出彩色RGB圖像。由端口FIFO作為數(shù)據(jù)緩沖,存儲一幀圖像到高速SDRAM,構(gòu)建VGA顯示控制器,實(shí)現(xiàn)對輸入是每像素24bit(RGB101010)、分辨率為640×480、幀頻25HZ彩色圖像進(jìn)行實(shí)時顯示。 整個模塊結(jié)構(gòu)包括電源模塊單元等、CMOS成像單元、FPGA數(shù)據(jù)處理單元、SDRAM控制單元、VGA顯示接口單元。 最后,對系統(tǒng)進(jìn)行了調(diào)試。經(jīng)實(shí)驗(yàn)驗(yàn)證,系統(tǒng)達(dá)到了實(shí)時性,能正確和可靠的工作。整個設(shè)計模塊能夠滿足高幀率和高清晰的實(shí)時圖像處理,占用系統(tǒng)資源很少,用較少的時間完成了圖像數(shù)據(jù)的轉(zhuǎn)換,提高了效率。

    標(biāo)簽: FPGA 實(shí)時圖像采集 與處理系統(tǒng)

    上傳時間: 2013-06-08

    上傳用戶:zhengjian

  • 視頻格式轉(zhuǎn)換算法研究及FPGA實(shí)現(xiàn)——去隔行、幀頻轉(zhuǎn)換、分辨率變換.rar

    在當(dāng)今的廣播系統(tǒng)中,絕大部分的視頻信號是隔行采樣的。采用這種掃描格式,能夠大幅度地減少視頻的帶寬,但也會引起彩色爬行、畫面閃爍、邊緣模糊及鋸齒等現(xiàn)象。這種缺陷經(jīng)人尺寸屏幕放大后就更加明顯。為改善畫面的視覺效果,去隔行技術(shù)應(yīng)運(yùn)而生。同時,視頻信號本身的低幀頻也會導(dǎo)致行抖動、線爬行以及大面積閃爍等視覺效果上的缺陷。增加掃描頻率會把這些視覺缺陷搬移到人眼不敏感的高頻區(qū)域上去從而產(chǎn)生較好的主觀圖象質(zhì)量。而為了適應(yīng)不同顯示終端以及對圖像大小變化的要求就必須對原始信號分辨率即每幀行數(shù)和每行像素數(shù)進(jìn)行變換。因此去隔行、幀頻轉(zhuǎn)換、分辨率變換成為視頻格式轉(zhuǎn)換的基本內(nèi)容。 FPGA 的出現(xiàn)是VLSI技術(shù)和EDA技術(shù)發(fā)展的結(jié)果。FPGA器件集成度高、體積小,具有通過用戶編程實(shí)現(xiàn)專門應(yīng)用的功能。它允許電路設(shè)計者利用基于計算機(jī)的開發(fā)平臺,經(jīng)過設(shè)計輸入、仿真、測試和校驗(yàn),直到達(dá)到預(yù)期的結(jié)果。使用FPGA器件可以大大縮短系統(tǒng)的研制周期,減少資金投入。另外采用FPGA器件可以將原來的電路板級產(chǎn)品集成芯片級產(chǎn)品,從而降低了功耗,提高了可靠性,同時還可以很方便的對設(shè)計進(jìn)行在線修改。 該文在介紹了視頻格式轉(zhuǎn)換中的主要算法后,重點(diǎn)對去隔行、幀頻轉(zhuǎn)換、分辨率變換的FPGA綜合實(shí)現(xiàn)方案進(jìn)行了由簡單到復(fù)雜的深入研究,分別給出了最簡解決方案、基于非線性算法的解決方案和基于運(yùn)動補(bǔ)償?shù)慕鉀Q方案。最簡解決方案利用線性算法將去隔行,幀頻轉(zhuǎn)換,分辨率變換三項(xiàng)處理同時實(shí)現(xiàn),達(dá)到FPGA內(nèi)部資源和外部RAM耗用量都為最小的要求,是后續(xù)復(fù)雜方案的基礎(chǔ)。其中去隔行采用場合并方式,幀頻轉(zhuǎn)換采用幀重復(fù)方式,分辨率變換采用均勻插值方式。基于非線性算法的解決方案中加入了對靜止區(qū)域的判斷,靜止區(qū)域的輸出像素值直接選用相應(yīng)位置的已存輸入數(shù)據(jù),非靜止區(qū)域的輸出像素值通過對已存輸入數(shù)據(jù)進(jìn)行非線性運(yùn)算得出。基于運(yùn)動補(bǔ)償?shù)慕鉀Q方案在對靜止區(qū)域進(jìn)行判斷和處理的基礎(chǔ)上,對欲生成的變頻后的場間插值幀進(jìn)行運(yùn)動估計,根據(jù)運(yùn)動矢量得出非靜止區(qū)域的輸出像素值。其中為求得輸入場間相應(yīng)時間位置上的插值幀輸出數(shù)據(jù),該方案采用了自定義的前后向塊匹配運(yùn)動估計方式,通過對三步搜索算法的高效實(shí)現(xiàn),將SAD 值進(jìn)行比較得出運(yùn)動矢量。

    標(biāo)簽: FPGA 視頻格式轉(zhuǎn)換 算法研究

    上傳時間: 2013-07-19

    上傳用戶:米卡

  • 高分辨率合成孔徑雷達(dá)視頻模擬器FPGA實(shí)現(xiàn)技術(shù)研究

    在合成孔徑雷達(dá)的研究和研制工作中,合成孔徑雷達(dá)模擬技術(shù)具有十分重要的作用。本文以440MHz帶寬線性調(diào)頻信號,采樣頻率500MHz高分辨合成孔徑雷達(dá)視頻模擬器為研究對象。首先對模擬器的幾項(xiàng)主要技術(shù)進(jìn)行分析,在對點(diǎn)目標(biāo)回波信號模型分析研究的基礎(chǔ)上,對點(diǎn)目標(biāo)原始回波數(shù)據(jù)進(jìn)行模擬并做了成像驗(yàn)證,從而為硬件實(shí)現(xiàn)提供了正確的信號模型;針對傳統(tǒng)的“波形存儲直讀法”方案,即在計算機(jī)平臺上用模擬軟件產(chǎn)生原始回波數(shù)據(jù)并存儲,再通過計算機(jī)接口實(shí)現(xiàn)數(shù)據(jù)傳輸,最后完成數(shù)模轉(zhuǎn)換產(chǎn)生視頻信號這一過程,分析指出該方案在實(shí)現(xiàn)高分辨率時的速度和容量瓶頸。  針對具體的設(shè)計要求,圍繞速度和容量問題,本文著眼于高分辨率SAR模擬器的FPGA實(shí)現(xiàn)研究,指出FPGA實(shí)時生成點(diǎn)目標(biāo)原始回波數(shù)據(jù)是其實(shí)現(xiàn)的核心;針對這一核心問題,充分利用現(xiàn)代VLSI設(shè)計中的流水線技術(shù)與并行陣列技術(shù)以及FPGA的優(yōu)良性能和豐富資源,在時間上采用同步流水結(jié)構(gòu)、空間上采用并行陣列形式,將速度和容量問題統(tǒng)一為數(shù)據(jù)的高速生成問題;給出了系統(tǒng)總體設(shè)計思想,該方案不需要大容量存儲器單元,大大減少模擬器復(fù)雜度;對原始回波數(shù)據(jù)實(shí)時生成模塊的各主要單元給出了結(jié)構(gòu)并進(jìn)行了仿真,結(jié)果表明FPGA可以滿足課題設(shè)計要求;同時,對該模擬器片上系統(tǒng)的實(shí)現(xiàn)、增強(qiáng)人機(jī)交互性,給出了人機(jī)界面的設(shè)計思路。  分析指出了點(diǎn)目標(biāo)原始回波數(shù)據(jù)實(shí)時生成模塊通過并行擴(kuò)展即可實(shí)現(xiàn)多點(diǎn)目標(biāo)的原始回波數(shù)據(jù)實(shí)時生成;最后對復(fù)雜場景目標(biāo)模擬器的實(shí)現(xiàn)進(jìn)行了構(gòu)思,指出了傳統(tǒng)方案在改進(jìn)的基礎(chǔ)上實(shí)現(xiàn)高分辨率視頻模擬器的可行性。本文首次提出以FPGA實(shí)現(xiàn)高分辨率合成孔徑雷達(dá)原始回波數(shù)據(jù)實(shí)時生成的思想,為國內(nèi)業(yè)界在此方向做了一些理論和實(shí)踐上的有益探索,對于國內(nèi)高分辨率合成孔徑雷達(dá)的研制具有一定的實(shí)際意義。

    標(biāo)簽: FPGA 高分辨率 合成孔徑 雷達(dá)視頻

    上傳時間: 2013-04-24

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  • 基于USB和FPGA技術(shù)的高性能數(shù)據(jù)采集模塊的設(shè)計與實(shí)現(xiàn)

    在合成孔徑雷達(dá)的研究和研制工作中,合成孔徑雷達(dá)模擬技術(shù)具有十分重要的作用。本文以440MHz帶寬線性調(diào)頻信號,采樣頻率500MHz高分辨合成孔徑雷達(dá)視頻模擬器為研究對象。首先對模擬器的幾項(xiàng)主要技術(shù)進(jìn)行分析,在對點(diǎn)目標(biāo)回波信號模型分析研究的基礎(chǔ)上,對點(diǎn)目標(biāo)原始回波數(shù)據(jù)進(jìn)行模擬并做了成像驗(yàn)證,從而為硬件實(shí)現(xiàn)提供了正確的信號模型;針對傳統(tǒng)的“波形存儲直讀法”方案,即在計算機(jī)平臺上用模擬軟件產(chǎn)生原始回波數(shù)據(jù)并存儲,再通過計算機(jī)接口實(shí)現(xiàn)數(shù)據(jù)傳輸,最后完成數(shù)模轉(zhuǎn)換產(chǎn)生視頻信號這一過程,分析指出該方案在實(shí)現(xiàn)高分辨率時的速度和容量瓶頸。  針對具體的設(shè)計要求,圍繞速度和容量問題,本文著眼于高分辨率SAR模擬器的FPGA實(shí)現(xiàn)研究,指出FPGA實(shí)時生成點(diǎn)目標(biāo)原始回波數(shù)據(jù)是其實(shí)現(xiàn)的核心;針對這一核心問題,充分利用現(xiàn)代VLSI設(shè)計中的流水線技術(shù)與并行陣列技術(shù)以及FPGA的優(yōu)良性能和豐富資源,在時間上采用同步流水結(jié)構(gòu)、空間上采用并行陣列形式,將速度和容量問題統(tǒng)一為數(shù)據(jù)的高速生成問題;給出了系統(tǒng)總體設(shè)計思想,該方案不需要大容量存儲器單元,大大減少模擬器復(fù)雜度;對原始回波數(shù)據(jù)實(shí)時生成模塊的各主要單元給出了結(jié)構(gòu)并進(jìn)行了仿真,結(jié)果表明FPGA可以滿足課題設(shè)計要求;同時,對該模擬器片上系統(tǒng)的實(shí)現(xiàn)、增強(qiáng)人機(jī)交互性,給出了人機(jī)界面的設(shè)計思路。  分析指出了點(diǎn)目標(biāo)原始回波數(shù)據(jù)實(shí)時生成模塊通過并行擴(kuò)展即可實(shí)現(xiàn)多點(diǎn)目標(biāo)的原始回波數(shù)據(jù)實(shí)時生成;最后對復(fù)雜場景目標(biāo)模擬器的實(shí)現(xiàn)進(jìn)行了構(gòu)思,指出了傳統(tǒng)方案在改進(jìn)的基礎(chǔ)上實(shí)現(xiàn)高分辨率視頻模擬器的可行性。本文首次提出以FPGA實(shí)現(xiàn)高分辨率合成孔徑雷達(dá)原始回波數(shù)據(jù)實(shí)時生成的思想,為國內(nèi)業(yè)界在此方向做了一些理論和實(shí)踐上的有益探索,對于國內(nèi)高分辨率合成孔徑雷達(dá)的研制具有一定的實(shí)際意義。

    標(biāo)簽: FPGA USB 性能 數(shù)據(jù)采集模塊

    上傳時間: 2013-05-26

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