SHA (Secure HASH Algorithm，譯作安全散列算法) 是美國國家安全局 (NSA) 設(shè)計，美國國家標(biāo)準(zhǔn)與技術(shù)研究院 (NIST) 發(fā)布的一系列密碼散列函數(shù)。正式名稱為 SHA 的家族第一個成員發(fā)布于 1993年。然而現(xiàn)在的人們給它取了一個非正式的名稱 SHA-0 以避免與它的后繼者混淆。兩年之后， SHA-1，第一個 SHA 的后繼者發(fā)布了。 另外還有四種變體，曾經(jīng)發(fā)布以提升輸出的范圍和變更一些細微設(shè)計: SHA-224, SHA-256, SHA-384 和 SHA-512 (這些有時候也被稱做 SHA-2)。
標(biāo)簽： Algorithm Secure HASH SHA
上傳時間： 2014-03-02
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用SHA算法實現(xiàn)對任意文件的HASH摘要，并且把HASH摘要值（至少為160bit）存入另一個文件，形如： HASH inputfile HASHvaluefile 說明：SHA算法的實現(xiàn)至少為160bit，或者可以選擇256，384或者512的，可以查閱相關(guān)資料，按照標(biāo)準(zhǔn)來實現(xiàn)（HASH的算法是否正確，可以和網(wǎng)上的標(biāo)準(zhǔn)算法對比，用相同的輸入看是否能夠得到相同的輸出）控制臺編程： int main(int argc, char *argv[ ])
上傳時間： 2017-07-11
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realization of HASH function
標(biāo)簽： realization function HASH of
上傳時間： 2017-07-16
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sah-1(Secure HASH Algorithm,安全散列算法)算法源程序
標(biāo)簽： Algorithm Secure HASH sah
上傳時間： 2017-07-19
上傳用戶：梧桐
toeplitz HASH算法實現(xiàn)，支持微軟Receive-Side Scaling機制
上傳時間： 2014-01-17
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This general HASH alogorithm implementation. This code has expamle for HASH implementaio for 16bit to 64bit processor implementations
標(biāo)簽： This HASH implementation implementaio
上傳時間： 2014-02-07
上傳用戶：15736969615
Sha256 Algorithm. The SHA HASH functions are a set of cryptographic HASH functions designed by the National Security Agency (NSA) and published by the NIST as a U.S. Federal Information Processing Standard. SHA stands for Secure HASH Algorithm
標(biāo)簽： functions HASH cryptographic Algorithm
上傳時間： 2014-11-09
上傳用戶：1109003457
HASH file.
上傳時間： 2014-01-04
上傳用戶：13160677563
只是實驗了dpdk中的toeplitz HASH
上傳時間： 2017-09-20
上傳用戶：andyleo0
隨著以太網(wǎng)技術(shù)的不斷發(fā)展，網(wǎng)絡(luò)的傳輸速度已經(jīng)由最初的10M發(fā)展到現(xiàn)在的10,000M。用可編程邏輯器件(FPGA)實現(xiàn)以太網(wǎng)控制器與其它SOC系統(tǒng)的互連成為當(dāng)前的研究熱點。本文闡述了MAC層的FPGA設(shè)計、仿真及測試；介紹了整個系統(tǒng)的內(nèi)部結(jié)構(gòu)、模塊劃分，并對各個模塊的設(shè)計過程進行了詳細闡述，接著介紹了開發(fā)環(huán)境和驗證工具，同時給出測試方案、驗證數(shù)據(jù)、實現(xiàn)結(jié)果及時序仿真波形圖。 對MAC層的主要功能模塊如:發(fā)送模塊、接收模塊、MAC流程控制模塊、寄存器模塊、MⅡ接口模塊和主機接口模塊以及CRC，CSMA/CD，HASH表等算法給出了基于FPGA及硬件描述語言的解決方法。 本課題針對以下三個方面進行了研究并取得一定的成果: 1)FPGA開發(fā)平臺的硬件實現(xiàn)。選用Xilinx公司的XC3S1000-FT256-4-C和ATMEL公司的ARM9200作為測試的核心器件，采用LXT971芯片作為物理層芯片，AT91RM9200作為數(shù)據(jù)輸入源和雙blockram作為幀緩存搭建FPGA硬件驗證開發(fā)平臺。 2)基于FPGA實現(xiàn)以太網(wǎng)控制器。用VerilogHDL語言構(gòu)建以太網(wǎng)控制器，實現(xiàn)CSMA/CD協(xié)議、10M/100M自適應(yīng)以及與物理層MⅡ接口等。 3)采用片上系統(tǒng)通用的WS接口。目的是便于與具有通用接口的片上系統(tǒng)互連，也為構(gòu)建SOC上處理器提供條件。 本論文實現(xiàn)了一個基于WS總線接口可裁減的以太網(wǎng)MAC控制器IP軟核，為設(shè)計具有自主知識產(chǎn)權(quán)的以太網(wǎng)MAC控制器積累了經(jīng)驗。同時，為與其它WS接口的控制器實現(xiàn)直接互連創(chuàng)造了條件，對高層次設(shè)計這一先進ASIC設(shè)計方法也有了較為深入的認(rèn)識。
標(biāo)簽： 10M100M FPGA 以太網(wǎng)控制器
上傳時間： 2013-07-17
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