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IC<b>芯片</b>

離散實驗一個包的傳遞用warshall

實驗源代碼 //Warshall.cpp #include<stdio.h> void warshall(int k,int n) { int i , j, t; int temp[20][20]; for(int a=0;a<k;a++) { printf("請輸入矩陣第%d 行元素:",a); for(int b=0;b<n;b++) { scanf ("%d",&temp[a][b]); } } for(i=0;i<k;i++){ for( j=0;j<k;j++){ if(temp[ j][i]==1) { for(t=0;t<n;t++) { temp[ j][t]=temp[i][t]||temp[ j][t]; } } } } printf("可傳遞閉包關系矩陣是:\n"); for(i=0;i<k;i++) { for( j=0;j<n;j++) { printf("%d", temp[i][ j]); } printf("\n"); } } void main() { printf("利用 Warshall 算法求二元關系的可傳遞閉包\n"); void warshall(int,int); int k , n; printf("請輸入矩陣的行數 i: "); scanf("%d",&k); 四川大學實驗報告 printf("請輸入矩陣的列數 j: "); scanf("%d",&n); warshall(k,n); }

標簽： warshall 離散實驗

上傳時間： 2016-06-27

上傳用戶：梁雪文以
道理特分解法

#include "iostream" using namespace std; class Matrix { private: double** A; //矩陣A double *b; //向量b public: int size; Matrix(int ); ~Matrix(); friend double* Dooli(Matrix& ); void Input(); void Disp(); }; Matrix::Matrix(int x) { size=x; //為向量b分配空間并初始化為0 b=new double [x]; for(int j=0;j<x;j++) b[j]=0; //為向量A分配空間并初始化為0 A=new double* [x]; for(int i=0;i<x;i++) A[i]=new double [x]; for(int m=0;m<x;m++) for(int n=0;n<x;n++) A[m][n]=0; } Matrix::~Matrix() { cout<<"正在析構中~~~~"<<endl; delete b; for(int i=0;i<size;i++) delete A[i]; delete A; } void Matrix::Disp() { for(int i=0;i<size;i++) { for(int j=0;j<size;j++) cout<<A[i][j]<<" "; cout<<endl; } } void Matrix::Input() { cout<<"請輸入A:"<<endl; for(int i=0;i<size;i++) for(int j=0;j<size;j++){ cout<<"第"<<i+1<<"行"<<"第"<<j+1<<"列:"<<endl; cin>>A[i][j]; } cout<<"請輸入b:"<<endl; for(int j=0;j<size;j++){ cout<<"第"<<j+1<<"個:"<<endl; cin>>b[j]; } } double* Dooli(Matrix& A) { double *Xn=new double [A.size]; Matrix L(A.size),U(A.size); //分別求得U，L的第一行與第一列 for(int i=0;i<A.size;i++) U.A[0][i]=A.A[0][i]; for(int j=1;j<A.size;j++) L.A[j][0]=A.A[j][0]/U.A[0][0]; //分別求得U，L的第r行，第r列 double temp1=0,temp2=0; for(int r=1;r<A.size;r++){ //U for(int i=r;i<A.size;i++){ for(int k=0;k<r-1;k++) temp1=temp1+L.A[r][k]*U.A[k][i]; U.A[r][i]=A.A[r][i]-temp1; } //L for(int i=r+1;i<A.size;i++){ for(int k=0;k<r-1;k++) temp2=temp2+L.A[i][k]*U.A[k][r]; L.A[i][r]=(A.A[i][r]-temp2)/U.A[r][r]; } } cout<<"計算U得:"<<endl; U.Disp(); cout<<"計算L的:"<<endl; L.Disp(); double *Y=new double [A.size]; Y[0]=A.b[0]; for(int i=1;i<A.size;i++ ){ double temp3=0; for(int k=0;k<i-1;k++) temp3=temp3+L.A[i][k]*Y[k]; Y[i]=A.b[i]-temp3; } Xn[A.size-1]=Y[A.size-1]/U.A[A.size-1][A.size-1]; for(int i=A.size-1;i>=0;i--){ double temp4=0; for(int k=i+1;k<A.size;k++) temp4=temp4+U.A[i][k]*Xn[k]; Xn[i]=(Y[i]-temp4)/U.A[i][i]; } return Xn; } int main() { Matrix B(4); B.Input(); double *X; X=Dooli(B); cout<<"~~~~解得:"<<endl; for(int i=0;i<B.size;i++) cout<<"X["<<i<<"]:"<<X[i]<<" "; cout<<endl<<"呵呵呵呵呵"; return 0; }

標簽： 道理特分解法

上傳時間： 2018-05-20

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FPGA的作用與簡介.pdf

FPGA的作用與簡介.pdf1. 什么是 FPGA ? 一個 FPGA 是一種包含有一個可重配置的門陣列邏輯電路矩陣的設備。通過配置， FPGA 的內部電路以一定方式相連接，從而創建了軟件應用的一個硬件實現。與處理器不同，FPGA 使用專用硬件進行邏輯處理，而不具有操作系統。FPGA 在本質上是完全并行的，故不同的處理操作不必競爭相同的資源。因此，增加額外的處理時，應用某一部分的性能不會受影響。而且，多個控制循環可以以不同的速率在單個 FPGA 設備上運行。基于 FPGA 的控制系統可以加強關鍵互鎖邏輯，也可以通過設計防止操作人員強奪 I/O。然而，不同于擁有固定硬件資源的硬連接的印制電路板（PCB）設計，基于 FPGA 的系統可以完全重新連接其內部電路，以支持控制系統在現場部署后可以重新配置。FPGA 設備提供了專用硬件電路所特有的性能與可靠性。單個 FPGA 可以通過在單個集成電路（IC）芯片上集成數百萬個邏輯門以代替數以千計的分立元件。一個 FPGA 芯片的內部資源包括一個被 I/O 組塊環圍的可配置邏輯組塊（CLB）矩陣。在 FPGA 矩陣內，信號通過可編程的互連開關和連線傳遞。 CompactRIO 入門教程 2 CompactRIO 入門教程圖 2.FPGA 芯片的內部構造

標簽： fpga

上傳時間： 2022-02-18

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安森美車規級1080P圖像傳感器AR0231手冊

AR0231AT7C00XUEA0-DRBR（RGB濾光）安森美半導體推出采用突破性減少LED閃爍 (LFM)技術的新的230萬像素CMOS圖像傳感器樣品AR0231AT，為汽車先進駕駛輔助系統(ADAS)應用確立了一個新基準。新器件能捕獲1080p高動態范圍(HDR)視頻，還具備支持汽車安全完整性等級B(ASIL B)的特性。LFM技術(專利申請中)消除交通信號燈和汽車LED照明的高頻LED閃爍，令交通信號閱讀算法能于所有光照條件下工作。AR0231AT具有1/2.7英寸(6.82 mm)光學格式和1928(水平) x 1208(垂直)有源像素陣列。它采用最新的3.0微米背照式(BSI)像素及安森美半導體的DR-Pix?技術，提供雙轉換增益以在所有光照條件下提升性能。它以線性、HDR或LFM模式捕獲圖像，并提供模式間的幀到幀情境切換。 AR0231AT提供達4重曝光的HDR，以出色的噪聲性能捕獲超過120dB的動態范圍。AR0231AT能同步支持多個攝相機，以易于在汽車應用中實現多個傳感器節點，和通過一個簡單的雙線串行接口實現用戶可編程性。它還有多個數據接口，包括MIPI(移動產業處理器接口)、并行和HiSPi(高速串行像素接口)。其它關鍵特性還包括可選自動化或用戶控制的黑電平控制，支持擴頻時鐘輸入和提供多色濾波陣列選擇。封裝和現狀：AR0231AT采用11 mm x 10 mm iBGA-121封裝，現提供工程樣品。工作溫度范圍為-40℃至105℃(環境溫度)，將完全通過AEC-Q100認證。

標簽： 圖像傳感器

上傳時間： 2022-06-27

上傳用戶：XuVshu
使用DVCC實驗系統中的并行接口芯片8255A的B口作輸入口

使用DVCC實驗系統中的并行接口芯片8255A的B口作輸入口，使工作于方式1,將PB0～PB7連接到手動開關K1～K8,將手動脈沖信號SP作為8255B口的選通信號，連接到PC2。將B品工作于方式1時的中斷請求信號（PC0）連接到8255A的IR3,8255A的片選信號無需連接（系統已連接好）。8259A的CS連接地址譯碼輸出端Y6,8259A的端口地址為60H、61H

標簽： 8255A DVCC 實驗系統并行接口

上傳時間： 2013-12-28

上傳用戶：xinyuzhiqiwuwu
IC卡破解,教程可以破解一般加密的A.B類智能IC卡

IC卡破解,教程可以破解一般加密的A.B類智能IC卡

標簽： A.B 破解 IC卡教程

上傳時間： 2014-08-26

上傳用戶：wfeel
利用福星曉程芯片3105開發多功能表時B、C相CPU的軟件程序

利用福星曉程芯片3105開發多功能表時B、C相CPU的軟件程序

標簽： 3105 CPU 芯片多功能表

上傳時間： 2017-01-31

上傳用戶：tedo811
基于FPGA的B型超聲成像系統的設計與實現.rar

便攜式B型超聲診斷儀具有無創傷、簡便易行、相對價廉等優勢，在臨床中越來越得到廣泛的應用。它將超聲波技術、微電子技術、計算機技術、機械設計與制造及生物醫學工程等技術融合在一起。開展該課題的研究對提高臨床診斷能力和促進我國醫療事業的發展具有重要的意義。便攜式B型超聲診斷儀由人機交互系統、探頭、成像系統、顯示系統構成。其基本工作過程是：首先人機交互系統接收到用戶通過鍵盤或鼠標發出的命令，然后成像系統根據命令控制探頭發射超聲波，并對回波信號處理、合成圖像，最后通過顯示系統完成圖像的顯示。成像系統作為便攜式B型超聲診斷儀的核心對圖像質量有決定性影響，但以前研制的便攜式B型超聲診斷儀的成像系統在三個方面存在不足：第一、采用的是單片機控制步進電機，控制精度不高，導致成像系統采樣不精確；第二、采用的數字掃描變換算法太粗糙，影響超聲圖像的分辨率；第三、它的CPU多采用的是51系列單片機，測量速度太慢，同時也不便于系統升級和擴展。針對以上不足，提出了基于FPGA的B型超聲成像系統解決方案，采用Altera公司的EP2C5Q208C8芯片實現了步進電機步距角的細分，使電機旋轉更勻速，提高了采樣精度；提出并采用DSTI-ULA算法（Uniform Ladder Algorithm based on Double Sample and Trilinear Interotation）在FPGA內實現數字掃描變換，提高了圖像分辨率；人機交互系統采用S3C2410-AL作為CPU，改善了測量速度和系統的擴展性。通過對系統硬件電路的設計、制作，軟件的編寫、調試，結果表明，本文所設計的便攜式B型超聲成像系統圖像分辨率高、測量速度快、體積小、操作方便。本文所設計的便攜式B型超聲診斷儀可在野外作業和搶險（諸如地震、抗洪）中發揮作用，同時也可在鄉村診所中完成對相關疾病的診斷工作。

標簽： FPGA 超聲成像

上傳時間： 2013-05-18

上傳用戶：helmos
介紹一個基于U S B 2 . 0 接口和D S P 的高速數據采集處理系統的工作原理設計及實現該高速數據采集處理系統采用TI 公司的TMS320C6000 數字信號處理器和Cypress 公司的

介紹一個基于U S B 2 . 0 接口和D S P 的高速數據采集處理系統的工作原理設計及實現該高速數據采集處理系統采用TI 公司的TMS320C6000 數字信號處理器和Cypress 公司的USB2.0 接口芯片可以實現高速采集和實時處理有著廣泛的應用前景

標簽： Cypress C6000 320C 6000

上傳時間： 2013-11-27

上傳用戶：koulian
基于verilog HDL的自動售貨機控制電路設計: 可以對5種不同種類的貨物進行自動售貨,價格分別為A=1.00,B=1.50,C=1.80,D=3.10,E=5.00 。售貨機可以接受1元,5角

基于verilog HDL的自動售貨機控制電路設計: 可以對5種不同種類的貨物進行自動售貨,價格分別為A=1.00,B=1.50,C=1.80,D=3.10,E=5.00 。售貨機可以接受1元,5角,1角三種硬幣(即有三種輸入信號IY,IWJ,IYJ),并且在一個3位7段LED(二位代表元,一位代表角)顯示以投入的總錢數，最大9.90元，如果大于該數值，新投入的硬幣會退出,選擇貨物的輸入信號Ia,Ib,Ic,Id,Ie和一個放棄信號In,輸出指示信號為 Sa, Sb ,Sc ,Sd, Se 分別表示售出相應的貨物,同時輸出的信號yuan, jiao代表找零,相應每個脈沖代表找零相應的硬幣，上述輸入和輸出信號均是一個固定寬度的脈沖信號。

標簽： verilog 1.00 1.50 1.80

上傳時間： 2016-07-12

上傳用戶：lanwei

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