專輯類-網絡及電腦相關專輯-114冊-4.31G TCP-IP詳解.CISCO詳解-273M.zip
上傳時間： 2013-04-24
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專輯類-網絡及電腦相關專輯-114冊-4.31G ip地址管理與子網劃分-5.3M-PDF.zip
上傳時間： 2013-07-21
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專輯類-網絡及電腦相關專輯-114冊-4.31G 高級網絡操作系統及其應用——TCP~IP協議與分組無線網-10.1M-PDF.pdf
上傳時間： 2013-06-22
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專輯類-網絡及電腦相關專輯-114冊-4.31G 無線傳感器網絡路由協議分析-6頁-0.2M.pdf
上傳時間： 2013-06-30
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專輯類-網絡及電腦相關專輯-114冊-4.31G 移動IP技術指南-7.7M-PDF.zip
上傳時間： 2013-06-17
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專輯類-網絡及電腦相關專輯-114冊-4.31G CISCO路由詳解-95M-pdf版.zip
上傳時間： 2013-04-24
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專輯類-網絡及電腦相關專輯-114冊-4.31G Cisco-TCP_IP路由管理專業參考-第3版-19.7M-PDF.zip
標簽： Cisco-TCP_IP M-PDF 19.7 zip
上傳時間： 2013-07-27
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隨著生活水平的提高，人們越來越關注自己的身體健康，血壓是反映人體生理狀況的最重要指標之一，正常的血壓是保證身體健康的重要條件。 另外血壓也是重癥病人監護的重要指標，準確、及時地監測血壓，對于了解病情、診斷疾病和保障危重病人安全都極為重要。因此，研制高性能的血壓監控系統具有重要的現實意義。 針對以上所述，本文提出了一種采用遠程血壓監控系統的解決方案，它融合計算機技術、測控技術和網絡通訊技術為一體，使電子血壓系統實現網絡化。本系統將采集到的血壓信息經處理后顯示到液晶屏上，同時將此信息以TCP/IP的方式發送到網絡上，這就是本設計的目的所在。 本論文在開始介紹了人體生理信號的特點及其測量條件之后，詳細研究分析了血壓測量原理以及舒張壓和收縮壓的判別。論文的重點放在系統硬件和軟件兩個方面的設計。在硬件方面，以ARM Cortex-M3內核的處理器LM3S8962作為控制器（內部集成有A/D轉換器和以太網控制器等），使得硬件系統的設計簡單化。整個硬件系統電路由六部分構成：處理器LM3S8962最小系統電路；電源模塊：JTAG接口電路：血壓檢測模塊；液晶顯示模塊；網絡接口。其中，血壓檢測模塊是整個系統設計的關鍵部分和難點部分，它主要是將袖壓的直流部分和交流部分分離出來送到A/D轉換器。軟件方面，這個部分是第四章的系統軟件的設計，首先把實時操作系統μC/OS-Ⅱ移植到處理器LM3S8962上，然后講解了應用程序的設計（由三個部分組成），分別是A/D轉換處理程序設計、液晶顯示程序設計和網絡通訊程序設計。論文的最后對系統的軟硬件調試做了簡單的介紹以及全文的總結。 關鍵詞：TCP/IP 示波法 舒張壓 收縮壓 μc/OS-Ⅱ
上傳時間： 2013-06-17
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隨著計算機及其外圍設備的發展，傳統的并行接口和串行接口在靈活性和接口擴展等方面存在的缺陷愈來愈不可回避，并逐漸成為計算機通信的瓶頸。在這種情況下，通用串行總線(Universal Serial Bus，USB)誕生了。USB由于具有傳輸速率高、價格便宜、使用方便、靈活性高、支持熱插拔、接口標準化和易于擴展等優點，目前已經成為計算機外設接口的主流技術，在計算機外圍設備和消費類電子領域正獲得越來越多的應用。 @@ 本文基于USB2．0協議規范，設計了一款支持高速和全速傳輸的USB2．0設備控制器IP核。文中著重介紹了這款設備控制器IP核的設計和FPGA驗證工作，詳細研究并分析了USB2．0規范，根據規范提出了一種USB2．0設備控制器整體構架方案，描述了各個功能子模塊硬件電路的功能及實現。從可重用的角度出發，對設備控制器模塊進行優化設計，增加多個靈活的配置選項，根據不同的應用對硬件進行配置，使其在滿足要求的情況下去除冗余電路，以減少占用面積和功耗，從而使其靈活地應用于各種USB系統。本文還研究了IP核的驗證方法，并對所設計的USB2．0設備控制器建立了功能完備的ModelSim仿真驗證環境，搭建了FPGA硬件驗證平臺，設計了具有AHB接口的設備控制器和帶有8051的設備控制器，并分別在FPGA平臺上進行了功能驗證。 @@ 本文所設計的USB2．0設備控制器IP核可配置性高，使用者可以自由配置所需端點的個數以及每個端點類型等，可以集成于多種USB系統中，適于各類USB設備的開發。本課題所取得的成果為USB2．0設備類的研究和開發積累了經驗，并為后來實驗室某項目測試芯片的USB數據采集提供了參考方案，也為未來USB3．0接口IP核的開發和應用奠定了基礎。 @@關鍵詞USB2．0控制器；IP核；FPGA；驗證
上傳時間： 2013-06-30
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DDR2 SDRAM是目前內存市場上的主流內存。除了通用計算機系統外，大量的嵌入式系統也紛紛采用DDR2內存，越來越多的SoC系統芯片中會集成有DDR2接口模塊。因此，設計一款匹配DDR2的內存控制器將會具有良好的應用前景。 論文在研究了DDR2的JEDEC標準的基礎上，設計出DDR2控制器的整體架構，采用自項向下的設計方法和模塊化的思想，將DDR2控制器劃分為若干模塊，并使用Verilog HDL語言完成DDR2控制器IP軟核中初始化模塊、配置模塊、執行模塊和數據通道模塊的RTL級設計。根據在設計中遇到的問題，對DDR2控制器的整體架構進行改進與完善。在分析了Altera數字PHY的基本性能的基礎上，設計DDR2控制器與數字PHY的接口模塊。搭建DDR2控制器IP軟核的仿真驗證平臺，針對設計的具體功能進行仿真驗證，并實現在Altera Stratix II GX90開發板上對DDR2存儲芯片基本讀/寫操作控制的FPGA功能演示。 論文設計的DDR2控制器的主要特點是： 1.支持數字PHY電路，不需要實際的硬件電路就完成DDR2控制器與DDR2存儲芯片之間的物理層接口，節約了設計成本，縮小了硬件電路的體積。 2.將配置口從初始化模塊中分離出來，簡化了具體操作。 3.支持多個DDR2存儲芯片，使得DDR2控制器的應用范圍更為廣闊。 4.支持DDR2的三項新技術，充分發揮DDR2內存的特性。 5.自動DDR2刷新控制，方便用戶對DDR2內存的控制。
上傳時間： 2013-06-10
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