本書系統講解通信網絡領域Xilinx FPGA內部的IP硬核。以流行的Xilinx Virtex-6型號芯片舉例，涵蓋Xilinx
FPGA在通信領域主流的IP核，闡述Xilinx FPGA時鐘資源和DCM、PLL和MMCM時鐘管理器的特性和使用方法；介紹基于Block
RAM資源生成ROM、RAM、FIFO和CAM核的使用過程。闡述TEMAC核背景知識、內部結構、接口時序和配置參數，給出生成實例；介紹LVDS技術規范、源同步實現方案和去偏移技術，講解Xilinx
FPGA中IODELAYE1、ISERDES1和OSERDES核使用方法；闡述Xilinx FPGA
DDR3控制器IP核的結構組成、模塊劃分、接口信號和物理約束等。
標簽：
xilinx
fpga
ip核
上傳時間：
2022-06-11
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