隨著圖像聲納技術(shù)的發(fā)展，對(duì)于大數(shù)據(jù)量圖像數(shù)據(jù)的壓縮成為必須要解決的一個(gè)課題。本文結(jié)合水聲圖像特點(diǎn)，應(yīng)用VerilogHDL 語(yǔ)言在Quartus Ⅱ軟件環(huán)境下設(shè)計(jì)實(shí)現(xiàn)了JPEG基本模式編解碼器。 JPEG是國(guó)際標(biāo)準(zhǔn)化組織(ISO)和CCITT 聯(lián)合制定的靜態(tài)圖像的壓縮標(biāo)準(zhǔn)，是目前最常使用的圖像存儲(chǔ)格式。 論文首先介紹了JPEG編碼的基本原理，然后根據(jù)編碼的流程從總體結(jié)構(gòu)上對(duì)JPEG編碼器進(jìn)行了模塊劃分。對(duì)于2D—DCT變換采用了行列分離的快速算法；針對(duì)水聲圖像特點(diǎn)采用了DC系數(shù)直接編碼。以一幅真實(shí)的水聲圖像作為JPEG編碼器的測(cè)試輸入，對(duì)編碼器輸出的碼流經(jīng)過(guò)軟件編程后正確顯示出了JPEG圖片，并分析了壓縮圖像效果和質(zhì)量。 JPEG解碼器采用了和JPEG編碼器對(duì)稱的模塊劃分，2D—IDCT變換同樣采用了行列分離的快速算法；根據(jù)JPEG標(biāo)準(zhǔn)中哈夫曼編碼的特點(diǎn)，哈夫曼解碼采用了濃縮哈夫曼表法，降低了存儲(chǔ)資源，提高了解碼速度。對(duì)經(jīng)本文設(shè)計(jì)的JPEG解碼器解碼后的圖片和原圖片進(jìn)行了比較分析，結(jié)果表明本設(shè)計(jì)滿足要求。
上傳時(shí)間： 2013-05-25
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H.264/AVC是由ITU和ISO兩大組織聯(lián)合組成的JVT共同制定的一項(xiàng)新的視頻壓縮技術(shù)標(biāo)準(zhǔn)，在較低帶寬上提供高質(zhì)量的圖像傳輸是H.264/AVC的應(yīng)用亮點(diǎn)。在同樣的視覺質(zhì)量前提下，H.264/AVC比H.263和MPEG-4節(jié)約了50％的碼率。但H.264獲得優(yōu)越性能的代價(jià)是計(jì)算復(fù)雜度的增加，據(jù)估計(jì)其編碼的計(jì)算復(fù)雜度大約為H.263的3倍，因此很難應(yīng)用于實(shí)時(shí)視頻處理領(lǐng)域。針對(duì)這一現(xiàn)狀，業(yè)內(nèi)做了大量的研究工作，力圖降低其計(jì)算復(fù)雜度和提高運(yùn)行效率。比如在運(yùn)動(dòng)估計(jì)方面，國(guó)內(nèi)外在這方面的研究已經(jīng)很成熟。而針對(duì)幀內(nèi)/幀間預(yù)測(cè)編碼的研究卻較少。因此研究預(yù)測(cè)模式的快速算法具有理論意義和應(yīng)用價(jià)值。 本文在詳細(xì)研究H.264標(biāo)準(zhǔn)視頻壓縮編碼特點(diǎn)基礎(chǔ)上，分析了H.264幀內(nèi)編碼, 幀間編碼及變換，量化技術(shù)的原理及特點(diǎn)，提出了一種基于局部邊緣方向信息的快速幀內(nèi)模式判決算法，通過(guò)結(jié)合SAD的模式選擇方法來(lái)減少模式選擇數(shù)目。它采用了Sobel梯度算子計(jì)算當(dāng)前塊的邊緣信息，累加當(dāng)前塊中屬于同一方向像素點(diǎn)的邊緣矢量構(gòu)造不同模式下的邊緣方向直方圖，以便確定最可能的預(yù)測(cè)模式。該算法有效降低了編碼器的運(yùn)算復(fù)雜度，在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明：Foreman 圖像序列編碼性能有了提高，其中PSNR平均降低了0.06dB，Bitrate平均降低了19.4％，這大大提高了視頻傳輸?shù)馁|(zhì)量。 另外在幀間預(yù)測(cè)模式選擇算法方面進(jìn)行了改進(jìn)研究：按順序?qū)Σ煌愋瓦M(jìn)行判決，有選擇地去比較可能模式，使得在有效減少需判決的模式數(shù)量的同時(shí)，結(jié)合小塊模式搜索中途停止準(zhǔn)則來(lái)確定最優(yōu)模式。仿真表明：改進(jìn)算法相對(duì)與原來(lái)算法能夠節(jié)省很多的編碼時(shí)間（平均下降了49.3％），但帶來(lái)的圖像質(zhì)星的下降（平均下降0.08dB,可以忽略）和碼率較少的增加。 同時(shí)在整數(shù)DCT變換模塊中，提出了一種快速蝶形算法，使得對(duì)4×4點(diǎn)數(shù)據(jù)做一次變換，只需通過(guò)8×8次加法和2×8次移位運(yùn)算便可完成，與原來(lái)12×8次加法和4×8次移位相比，新算法大大降低了運(yùn)算復(fù)雜度。 最后介紹FPGA的特點(diǎn)及設(shè)計(jì)流程，并實(shí)現(xiàn)了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實(shí)現(xiàn)的H.264編碼視頻處理模塊設(shè)計(jì)具備了成本低，周期短，設(shè)計(jì)方法靈活等優(yōu)點(diǎn)，具有廣闊的市場(chǎng)應(yīng)用前景。 仿真表明，通過(guò)使用本文提出的幀內(nèi)/幀間速算法方法可使得H.264編碼速度獲得顯著的提高，使H.264 Baseline編碼器能在PC平臺(tái)上實(shí)現(xiàn)實(shí)時(shí)編碼。
上傳時(shí)間： 2013-07-18
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通信領(lǐng)域的主導(dǎo)技術(shù)有兩種：用于內(nèi)部商業(yè)通信的局域網(wǎng)(LAN)中的以太網(wǎng)(Ethernet)和廣域網(wǎng)(WAN)中的SDH(SynchronousDigitalHierarchy)。因?yàn)樵赟DH網(wǎng)絡(luò)上不直接支持以太網(wǎng)，當(dāng)企業(yè)(客戶)間需要彼此通信或企業(yè)(客戶)內(nèi)需要將其總部與分部連至同一LAN網(wǎng)時(shí)互連問(wèn)題便應(yīng)運(yùn)而生。 該研究課題的目的是研究在EoS(EthernetoverSDH)實(shí)現(xiàn)過(guò)程中存在的技術(shù)難題和協(xié)議實(shí)現(xiàn)的復(fù)雜性，提出一種簡(jiǎn)單、快速、高效的協(xié)議實(shí)現(xiàn)方法。主要關(guān)注的是EoS系統(tǒng)中與協(xié)議幀映射相關(guān)的關(guān)鍵技術(shù)，例如：自定義幀結(jié)構(gòu)、幀定位、全數(shù)字鎖相技術(shù)、流量控制技術(shù)等，最終完成EoS中這些關(guān)鍵技術(shù)模塊的設(shè)計(jì)。 該課題簡(jiǎn)單分析EoS系統(tǒng)相關(guān)協(xié)議幀結(jié)構(gòu)及EoS系統(tǒng)的原理，闡述了FPGA技術(shù)的實(shí)現(xiàn)方法，重點(diǎn)在于利用業(yè)界最先進(jìn)的EDA工具實(shí)現(xiàn)EoS系統(tǒng)中幀映射技術(shù)。系統(tǒng)中采用一種簡(jiǎn)化了的點(diǎn)對(duì)點(diǎn)實(shí)現(xiàn)方案，對(duì)以太網(wǎng)的數(shù)據(jù)幀直接進(jìn)行HDLC幀格式封裝，采用多通道的E1信道承載完整的HIDLC幀方式將HDLC幀映射到E1信道中，然后采用單通道承載多個(gè)完整的E1幀方式將E1映射到SDH信道中，從而把以太網(wǎng)幀有效地映射到SDH的負(fù)荷中，實(shí)現(xiàn)“透明的局域網(wǎng)服務(wù)”。這對(duì)在現(xiàn)有的SDH傳輸設(shè)備上承載以太網(wǎng)，開發(fā)實(shí)現(xiàn)以太網(wǎng)的廣域連接設(shè)備，將會(huì)具有重要的意義。
標(biāo)簽： FPGA EoS 點(diǎn)對(duì)點(diǎn) 幀
上傳時(shí)間： 2013-04-24
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hdlc幀接收器包含文件 設(shè)計(jì)代碼測(cè)試代碼綜合腳步說(shuō)明文檔
標(biāo)簽： hdlc_receive_code
上傳時(shí)間： 2013-07-05
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射頻識(shí)別(RFID，Radio Frequency Identification)是一種利用電磁波雙向傳輸實(shí)現(xiàn)自動(dòng)識(shí)別的技術(shù)。近年來(lái)，射頻識(shí)別技術(shù)在物流、交通、身份識(shí)別等生產(chǎn)生活領(lǐng)域的應(yīng)用日益擴(kuò)大。相比于13.56MHz射頻識(shí)別系統(tǒng)，915MHz射頻識(shí)別系統(tǒng)在識(shí)別距離，閱讀速度方面有更大的優(yōu)勢(shì)，是目前射頻識(shí)別產(chǎn)品研究的熱點(diǎn)。 本文在理解ISO/IEC18000-6C協(xié)議的基礎(chǔ)上，首先研究用于本系統(tǒng)的基本理論，包括射頻識(shí)別技術(shù)和嵌入式技術(shù)，提出一款基于ISO/IEC18000-6C協(xié)議的915MHz射頻識(shí)別讀卡器的解決方案。在硬件部分，以Intel公司開發(fā)的R1000作為射頻收發(fā)模塊的核心；選用ATMEL公司的ARM處理器AT91SAM7S256作為控制單元的主控制器，在ARM處理器上運(yùn)行μC/OS-II嵌入式實(shí)時(shí)操作系統(tǒng)，采用多任務(wù)實(shí)現(xiàn)和其他功能模塊的通信。軟件部分為系統(tǒng)移植了μC/OS-II操作系統(tǒng)，使用C與匯編語(yǔ)言的混合編程編寫B(tài)ootloader，編寫了各種硬件設(shè)備的驅(qū)動(dòng)程序，使用C語(yǔ)言實(shí)現(xiàn)了串行通信程序，實(shí)現(xiàn)與上位機(jī)通信并實(shí)現(xiàn)對(duì)程序的更新。本文所設(shè)計(jì)的射頻識(shí)別系統(tǒng)具有模塊化設(shè)計(jì)、高可靠性等特點(diǎn)。實(shí)驗(yàn)表明，這種設(shè)計(jì)方案能夠達(dá)到ISO/IEC18000-6C協(xié)議要求。
標(biāo)簽： ARM 915 MHz 射頻識(shí)別
上傳時(shí)間： 2013-07-18
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這是支持MF RC500 MIFARE 讀寫集成電路IC的有關(guān)射頻設(shè)計(jì)的應(yīng)用筆記。意在提供對(duì)MIFARE 射頻接口（ISO 14443A）所需的理解來(lái)設(shè)計(jì)具體天線應(yīng)用和匹配電路，為了使無(wú)接觸MIFAR
上傳時(shí)間： 2013-04-24
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ISO IEC 21481 規(guī)范標(biāo)準(zhǔn)文檔，NFC標(biāo)準(zhǔn)規(guī)范學(xué)習(xí)必備。
上傳時(shí)間： 2013-07-16
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JPEG2000是由ISO/ITU-T組織下的IEC JTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標(biāo)準(zhǔn).與JPEG(Joint Photographic Experts Group)相比,JPEG2000能夠提供更好的數(shù)據(jù)壓縮比,并且提供了一些JPEG所不具有的功能[1].JPEG2000具有的多種特性使得它具有廣泛的應(yīng)用前景.但是,JPEG2000是一個(gè)復(fù)雜編碼系統(tǒng),目前為止的軟件實(shí)現(xiàn)方案的執(zhí)行時(shí)間和所需的存儲(chǔ)量較大,若想將JPEG2000應(yīng)用于實(shí)際中,有著較大的困難,而用硬件電路實(shí)現(xiàn)JPEG2000或者其中的某些模塊,必然能夠減少JPEG200的執(zhí)行時(shí)間,因而具有重要的意義.本文首先簡(jiǎn)單介紹了JPEG2000這一新的靜止圖像壓縮標(biāo)準(zhǔn),然后對(duì)算術(shù)編碼的原理及實(shí)現(xiàn)算法進(jìn)行了深入的研究,并重點(diǎn)探討了JPEG2000中算術(shù)編碼的硬件實(shí)現(xiàn)問(wèn)題,給出了一種硬件最優(yōu)化的算術(shù)編碼實(shí)現(xiàn)方案.最后使用硬件描述語(yǔ)言(Very High Speed Integrated Circuit Hardware Description Language,VHDL)在寄存器傳輸級(jí)(Register Transfer Level,RTL描述了該硬件最優(yōu)化的算術(shù)編碼實(shí)現(xiàn)方案,并以Altera 20K200E FPGA為基礎(chǔ),在Active-HDL環(huán)境中進(jìn)行了功能仿真,在Quartus Ⅱ集成開發(fā)環(huán)境下完成了綜合以及后仿真,綜合得到的最高工作時(shí)鐘頻率達(dá)45.81MHz.在相同的輸入條件下,輸出結(jié)果表明,本文設(shè)計(jì)的硬件算術(shù)編碼器與實(shí)現(xiàn)JPEG2000的軟件:Jasper[2]中的算術(shù)編碼模塊相比,處理時(shí)間縮短了30﹪左右.因而本文的研究對(duì)于JPEG2000應(yīng)用于數(shù)字監(jiān)控系統(tǒng)等實(shí)際應(yīng)用有著重要的意義.
標(biāo)簽： JPEG 2000 FPGA 算術(shù)編碼
上傳時(shí)間： 2013-05-16
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JPEG2000是由ISO/ITU-T組織下的IECJTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標(biāo)準(zhǔn)，其優(yōu)良的壓縮特性使得它將具有廣泛的應(yīng)用領(lǐng)域。JPEG2000算法非常復(fù)雜，圖像編碼過(guò)程占用了大量的處理器時(shí)間開銷和內(nèi)存開銷，因而通過(guò)對(duì)JPEG2000算法進(jìn)行優(yōu)化并采用硬件電路來(lái)實(shí)現(xiàn)JPEG2000標(biāo)準(zhǔn)的部分或全部?jī)?nèi)容，對(duì)加快編碼速度從而擴(kuò)展其應(yīng)用領(lǐng)域有重要的意義。 本文的研究主要包括兩方面的內(nèi)容，其一是JPEG2000算術(shù)編碼器算法的研究與硬件設(shè)計(jì)，其二是JPEG2000碼率控制算法的研究與優(yōu)化算法的設(shè)計(jì)。在研究算術(shù)編碼器過(guò)程中，首先研究了JPEG2000中基于上下文的MQ算術(shù)編碼器的編碼原理和編碼流程，之后采用有限狀態(tài)機(jī)和二級(jí)流水線技術(shù)，并在不影響關(guān)鍵路徑的情況下通過(guò)對(duì)算術(shù)編碼步驟優(yōu)化采用硬件描述語(yǔ)言對(duì)算術(shù)編碼器進(jìn)行了設(shè)計(jì)，并通過(guò)了功能仿真與綜合。實(shí)驗(yàn)證明該設(shè)計(jì)不但編碼速度快，而且流水線短，硬件設(shè)計(jì)的復(fù)雜度低且易于控制。 在研究碼率控制算法過(guò)程中，首先結(jié)合率失真理論建立了算法的數(shù)學(xué)模型，并驗(yàn)證了該算法的有效性，之后深入分析了該數(shù)學(xué)模型的實(shí)現(xiàn)流程，找出影響算法效率的關(guān)鍵路徑。在對(duì)算法優(yōu)化時(shí)采用黃金分割點(diǎn)算法代替原來(lái)的二分查找法，并使用了碼塊R-D斜率最值記憶和碼率誤差控制算法。實(shí)驗(yàn)證明，采用優(yōu)化算法在增加少量系統(tǒng)資源的情況下使得計(jì)算效率提高了60％以上。之后，分析了率失真理論與JPEG2000中PCRD-opt算法的具體實(shí)現(xiàn)，又提出了一種失真更低的比特分配方案，即按照“失真/碼長(zhǎng)”值從大到小通道編碼順序進(jìn)行編碼，通過(guò)對(duì)該算法的仿真驗(yàn)證，得出在固定碼率條件下新算法將產(chǎn)生更少的失真。
標(biāo)簽： JPEG 2000 FPGA 標(biāo)準(zhǔn)
上傳時(shí)間： 2013-07-13
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ISO和ITU-T制定的一系列視頻編碼國(guó)際標(biāo)準(zhǔn)的推出，開創(chuàng)了視頻通信和存儲(chǔ)應(yīng)用的新紀(jì)元。從H.261視頻編碼建議，到H.262/3、MPEG-1/2/4等都有一個(gè)共同的不斷追求的目標(biāo)，即在盡可能低的碼率(或存儲(chǔ)容量)下獲得盡可能好的圖像質(zhì)量。 本課題的研究建立在目前主流的壓縮算法的基礎(chǔ)上，綜合出各種標(biāo)準(zhǔn)中實(shí)現(xiàn)途徑的共性和優(yōu)勢(shì)，將算法的主體移植于FPGA(FieldProgrammableGateArray)平臺(tái)上。憑借該種類嵌入式系統(tǒng)配置靈活、資源豐富的特點(diǎn)，建立一個(gè)可重構(gòu)的內(nèi)核處理模塊。進(jìn)一步的完善算法(運(yùn)算速度、精度)和外圍系統(tǒng)后，就可作為專用視頻壓縮編碼器進(jìn)行門級(jí)電路設(shè)計(jì)的原型，構(gòu)建一個(gè)片上可編程的獨(dú)立系統(tǒng)。 編碼器設(shè)計(jì)有良好的應(yīng)用前景，通過(guò)使用離散余弦變換和熵編碼，對(duì)運(yùn)動(dòng)圖像從空間上進(jìn)行壓縮編碼，使得編碼后的數(shù)據(jù)流適合于傳輸、通信、存儲(chǔ)和編輯等方面的要求。同時(shí)，系統(tǒng)的設(shè)計(jì)將解碼的工作量大幅度降低，功能模塊在作適當(dāng)?shù)母膭?dòng)后可為解碼器的參考設(shè)計(jì)使用。 研究所涉及的各功能模塊都進(jìn)行了系統(tǒng)性的仿真和綜合，滿足工程樣機(jī)的前期研發(fā)需要。
上傳時(shí)間： 2013-04-24
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