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Integrator

積分儀是在測(cè)量和控制應(yīng)用中發(fā)揮作用的一種元件,其輸出信號(hào)是其輸入信號(hào)的時(shí)間積分。它在定義的時(shí)間內(nèi)累積輸入量以產(chǎn)生代表性的輸出。
  • Nucleus Common Library for Integrator using ARM Developer Suite

    Nucleus Common Library for Integrator using ARM Developer Suite

    標(biāo)簽: Integrator Developer Nucleus Library

    上傳時(shí)間: 2014-08-17

    上傳用戶(hù):hfmm633

  • arm Integrator cpci板的bsp源代碼

    arm Integrator cpci板的bsp源代碼

    標(biāo)簽: Integrator cpci arm bsp

    上傳時(shí)間: 2013-12-09

    上傳用戶(hù):1159797854

  • 基于開(kāi)關(guān)電容技術(shù)的鎖定放大器設(shè)計(jì)

    鎖定放大是微弱信號(hào)檢測(cè)的重要手段。基于相關(guān)檢測(cè)理論,利用開(kāi)關(guān)電容的開(kāi)關(guān)實(shí)現(xiàn)鎖定放大器中乘法器的功能,提出開(kāi)關(guān)電容和積分器相結(jié)合以實(shí)現(xiàn)相關(guān)檢測(cè)的方法,并設(shè)計(jì)出一種鎖定放大器。該鎖定放大器將微弱信號(hào)轉(zhuǎn)化為與之相關(guān)的方波,通過(guò)后續(xù)電路得到正比于被測(cè)信號(hào)的直流電平,為后續(xù)采集處理提供方便。測(cè)量數(shù)據(jù)表明鎖定放大器前級(jí)可將10-6 A的電流轉(zhuǎn)換為10-1 V的電壓,后級(jí)通過(guò)帶通濾波器級(jí)聯(lián)可將信號(hào)放大1×105倍。該方法在降低噪聲的同時(shí),可對(duì)微弱信號(hào)進(jìn)行放大,線性度較高、穩(wěn)定性較好。 Abstract:  Lock-in Amplifying(LIA)is one of important means for weak signal detection. Based on cross-correlation detection theory, switch in the swithched capacitor was used as multiplier of LIA, and a new method of correlation detection was proposed combining swithched capacitor with Integrator. A kind of LIA was designed which can convert the weak signal to square-wave, then DC proportional to measured signal was obtained through follow-up conditioning circuit, providing convenience for signal acquisition and processing. The measured data shows that the electric current(10-6 A) can be changed into voltage(10-1 V) by LIA, and the signal is magnified 1×105 times by cascade band-pass filter. The noise is suppressed and the weak signal is amplified. It has the advantages of good linearity and stability.

    標(biāo)簽: 開(kāi)關(guān)電容 鎖定放大器

    上傳時(shí)間: 2013-11-29

    上傳用戶(hù):黑漆漆

  • hspice 2007下載 download

    解壓密碼:www.elecfans.com 隨著微電子技術(shù)的迅速發(fā)展以及集成電路規(guī)模不斷提高,對(duì)電路性能的設(shè)計(jì) 要求越來(lái)越嚴(yán)格,這勢(shì)必對(duì)用于大規(guī)模集成電路設(shè)計(jì)的EDA 工具提出越來(lái)越高的 要求。自1972 年美國(guó)加利福尼亞大學(xué)柏克萊分校電機(jī)工程和計(jì)算機(jī)科學(xué)系開(kāi)發(fā) 的用于集成電路性能分析的電路模擬程序SPICE(Simulation Program with IC Emphasis)誕生以來(lái),為適應(yīng)現(xiàn)代微電子工業(yè)的發(fā)展,各種用于集成電路設(shè)計(jì)的 電路模擬分析工具不斷涌現(xiàn)。HSPICE 是Meta-Software 公司為集成電路設(shè)計(jì)中 的穩(wěn)態(tài)分析,瞬態(tài)分析和頻域分析等電路性能的模擬分析而開(kāi)發(fā)的一個(gè)商業(yè)化通 用電路模擬程序,它在柏克萊的SPICE(1972 年推出),MicroSim公司的PSPICE (1984 年推出)以及其它電路分析軟件的基礎(chǔ)上,又加入了一些新的功能,經(jīng) 過(guò)不斷的改進(jìn),目前已被許多公司、大學(xué)和研究開(kāi)發(fā)機(jī)構(gòu)廣泛應(yīng)用。HSPICE 可 與許多主要的EDA 設(shè)計(jì)工具,諸如Candence,Workview 等兼容,能提供許多重要 的針對(duì)集成電路性能的電路仿真和設(shè)計(jì)結(jié)果。采用HSPICE 軟件可以在直流到高 于100MHz 的微波頻率范圍內(nèi)對(duì)電路作精確的仿真、分析和優(yōu)化。在實(shí)際應(yīng)用中, HSPICE能提供關(guān)鍵性的電路模擬和設(shè)計(jì)方案,并且應(yīng)用HSPICE進(jìn)行電路模擬時(shí), 其電路規(guī)模僅取決于用戶(hù)計(jì)算機(jī)的實(shí)際存儲(chǔ)器容量。 The HSPICE Integrator Program enables qualified EDA vendors to integrate their products with the de facto standard HSPICE simulator, HSPICE RF simulator, and WaveView Analyzer™. In addition, qualified HSPICE Integrator Program members have access to HSPICE Integrator application programming interfaces (APIs). Collaboration between HSPICE Integrator Program members will enable customers to achieve more thorough design verification in a shorter period of time from the improvements offered by inter-company EDA design solutions.

    標(biāo)簽: download hspice 2007

    上傳時(shí)間: 2013-11-10

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  • hspice 2007下載 download

    解壓密碼:www.elecfans.com 隨著微電子技術(shù)的迅速發(fā)展以及集成電路規(guī)模不斷提高,對(duì)電路性能的設(shè)計(jì) 要求越來(lái)越嚴(yán)格,這勢(shì)必對(duì)用于大規(guī)模集成電路設(shè)計(jì)的EDA 工具提出越來(lái)越高的 要求。自1972 年美國(guó)加利福尼亞大學(xué)柏克萊分校電機(jī)工程和計(jì)算機(jī)科學(xué)系開(kāi)發(fā) 的用于集成電路性能分析的電路模擬程序SPICE(Simulation Program with IC Emphasis)誕生以來(lái),為適應(yīng)現(xiàn)代微電子工業(yè)的發(fā)展,各種用于集成電路設(shè)計(jì)的 電路模擬分析工具不斷涌現(xiàn)。HSPICE 是Meta-Software 公司為集成電路設(shè)計(jì)中 的穩(wěn)態(tài)分析,瞬態(tài)分析和頻域分析等電路性能的模擬分析而開(kāi)發(fā)的一個(gè)商業(yè)化通 用電路模擬程序,它在柏克萊的SPICE(1972 年推出),MicroSim公司的PSPICE (1984 年推出)以及其它電路分析軟件的基礎(chǔ)上,又加入了一些新的功能,經(jīng) 過(guò)不斷的改進(jìn),目前已被許多公司、大學(xué)和研究開(kāi)發(fā)機(jī)構(gòu)廣泛應(yīng)用。HSPICE 可 與許多主要的EDA 設(shè)計(jì)工具,諸如Candence,Workview 等兼容,能提供許多重要 的針對(duì)集成電路性能的電路仿真和設(shè)計(jì)結(jié)果。采用HSPICE 軟件可以在直流到高 于100MHz 的微波頻率范圍內(nèi)對(duì)電路作精確的仿真、分析和優(yōu)化。在實(shí)際應(yīng)用中, HSPICE能提供關(guān)鍵性的電路模擬和設(shè)計(jì)方案,并且應(yīng)用HSPICE進(jìn)行電路模擬時(shí), 其電路規(guī)模僅取決于用戶(hù)計(jì)算機(jī)的實(shí)際存儲(chǔ)器容量。 The HSPICE Integrator Program enables qualified EDA vendors to integrate their products with the de facto standard HSPICE simulator, HSPICE RF simulator, and WaveView Analyzer™. In addition, qualified HSPICE Integrator Program members have access to HSPICE Integrator application programming interfaces (APIs). Collaboration between HSPICE Integrator Program members will enable customers to achieve more thorough design verification in a shorter period of time from the improvements offered by inter-company EDA design solutions.

    標(biāo)簽: download hspice 2007

    上傳時(shí)間: 2013-10-18

    上傳用戶(hù):s363994250

  • vivado Final_IP+Integrator視頻演示

    為了解決實(shí)現(xiàn)的瓶頸,Vivado 工具采用層次化器件編輯器和布局規(guī)劃器、速度提升 了3 至 15 倍且為 SystemVerilog 提供業(yè)界領(lǐng)先支持的邏輯綜合工具、速度提升 了4 倍且確定性更高的布局布線引擎、以及通過(guò)分析技術(shù)可最小化時(shí)序、線長(zhǎng)、路由擁堵等多個(gè)變量的“成本”函數(shù)。此外,增量式流程能讓工程變更通知單 (ECO) 的任何修改只需對(duì)設(shè)計(jì)的一小部分進(jìn)行重新實(shí)現(xiàn)就能快速處理,同時(shí)確保性能不受影響。 賽靈思vivado設(shè)計(jì)套件專(zhuān)題:http://www.elecfans.com/topic/tech/vivado/

    標(biāo)簽: Integrator Final_IP vivado 視頻

    上傳時(shí)間: 2013-10-12

    上傳用戶(hù):誰(shuí)偷了我的麥兜

  • This m file models an UWB system using BPSK. The receiver is a correlation receiver with a LPF integ

    This m file models an UWB system using BPSK. The receiver is a correlation receiver with a LPF Integrator and comparators for threshhold selection.

    標(biāo)簽: receiver correlation models system

    上傳時(shí)間: 2014-12-19

    上傳用戶(hù):ryb

  • This m file analyzes a coherent binary phase shift keyed(BPSK) and a amplitude shift keyed(ASK) comm

    This m file analyzes a coherent binary phase shift keyed(BPSK) and a amplitude shift keyed(ASK) communication system. The receiver uses a correlator(mixer-Integrator[LPF]) configuration with BER measurements comparing measured and theoretical results. The bandpass and low pass used in the receiver are constructed using z transforms.

    標(biāo)簽: keyed shift amplitude analyzes

    上傳時(shí)間: 2015-09-26

    上傳用戶(hù):liuchee

  • Noncoherent receivers are attractive for pulsed UWB systems due to the implementation simplicity. To

    Noncoherent receivers are attractive for pulsed UWB systems due to the implementation simplicity. To alleviate the noise effect in detecting UWB PPM signals, this letter proposes a simple yet flexible weighted noncoherent receiver structure, which adopts a square-law Integrator multiplied with a window function.

    標(biāo)簽: implementation Noncoherent attractive simplicity

    上傳時(shí)間: 2013-12-01

    上傳用戶(hù):wys0120

  • (網(wǎng)盤(pán))vivado 41講入門(mén)與提高 視頻教程

    第41講 Tcl在Vivado中的應(yīng)用(7):非工程模式下的設(shè)計(jì)流程管理第40講 Tcl在Vivado中的應(yīng)用(6):工程模式下的設(shè)計(jì)流程管理第39講 Tcl在Vivado中的應(yīng)用(5):使用Xilinx Tcl Store第38講 Tcl在Vivado中的應(yīng)用(4):嵌入自定義Tcl命令第37講 Tcl在Vivado中的應(yīng)用(3):使用Hook Script第36講 Tcl在Vivado中的應(yīng)用(2):定制報(bào)告第35講 Tcl在Vivado中的應(yīng)用(1):編輯網(wǎng)表第34講 利用Vivado IP Integrator進(jìn)行設(shè)計(jì)開(kāi)發(fā)第33講 功耗估計(jì)和優(yōu)化第32講 UltraFast設(shè)計(jì)方法學(xué)(11):時(shí)序收斂之10個(gè)時(shí)序收斂技巧第31講 UltraFast設(shè)計(jì)方法學(xué)(10):時(shí)序收斂之時(shí)序約束基本準(zhǔn)則第30講 UltraFast設(shè)計(jì)方法學(xué)(9):理解實(shí)現(xiàn)策略第29講 UltraFast設(shè)計(jì)方法學(xué)(8):在Vivado中使用設(shè)計(jì)規(guī)則檢查第28講 UltraFast設(shè)計(jì)方法學(xué)(7):如何管理IP約束第27講 UltraFast設(shè)計(jì)方法學(xué)(6):定義時(shí)鐘分組第26講 UltraFast設(shè)計(jì)方法學(xué)(5):時(shí)序約束第25講 UltraFast設(shè)計(jì)方法學(xué)(4):RTL代碼風(fēng)格(2)第24講 UltraFast設(shè)計(jì)方法學(xué)(3):RTL代碼風(fēng)格(1)第23講 UltraFast設(shè)計(jì)方法學(xué)(2):時(shí)鐘第22講 UltraFast設(shè)計(jì)方法學(xué)(1):初識(shí)UltraFast第21講 綜合后的設(shè)計(jì)分析(2):時(shí)序分析第20講 綜合后的設(shè)計(jì)分析(1):資源與扇出分析第19講 約束的優(yōu)先級(jí)第18講 設(shè)置偽路徑第17講 設(shè)置多周期路徑約束第16講 虛擬時(shí)鐘第15講 設(shè)置輸出延時(shí)約束第14講 設(shè)置輸入延時(shí)約束第13講 創(chuàng)建基本時(shí)鐘周期約束第12講 時(shí)序分析中的基本概念和術(shù)語(yǔ)第11講 與Vivado設(shè)計(jì)流程相關(guān)的一些技巧第10講 輸入/輸出和時(shí)鐘規(guī)劃第9講 編程與調(diào)試第8講 Vivado里最常用的5個(gè)Tcl命令第7講 增量實(shí)現(xiàn)第6講 實(shí)現(xiàn)第5講 綜合的基本設(shè)置和綜合屬性第4講 基于ModelSim的邏輯仿真(DEMO工程文件與第三講一致?。┑?講 基于XSim的邏輯仿真第2講 用三個(gè)DEMO講解如何在設(shè)計(jì)中使用IP

    標(biāo)簽: vivado

    上傳時(shí)間: 2022-06-13

    上傳用戶(hù):jason_vip1

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