uc/os-ii 2.52的源代碼中文註釋版本.PDF格式,最後還介紹了在BC4.5編譯環境下成功編譯了UC/OS-II系統,是學習UC/OS-II一份不錯的參考資料.
標簽: OS-II os-ii 2.52 UC
上傳時間: 2017-05-05
上傳用戶:GavinNeko
針對一級非線性倒力擺的模糊監督控制應用在系統含有不確定性
標簽: 模糊 控制應用 系統
上傳時間: 2013-12-23
上傳用戶:yt1993410
鍵盤位序更改程序請認真閱讀您的文件包然后寫出其具體功能(至少要20個字)。盡量不要讓站長把時間都花費在為您修正說明上。壓縮包解壓時不能有密碼。
標簽: 鍵盤 程序 正 密碼
上傳時間: 2017-08-09
上傳用戶:稀世之寶039
本書在高階技術(尤涉作業系統核心)方面居崇高位,不少名書也常推薦此書以補不足。本書基本以作業系統觀念為主,輔以範例驗證之。讀者群設定在具備32位元Windows程式經驗者。"Richter在實作技巧是位高手。諸君,試安裝本書所附光碟片你就知道了,我只能用華麗兩字來形容。"
標簽: 系統 核心 方面
上傳時間: 2014-01-25
上傳用戶:zjf3110
本書在高階技術(尤涉作業系統核心)方面居崇高位,不少名書也常推薦此書以補不足。本書基本以作業系統觀念為主,輔以範例驗證之。讀者群設定在具備32位元Windows程式經驗者。"Richter在實作技巧是位高手。諸君,試安裝本書所附光碟片你就知道了,我只能用華麗兩字來形容。"引自臺灣候杰先生語。
上傳時間: 2014-12-03
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標簽: 1.0 CSS 版本 英文
上傳時間: 2016-03-04
上傳用戶:15071087253
實習目的 本實驗將練習如何運用 DSP EVM 產生弦波。使學生能夠加深瞭解 TMS320C6701 EVM 發展系統的基本操作,及一些周邊的運作。 藉由產生弦波的實驗,學習如何使用硬體及軟體。在軟體部份,使 用 Code Composer Studio(CCS) ,包含 C 編輯器、連接器(linker)和 TI 所提供的C源始碼偵錯器(debugger) 。在硬體部份包括TMS320C67 的 浮點 DSP 和在 EVM 板子上的類比晶片。
標簽: EVM C6701 320C 6701
上傳時間: 2016-05-05
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windows核心編程chm附源代碼 本書在高階技術(尤涉作業系統核心)方面居崇高位,不少名書也常推薦此書以補不足。本書基本以作業系統觀念為主,輔以範例驗證之。讀者群設定在具備32位元Windows程式經驗者。"Richter在實作技巧是位高手。諸君,試安裝本書所附光碟片你就知道了,我只能用華麗兩字來形容。"引自臺灣候杰先生語。
標簽: windows chm 核心 系統
上傳時間: 2014-07-06
上傳用戶:水口鴻勝電器
本書在高階技術(尤涉作業系統核心)方面居崇高位,不少名書也常推薦此書以補不足。本書基本以作業系統觀念為主,輔以範例驗證之。讀者群設定在具備32位元Windows程式經驗者。
上傳時間: 2017-04-02
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作為嵌入式系統核心的微處理器,是SOC不可或缺的“心臟”,微處理器的性能直接影響著整個SOC的性能。 與國際先進技術相比,我國在這一領域的研究和開發工作還相當落后,這直接影響到我國信息產業的發展。本著趕超國外先進技術,填補我國在該領域的空白以擺脫受制于國外的目的,我國很多科研單位和公司進行了自己的努力和嘗試。經過幾年的探索,已經有多種自主知識產權的處理器芯片完成了設計驗證并逐漸進入市場化階段。我國已結束無“芯”的歷史,并向設計出更高性能處理器的目標邁進。 艾科創新微電子公司的VEGA處理器,是公司憑借自己的技術力量和科研水平設計出的一款64位高性能RSIC微處理器。該處理器基于MIPSISA構架,采用五級流水線的設計,并且使用了高性能處理器所廣泛采用的虛擬內存管理技術。設計過程中采用自上而下的方法,根據其功能將其劃分為取指、譯碼、算術邏輯運算、內存管理、流水線控制和cache控制等幾個功能塊,使得我們在設計中能夠按照其功能和時序要求進行。 本文的首先介紹了MIPS微處理器的特點,通過對MIPS指令集和其五級流水線結構的介紹使得對VEGA的設計有了一個直觀的認識。在此基礎上提出了VEGA的結構劃分以及主要模塊的功能。作為采用虛擬內存管理技術的處理器,文章的主要部分介紹了VEGA的虛擬內存管理技術,將VEGA的內存管理單元(MMU)尤其是內部兩個翻譯后援緩沖(TLB)的設計作為重點給出了流水線處理器設計的方法。結束總體設計并完成仿真后,并不能代表設計的正確性,它還需要我們在實際的硬件平臺上進行驗證。作為論文的又一重點內容,介紹了我們在VEGA驗證過程中使用到的FPGA的主要配置單元,FPGA的設計流程。VEGA的FPGA平臺是一完整的計算機系統,我們利用在線調試軟件XilinxChipscope對其進行了在線調試,修正其錯誤。 經過模塊設計到最后的FPGA驗證,VEGA完成了其邏輯設計,經過綜合和布局布線等后端流程,VEGA采用0.18工藝流片后達到120MHz的工作頻率,可在其平臺上運行Windows-CE和Linux嵌入式操作系統,達到了預計的設計要求。
標簽: MIPS FPGA 微處理器 模塊設計
上傳時間: 2013-07-07
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