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LABWINDOWS-CVI

  • 基于labwindows/cvi的圖像的藝術(shù)化處理的編程實(shí)現(xiàn)

    基于labwindows/cvi的圖像的藝術(shù)化處理的編程實(shí)現(xiàn)

    標(biāo)簽: labwindows cvi 圖像 編程實(shí)現(xiàn)

    上傳時(shí)間: 2017-03-30

    上傳用戶:watch100

  • usb2.0數(shù)據(jù)采集卡的labview/vi及l(fā)abwindows/cvi的詳細(xì)演示源碼程序

    usb2.0數(shù)據(jù)采集卡的labview/vi及l(fā)abwindows/cvi的詳細(xì)演示源碼程序

    標(biāo)簽: labwindows labview usb 2.0

    上傳時(shí)間: 2014-02-23

    上傳用戶:dapangxie

  • 基于labwindows/cvi的串口通信的實(shí)現(xiàn)

    基于labwindows/cvi的串口通信的實(shí)現(xiàn),希望對(duì)有需要的朋友提高參考

    標(biāo)簽: labwindows cvi 串口通信

    上傳時(shí)間: 2013-12-10

    上傳用戶:dsgkjgkjg

  • 虛擬儀器編程語(yǔ)言LabWindows/CVI是NI公司開發(fā)的面向計(jì)算機(jī)測(cè)控領(lǐng)域的虛擬儀器軟件開發(fā)平臺(tái)

    虛擬儀器編程語(yǔ)言LabWindows/CVI是NI公司開發(fā)的面向計(jì)算機(jī)測(cè)控領(lǐng)域的虛擬儀器軟件開發(fā)平臺(tái),本書重點(diǎn)介紹了虛擬儀器編程語(yǔ)言的開發(fā)過程,可作為相關(guān)人員的學(xué)習(xí)指導(dǎo)書

    標(biāo)簽: LabWindows CVI 虛擬儀器 編程語(yǔ)言

    上傳時(shí)間: 2017-09-23

    上傳用戶:helmos

  • LABWINDOWS-CVI中的多線程技術(shù)

    LABWINDOWS-CVI中的多線程技術(shù)                             

    標(biāo)簽: labwindows cvi 多線程技術(shù)

    上傳時(shí)間: 2022-07-11

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  • 利用LABWINDOWS-CVI多線程技術(shù)實(shí)現(xiàn)實(shí)時(shí)數(shù)據(jù)采集

    利用LABWINDOWS-CVI多線程技術(shù)實(shí)現(xiàn)實(shí)時(shí)數(shù)據(jù)采集           

    標(biāo)簽: labwindows 數(shù)據(jù)采集

    上傳時(shí)間: 2022-07-17

    上傳用戶:XuVshu

  • LabWindows/CVI與Microsoft-Access之間數(shù)據(jù)共享的實(shí)現(xiàn)

    Labwindows/cvi與access的連接與數(shù)據(jù)共享運(yùn)用

    標(biāo)簽: Microsoft-Access LabWindows CVI 數(shù)據(jù)共享

    上傳時(shí)間: 2020-03-26

    上傳用戶:pansonly

  • 基于xPC和CVI的實(shí)時(shí)仿真系統(tǒng)設(shè)計(jì)實(shí)現(xiàn)

    針對(duì)在xPC平臺(tái)下開發(fā)的實(shí)時(shí)仿真系統(tǒng)依賴于MATLAB環(huán)境,影響其在工程實(shí)踐中推廣應(yīng)用的問題,提出了一種基于xPC Target和LabWindows/CVI的實(shí)時(shí)仿真系統(tǒng)設(shè)計(jì)方法。采用該方法設(shè)計(jì)的仿真系統(tǒng),實(shí)現(xiàn)了獨(dú)立的宿主機(jī)程序,同時(shí)利用LabWindows/CVI虛擬儀器技術(shù)開發(fā)出了主控臺(tái)仿真軟件。經(jīng)仿真驗(yàn)證,該系統(tǒng)具備仿真步長(zhǎng)1 ms,數(shù)據(jù)通訊周期20 ms,顯示更新周期20 ms的實(shí)時(shí)仿真能力。仿真系統(tǒng)界面友好且易于操作,為xPC平臺(tái)下的實(shí)時(shí)仿真系統(tǒng)在工程實(shí)際的應(yīng)用提供了有益參考。

    標(biāo)簽: xPC CVI 實(shí)時(shí)仿真系統(tǒng) 設(shè)計(jì)實(shí)現(xiàn)

    上傳時(shí)間: 2013-10-10

    上傳用戶:cepsypeng

  • 級(jí)聯(lián)多電平變頻器測(cè)控系統(tǒng)的設(shè)計(jì).rar

    多電平逆變器中每個(gè)功率器件承受的電壓相對(duì)較低,因此可以用低耐壓功率器件實(shí)現(xiàn)高壓大容量逆變器,且采用多電平變換技術(shù)可以顯著提高逆變器輸出電壓的質(zhì)量指標(biāo)。因此,隨著功率器件的不斷發(fā)展,采用多電平變換技術(shù)將成為實(shí)現(xiàn)高壓大容量逆變器的重要途徑和方法。本文選取其中一種極具優(yōu)勢(shì)的多電平拓?fù)浣Y(jié)構(gòu)一級(jí)聯(lián)多電平變頻器作為研究對(duì)象,完成了其拓?fù)浣Y(jié)構(gòu)、控制策略及測(cè)控系統(tǒng)的設(shè)計(jì)。 @@ 首先,對(duì)多電平變頻器的研究意義,國(guó)內(nèi)外現(xiàn)狀進(jìn)行了分析,比較了三種成熟拓?fù)浣Y(jié)構(gòu)的特點(diǎn),得出了級(jí)聯(lián)型多電平變頻器的優(yōu)點(diǎn),從而將其作為研究對(duì)象。對(duì)比分析了四種調(diào)制策略,確定載波移相二重化的調(diào)制方法和恒壓頻比的控制策略,進(jìn)行數(shù)學(xué)分析和理論仿真,得出了選擇的正確性及可行性。并指出了級(jí)聯(lián)單元個(gè)數(shù)與載波移相角的關(guān)系和調(diào)制比對(duì)輸出電壓的影響;完成了級(jí)聯(lián)變頻器數(shù)學(xué)模型的建立和死區(qū)效應(yīng)的分析。 @@ 其次,完成了相關(guān)硬件的設(shè)計(jì),包括DSP、CPLD、IPM的選型,系統(tǒng)電源的設(shè)計(jì)、檢測(cè)(轉(zhuǎn)速、電流、電壓、故障)電路的設(shè)計(jì)、通信電路的設(shè)計(jì)等。用Labwindows/CVI實(shí)現(xiàn)了上位機(jī)界面的編寫,實(shí)現(xiàn)了開關(guān)機(jī)、設(shè)定轉(zhuǎn)速、通信配置、電壓電流轉(zhuǎn)速檢測(cè)、電流軟件濾波、諧波分析。編寫了下位機(jī)DSP的串口通信、AD轉(zhuǎn)換、轉(zhuǎn)速檢測(cè)(QEP)以及部分控制程序。 @@ 最后,在實(shí)驗(yàn)臺(tái)上完成硬件和軟件的調(diào)試,成功的實(shí)現(xiàn)了變頻器載波移相SPWM的多電平輸出,并驅(qū)動(dòng)異步電機(jī)進(jìn)行了空載變頻試驗(yàn),測(cè)控界面能準(zhǔn)確的與下位機(jī)進(jìn)行通信,快捷的給定各種控制命令,并能實(shí)時(shí)的顯示變頻器的輸出頻率、輸出電壓和輸出電流,為實(shí)驗(yàn)調(diào)試增加了方便性,提高了工作效率。 @@關(guān)鍵詞:級(jí)聯(lián)多電平逆變器;載波移相;IPM;DSP;Labwindows/CVI;測(cè)控界面

    標(biāo)簽: 級(jí)聯(lián) 電平變頻器 測(cè)控系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:米卡

  • 基于FPGA的DDS信號(hào)源設(shè)計(jì).rar

    作為電子類專業(yè)學(xué)生,實(shí)驗(yàn)是提高學(xué)生對(duì)所學(xué)知識(shí)的印象以及發(fā)現(xiàn)問題和解決問題的能力,增加學(xué)生動(dòng)手能力的必須環(huán)節(jié)。本設(shè)計(jì)的目的就是開發(fā)一套滿足學(xué)生實(shí)驗(yàn)需求的信號(hào)源,基于此目的本信號(hào)源并不需要突出的性能,但經(jīng)濟(jì)上要求低成本,同時(shí)要求操作簡(jiǎn)單,能夠輸出多種波形,并且利于學(xué)生在此平臺(tái)上認(rèn)識(shí)信號(hào)源原理,同時(shí)方便在此平臺(tái)上進(jìn)行拓展開發(fā)。 設(shè)計(jì)中運(yùn)用虛擬儀器技術(shù)將計(jì)算機(jī)屏幕作為儀器面板,采用EPP接口,同時(shí)在FPGA上開發(fā)控制電路,為后續(xù)開發(fā)留下了空間,同時(shí)節(jié)省了成本。本設(shè)計(jì)采用地址線16位,數(shù)據(jù)線12位的靜態(tài)RAM作為信號(hào)源的波形存儲(chǔ)器,后端采用兩種濾波類型對(duì)需要濾波的信號(hào)進(jìn)行濾波。啟動(dòng)信號(hào)時(shí)軟件需要先將波形數(shù)據(jù)預(yù)存在存儲(chǔ)器中便于調(diào)用,最后得到的結(jié)果基本滿足教學(xué)實(shí)驗(yàn)的需求。 本文結(jié)構(gòu)上首先介紹了直接采用DDS芯片制作信號(hào)源的利弊,及作者采用這種設(shè)計(jì)的初衷,然后介紹了信號(hào)源的整體結(jié)構(gòu),總體模塊。以下章節(jié)首先介紹FPGA內(nèi)部設(shè)計(jì),包括總體結(jié)構(gòu)和幾大部分模塊,包括:時(shí)鐘產(chǎn)生電路,相位累加器,數(shù)據(jù)輸入控制電路,濾波器控制電路,信號(hào)源啟動(dòng)控制電路。 然后介紹了其他模塊的設(shè)計(jì),包括存儲(chǔ)器選擇,幅度控制電路的設(shè)計(jì)以及濾波器電路的設(shè)計(jì),本設(shè)計(jì)的幅度控制采用兩級(jí)DA級(jí)聯(lián),以及后端電阻分壓網(wǎng)絡(luò)調(diào)節(jié)的方式進(jìn)行設(shè)計(jì),提高了幅度調(diào)節(jié)的范圍。對(duì)于濾波器的設(shè)計(jì),依據(jù)不同的信號(hào)頻率,分成了4個(gè)部分,對(duì)于500K以下的信號(hào)采用的是二階巴特沃斯有源低通濾波,對(duì)于500K以上至5M以下信號(hào)采用的五階RC低通濾波器。 在軟件設(shè)計(jì)部分,分成兩個(gè)部分,對(duì)于底層驅(qū)動(dòng)程序采用以Labwindows/CVI為平臺(tái)進(jìn)行開發(fā),利用其編譯和執(zhí)行速度快,并且和LabVIEW能夠很好連接的特性。對(duì)于上層控制軟件,采用以LabVIEW為平臺(tái)進(jìn)行開發(fā),充分利用其圖化設(shè)計(jì),易于擴(kuò)展。 論文最后對(duì)所做工作進(jìn)行了總結(jié),提出了進(jìn)一步改進(jìn)的方向。

    標(biāo)簽: FPGA DDS 信號(hào)源

    上傳時(shí)間: 2013-04-24

    上傳用戶:afeiafei309

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