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MC8051IP核的FPGA實現(xiàn)

  • GUPnP Media Renderer是MediaRenderer version 1 device type的一個參考實現(xiàn)

    GUPnP Media Renderer是MediaRenderer version 1 device type的一個參考實現(xiàn)

    標(biāo)簽: MediaRenderer Renderer version device

    上傳時間: 2013-12-10

    上傳用戶:coeus

  • 基于Fusion系列AFS600的FPGA的51核

    基于Fusion系列AFS600的FPGA的51核,在板子上試過,可以對51核寫1602的顯示程序,就可以顯示了,也可以寫其他的51程序。

    標(biāo)簽: Fusion FPGA AFS 600

    上傳時間: 2014-02-28

    上傳用戶:hewenzhi

  • FreeRTOS 的實現(xiàn)詳解

    FreeRTOS 的實現(xiàn)詳解,包括TCB實現(xiàn),調(diào)度原理,以及task通訊物件介紹。

    標(biāo)簽: FreeRTOS

    上傳時間: 2013-12-19

    上傳用戶:gaojiao1999

  • 基于FPGA的高性能32位浮點FFTIP核的開發(fā)

    基于FPGA的高性能32位浮點FFTIP核的開發(fā),適合fpga工程技術(shù)人員參考

    標(biāo)簽: FFTIP FPGA 性能 浮點

    上傳時間: 2014-12-05

    上傳用戶:semi1981

  • ARM7核在FPGA中的VHDL代碼實現(xiàn)

    ARM7核在FPGA中的VHDL代碼實現(xiàn)

    標(biāo)簽: ARM7 FPGA VHDL 代碼

    上傳時間: 2013-12-19

    上傳用戶:無聊來刷下

  • 基于Xilinx FPGA ip核的使用實例

    基于Xilinx FPGA ip核的使用實例

    標(biāo)簽: FPGA EDK

    上傳時間: 2015-04-19

    上傳用戶:ThomasAnn

  • FPGA中IP核的生成講解

    該文檔為FPGA中IP核的生成講解資料,講解的還不錯,感興趣的可以下載看看…………………………

    標(biāo)簽: fpga ip核

    上傳時間: 2021-11-10

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  • 基于FPGA嵌入式硬核的PCIExpress總線接口設(shè)計與驗證

    該文檔為基于FPGA嵌入式硬核的PCIExpress總線接口設(shè)計與驗證講解文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………

    標(biāo)簽: fpga 嵌入式 pciexpress 總線接口

    上傳時間: 2022-04-07

    上傳用戶:

  • 基于IP核雙口RAM的FPGA與DSPEMIF的接口設(shè)計

    基于IP核雙口RAM的FPGA與DSPEMIF的接口設(shè)計                

    標(biāo)簽: RAM fpga dsp emif 接口

    上傳時間: 2022-07-09

    上傳用戶:jiabin

  • 高速實時信號處理系統(tǒng)的FPGA軟件設(shè)計與實現(xiàn).rar

    隨著現(xiàn)代DSP、FPGA等數(shù)字芯片的信號處理能力不斷提高,基于軟件無線電技術(shù)的現(xiàn)代通信與信息處理系統(tǒng)也得到了更為廣泛的應(yīng)用。軟件無線電的基本思想是以一個通用、標(biāo)準(zhǔn)、模塊化的硬件系統(tǒng)作為其應(yīng)用平臺,把盡可能多的無線及個人通信和信號處理的功能用軟件來實現(xiàn),從而將無線通信新系統(tǒng)、新產(chǎn)品的開發(fā)逐步轉(zhuǎn)移到軟件上來。另一方面,現(xiàn)代信號處理系統(tǒng)對數(shù)據(jù)的處理速度、處理精度和動態(tài)范圍的要求也越來越高,需要每秒完成幾千萬到幾百億次運算。因此研制具備高速實時信號處理能力的通用硬件平臺越來越受到業(yè)界的重視。 @@ 目前的高速實時信號處理系統(tǒng)一般均采用DSP+FPGA的架構(gòu),其中DSP主要負責(zé)完成系統(tǒng)通信和基帶信號處理算法,而FPGA主要完成信號預(yù)處理等前端算法,并提供系統(tǒng)常用的各種外部接口邏輯。本文的主要工作就在于完成通用型高速實時信號處理系統(tǒng)的FPGA軟件設(shè)計。 @@ 本文提出了一種基于多DSP與FPGA的通用高速實時信號處理系統(tǒng)的架構(gòu)。綜合考慮各方面因素,作者選擇使用兩片ADSP-TS201浮點DSP以混合耦合模型構(gòu)成系統(tǒng)信號處理核心;以Xilinx公司最新的高性能FPGA Virtex-5系列的XC5VLX50T提供系統(tǒng)所需的各種接口,包括與ADSP-TS201的高速Linkport接口以及SPI、UART、SPORT等常用外設(shè)接口。此外,作者還選擇了ADSP-BF533定點DSP加入系統(tǒng)當(dāng)中以擴展系統(tǒng)音視頻信號處理能力,體現(xiàn)系統(tǒng)的通用性。 @@ 基于FPGA的嵌入式系統(tǒng)設(shè)計正逐漸成為現(xiàn)代FPGA應(yīng)用的一個熱點。結(jié)合課題需要,作者以Xilinx公司的MicroBlze軟核處理器為核心在Virtex-5片內(nèi)設(shè)計了一個嵌入式系統(tǒng),完成了對CF卡、DDR2 SDRAM存儲器的讀寫控制,并利用片內(nèi)集成的三態(tài)以太網(wǎng)MAC硬核模塊,實現(xiàn)了系統(tǒng)與上位PC機之間的以太網(wǎng)通信鏈路。此外,為擴展系統(tǒng)功能,適應(yīng)未來可能的軟件升級,進一步提高系統(tǒng)的通用性,還將嵌入式實時操作系統(tǒng)μC/OS-II移植到MicroBlaze處理器上。 @@ 最后,作者介紹了基于Xilinx RocketIO GTP收發(fā)器的高速串行傳輸設(shè)計的關(guān)鍵技術(shù)和基本的設(shè)計方法,充分體現(xiàn)了目前高速實時信號處理系統(tǒng)的發(fā)展要求和趨勢。 @@關(guān)鍵詞:高速實時信號處理;FPGA;Virtex-5;嵌入式系統(tǒng);MicroBlaze

    標(biāo)簽: FPGA 實時信號 處理系統(tǒng)

    上傳時間: 2013-05-17

    上傳用戶:wangchong

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