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MODELSIM-win

  • 在利用FPGA實現數字信號處理方面

    在利用FPGA實現數字信號處理方面,分布式算法發揮著關鍵作用,與傳統的乘積-積結構相比,具有并行處理的高效性特點。詳細研究了基于FPGA、采用分布式算法實現FIR數字濾波器的原理和方法,并通過Xilinx ISE在Modelsim下進行了仿真。

    標簽: FPGA 數字信號處理 方面

    上傳時間: 2015-08-14

    上傳用戶:wsf950131

  • 分區表備份器 miniTO 源碼 現傳上源碼...希望能對正學習DOS,WINDOWS,磁盤和編程者有點幫助... 內含純DOS,WIN32控制臺和WIN32 GUI三個版本.它們生成的備份文

    分區表備份器 miniTO 源碼 現傳上源碼...希望能對正學習DOS,WINDOWS,磁盤和編程者有點幫助... 內含純DOS,WIN32控制臺和WIN32 GUI三個版本.它們生成的備份文件可以在任何版本中使用. WIN32 GUI版本暫使用備份功能(其他模塊也都已全部寫好,全是完整的,現在僅開啟備份功能),如果想使用還原替換和比較功能,可自行打開調用的開關或加幾句調用的代碼就可以了, 一會兒我再把它們加上去,... (在WIN,打印功能是不能使用直接使用DOS的代碼的,要把它們先送到編輯框的緩沖區再顯示的...有興趣的也可自己弄...) 因剛剛從DOS代碼轉寫成WIN,程序提示還沒有完全改寫成WIN的,printf()等還留在里面,不過對編譯沒有影響,有時間可以改寫掉, 因時間關系,沒有詳細的注釋,不過在寫的時候,變量名字基本是根據其功能起的,所以,對程序的代碼思路還是不難理解的

    標簽: DOS WIN WINDOWS miniTO

    上傳時間: 2015-10-05

    上傳用戶:戀天使569

  • 現傳上源碼...希望能對正學習DOS,WINDOWS,磁盤和編程者有點幫助... 內含純DOS,WIN32控制臺和WIN32 GUI三個版本.它們生成的備份文件可以在任何版本中使用. DOS版

    現傳上源碼...希望能對正學習DOS,WINDOWS,磁盤和編程者有點幫助... 內含純DOS,WIN32控制臺和WIN32 GUI三個版本.它們生成的備份文件可以在任何版本中使用. DOS版具有全部功能 WIN版控制臺 暫未開啟打印功能 WIN版GUI 暫未開啟比較和打印功能 WIN32 版本的暫未開啟的功能的模塊都是完整的,如果想使用,可自行打開調用的開關或加幾句調用的代碼就可以了, 以后有時間我再把它們加上去,...) (在WIN,打印功能是不能使用直接使用DOS的代碼的,要把它們先送到編輯框的緩沖區再顯示的...有興趣的也可自己弄...) 因剛剛從DOS代碼轉寫成WIN,程序提示還沒有完全改寫成WIN的,printf()等還留在里面,不過對編譯沒有影響,有時間可以改寫掉, 因時間關系,沒有詳細的注釋,不過在寫的時候,變量名字基本是根據其功能起的,所以,對程序的代碼思路還是不難理解的

    標簽: DOS WIN WINDOWS 32

    上傳時間: 2015-10-08

    上傳用戶:leixinzhuo

  • 8位的a/d行為模型

    8位的a/d行為模型,可以應用于modelsim等環境下的仿真,不可綜合。

    標簽: 8位 行為模型

    上傳時間: 2014-01-06

    上傳用戶:invtnewer

  • 靜態隨機讀取存儲器行為模型

    靜態隨機讀取存儲器行為模型,可以應用于modelsim環境的仿真。

    標簽: 隨機 讀取 存儲器 行為模型

    上傳時間: 2013-12-25

    上傳用戶:woshini123456

  • 如果應用程序在共享 DLL 中使用 MFC

    如果應用程序在共享 DLL 中使用 MFC,且應用程序使用的語言不是 操作系統的當前語言,則需要從 Microsoft Visual C++ 光盤上 Win\System 目錄下將相應的本地化資源 MFC70XXX.DLL

    標簽: DLL MFC 應用程序

    上傳時間: 2014-01-10

    上傳用戶:asasasas

  • 學生通訊管理系統是本人的課程設計

    學生通訊管理系統是本人的課程設計,在win-TC環境下編譯通過,在DOS下運行。完成學生基本信息的錄入,查詢,刪除等操作。適合C語言初學者參考。

    標簽: 通訊 管理系統

    上傳時間: 2014-01-03

    上傳用戶:shizhanincc

  • 本代碼介紹了使用VHDL開發FPGA的一般流程

    本代碼介紹了使用VHDL開發FPGA的一般流程,最終采用了一種基于FPGA的數字頻率的實現方法。該設計采用硬件描述語言VHDL,在軟件開發平臺ISE上完成,可以在較高速時鐘頻率(100MHz)下正常工作。該設計的頻率計能準確的測量頻率在1Hz到100MHz之間的信號。使用ModelSim仿真軟件對VHDL程序做了仿真,并完成了綜合布局布線,最終下載到芯片Spartan-II上取得良好測試效果。

    標簽: VHDL FPGA 代碼 流程

    上傳時間: 2014-01-12

    上傳用戶:hj_18

  • 用VHDL寫的運動計時表程序

    用VHDL寫的運動計時表程序,用Modelsim仿真已經通過,帖出來與大家分享。

    標簽: VHDL 計時 程序

    上傳時間: 2014-01-25

    上傳用戶:banyou

  • riscMCU的VHDL實現

    riscMCU的VHDL實現,內附有modelsim仿真testbench和文檔說明

    標簽: riscMCU VHDL

    上傳時間: 2014-12-02

    上傳用戶:daoxiang126

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