MODELSIM 環境下的Verilog 源代碼
MODELSIM 環境下的Verilog 源代碼，實現全加器功能...
Modelsim技術資料
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?? 技術文檔：1
?? 源代碼：1619
?? 電路圖：1
?? Modelsim全部資料 (448個)
本代碼是在modelsim下運行的模擬8×8位的CPU
本代碼是在modelsim下運行的模擬8×8位的CPU，執行程度，對深入理解CPU設計和運行原理具有重要意義...
ModelSim的波形比較的功能可以將當前仿真與一個參考數據（WLF文件）進行比較
ModelSim的波形比較的功能可以將當前仿真與一個參考數據（WLF文件）進行比較，比較的結果可以在波形窗口或者列表窗口中查看，也可以將比較的結果生成一個文本文件...
ML Modelsim教程（PDF）.zip
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fir在dspbuilder下產生VHDL源碼及其測試激勵文件時的matlab模型,在modelsim下仿真通過
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fft在dspbuilder下產生VHDL源碼及其測試激勵文件的matlab模型,在modelsim下仿真通過
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dds在dspbuilder下產生VHDL源碼及其測試激勵文件的matlab模型,在modelsim下仿真通過
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m序列在dspbuilder下產生VHDL源碼及其測試激勵文件的matlab模型,在modelsim下仿真通過
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正弦波在dspbuilder下產生VHDL源碼及其測試激勵文件的matlab模型,在modelsim下仿真通過
正弦波在dspbuilder下產生VHDL源碼及其測試激勵文件的matlab模型,在modelsim下仿真通過...
crack for ModelSim, a Verilog, VHDL and mixed VHDL / Verilog CAD simulator for FPGA, board and IC de
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