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利用單片機做的編碼器輸出值LED顯示程序，用MAX7219驅動七段數碼管，完成二‘十’十六進制的切換顯示。
標簽： LED 用單片機 顯示程序 編碼器
上傳時間： 2014-07-22
上傳用戶：hjshhyy
定時器的編程，vhdl語言，可以實現24時制定時器
標簽： 定時器 編程
上傳時間： 2013-12-19
上傳用戶：1427796291
本文使用實例描述了在 FPGA/CPLD 上使用 VHDL 進行分頻器設 計，包括偶數分頻、非 50％占空比和 50％占空比的奇數分頻、半整數 （N+0.5）分頻、小數分頻、分數分頻以及積分分頻。所有實現均可 通過 Synplify Pro 或 FPGA 生產廠商的綜合器進行綜合，形成可使 用的電路，并在 ModelSim 上進行驗證。
標簽： FPGA CPLD VHDL 分頻器
上傳時間： 2013-12-15
上傳用戶：從此走出陰霾
使用C#程式語言開發，並執行於.NET Framework下；是研習「蟻拓尋優法」不可或缺的軟體工具。系統使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設定費洛蒙和食物氣味強度等相關參數以及動態設定障礙物的位置和形狀，研習螞蟻覓食的最短路徑形成過程。研習各種參數設定對螞蟻覓食行為的影響，了解費落蒙機制對蟻拓尋優化法的影響。本系統可支援柔性計算教學，研習蟻拓優化法中人工螞蟻的隨機搜尋模式和啟發式法則設計原理。
標簽： 程式
上傳時間： 2013-12-24
上傳用戶：anng
7段數碼顯示譯碼器設計7段數碼是純組合電路，通常的小規模專用IC，如74或4000系列的器件只能作十進制BCD碼譯碼，然而數字系統中的數據處理和運算都是二進制的，所以輸出表達都是十六進制的，為了滿足十六進制數的譯碼顯示，最方便的方法就是利用譯碼程序在FPGA/CPLD中來實現。例子作為七段譯碼器，輸出信號LED7S的7位分別接數碼管的7個段，高位在左，低位在右。例如當LED7S輸出為“1101101”時，數碼管的7個段g、f、e、d、c、b、a分別接1、1、0、1、1、0、1；接有高電平的段發亮，于是數碼管顯示“5”。
標簽： 數碼顯示 數碼 譯碼器 組合電路
上傳時間： 2014-01-26
8位十六進制頻率計設計 根據頻率的定義和頻率測量的基本原理，測定信號的頻率必須有一個脈寬為1s的輸入信號脈沖計數允許信號；1s計數結束后，計數值被鎖入鎖存器，計數器清零，為下一測頻計數周期做好準備。測頻控制信號可由一個獨立的發生器（FTCTRL）來產生。
標簽： 8位 十六進制 頻率計設 頻率
上傳時間： 2013-12-26
上傳用戶：咔樂塢
VFD-A 內部的參數資料可使用內部 RS-485 串聯通訊介面，設定及修改並可控制交流電機驅動 器運轉及監測交流電機驅動器的運轉狀態，可提高自動化的能力。
標簽： VFD-A 485 RS
上傳用戶：invtnewer
磁盤編輯器，可以以16進制形式，對磁盤進行編輯。可查看改寫病毒、磁盤的信息。對磁盤、文件加密，安全有很大幫助。
標簽： 磁盤 編輯器
上傳時間： 2014-01-08
上傳用戶：xiaoxiang
程序提供了一種2選1選擇器的算法，只需稍加即可改成n選1選擇器。哇！
標簽： 程序 選擇器 算法
上傳時間： 2014-01-02
上傳用戶：ynsnjs
這是一個求數獨遊戲的m-file 在matlab的命令窗口 鍵入>> sudo7 或者run sudo7 的m-file 之後在 9x9 的方格內 填入 數獨的問題 按下 "計算是否有解" 的功能鍵 若不是存在多組的解，則可以 按下 "顯示結果" 的功能鍵， 也可以載入作者測試的"date1"或"date2" 但不可載入及修改"condition"
標簽： m-file sudo7 matlab gt
上傳時間： 2016-11-18
上傳用戶：waizhang
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