NC-SIM 5.40
NC-Sim工具進行邏輯驗證,通常編寫BFM是不可缺少的工作,而激勵產生、結果分析和建模只能選擇高級語言了。您推薦使用C/C++...
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Cadence公司出品,很好的Verilog/VHDL仿真工具,其中NC-Verilog 的前身是著名的Verilog仿真軟件:Verilog-XL,用于Verilog仿真;NC-VHDL,用于VHDL仿真;NC-Sim,是Verilog/VHDL混合語言仿真工具...
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EDA (Electronic Design Automation)即“電子設計自動化”,是指以計算機為工作平臺,以EDA軟件為開發環境,以硬件描述語言為設計語言,以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等),以集成電路芯片為目標器件的電子產品自動化設計過程。“工欲善其事,必先...