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QC-ldpc

  • qc—ldpc編碼的matlab源碼

    qc—ldpc編碼的matlab源碼,分為好幾個(gè)版本,small文件夾里的支持小的稀疏矩陣,large文件夾里的支持較大的稀疏矩陣。test文件為頂層

    標(biāo)簽: matlab ldpc 編碼 源碼

    上傳時(shí)間: 2016-07-24

    上傳用戶:jeffery

  • Construct the short length of QC LDPC codes without girth 4 and girth 6

    Construct the short length of QC LDPC codes without girth 4 and girth 6

    標(biāo)簽: girth Construct without length

    上傳時(shí)間: 2016-11-01

    上傳用戶:ljt101007

  • constructs girth-six column-weight three QC-ldpc codes

    constructs girth-six column-weight three QC-ldpc codes

    標(biāo)簽: column-weight constructs girth-six QC-ldpc

    上傳時(shí)間: 2013-12-19

    上傳用戶:lht618

  • Flexible construction of girth-six QC-ldpc Codes

    Flexible construction of girth-six QC-ldpc Codes

    標(biāo)簽: construction girth-six Flexible QC-ldpc

    上傳時(shí)間: 2017-09-27

    上傳用戶:gaojiao1999

  • Construct the short length of QC LDPC codes without girth 4 and girth 6

    Construct the short length of QC LDPC codes without girth 4 and girth 6

    標(biāo)簽: girth Construct without length

    上傳時(shí)間: 2017-09-27

    上傳用戶:kelimu

  • 基于MATALB的QC-ldpc碼的編碼和解碼性能仿真

    基于MATALB的QC-ldpc碼的編碼,解碼和主程序,打開MATALB對(duì)主程序仿真即可。每一句自己都有漢語解釋,嚴(yán)格對(duì)照每一步原理,新手小白都能看懂哦,希望有需要的可以看看,自己也可以根據(jù)我的進(jìn)行參數(shù)改變,對(duì)不同的性能分析。可以私信我多交流哦!

    標(biāo)簽: matalb QC-ldpc 編碼 解碼

    上傳時(shí)間: 2022-06-04

    上傳用戶:XuVshu

  • 高吞吐量LDPC碼編碼構(gòu)造及其FPGA實(shí)現(xiàn)

    低密度校驗(yàn)碼(LDPC,Low Density Parity Check Code)是一種性能接近香農(nóng)極限的信道編碼,已被廣泛地采用到各種無線通信領(lǐng)域標(biāo)準(zhǔn)中,包括我國的數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)、歐洲第二代衛(wèi)星數(shù)字視頻廣播標(biāo)準(zhǔn)(DVB-S2,Digital Video Broadcasting-Satellite 2)、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統(tǒng)中的核心技術(shù)之一。 當(dāng)今LDPC碼構(gòu)造的主流方向有兩個(gè),分別是結(jié)合準(zhǔn)循環(huán)(QC,Quasi Cyclic)移位結(jié)構(gòu)的單次擴(kuò)展構(gòu)造和類似重復(fù)累積(RA,Repeat Accumulate)碼構(gòu)造。相應(yīng)地,主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高,但是需要較多的寄存器和ROM資源;基于迭代譯碼的編碼算法實(shí)現(xiàn)簡單,但是吞吐量不高,且不容易構(gòu)造高性能的好碼。 本文在研究了上述幾種碼構(gòu)造和編碼算法之后,結(jié)合編譯碼器綜合實(shí)現(xiàn)的復(fù)雜度考慮,提出了一種切實(shí)可行的基于二次擴(kuò)展(Dex,Duplex Expansion)的QC-ldpc碼構(gòu)造方法,以實(shí)現(xiàn)高吞吐量的LDPC碼收發(fā)端;并且充分利用該類碼校驗(yàn)矩陣準(zhǔn)循環(huán)移位結(jié)構(gòu)的特點(diǎn),結(jié)合RU算法,提出了一種新編碼器的設(shè)計(jì)方案。 基于二次擴(kuò)展的QC-ldpc碼構(gòu)造方法,是通過對(duì)母矩陣先后進(jìn)行亂序擴(kuò)展(Pex,Permutation Expansion)和循環(huán)移位擴(kuò)展(CSEx,Cyclic Shift Expansion)實(shí)現(xiàn)的。在此基礎(chǔ)上,為了實(shí)現(xiàn)可變碼長、可變碼率,一般編譯碼器需同時(shí)支持多個(gè)亂序擴(kuò)展和循環(huán)移位擴(kuò)展的擴(kuò)展因子。本文所述二次擴(kuò)展構(gòu)造方法的特點(diǎn)在于,固定循環(huán)移位擴(kuò)展的擴(kuò)展因子大小不變,支持多個(gè)亂序擴(kuò)展的擴(kuò)展因子,使得譯碼器結(jié)構(gòu)得以精簡;構(gòu)造得到的碼字具有近似規(guī)則碼的結(jié)構(gòu),便于硬件實(shí)現(xiàn);(偽)隨機(jī)生成的循環(huán)移位系數(shù)能夠提高碼字的誤碼性能,是對(duì)硬件實(shí)現(xiàn)和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復(fù)用,使得實(shí)現(xiàn)復(fù)雜度近似與碼長成正比。考慮到吞吐量的要求,新編碼器結(jié)構(gòu)完全拋棄了RU算法中串行的前向替換(FS,F(xiàn)orward Substitution)模塊,同時(shí)簡化了流水線結(jié)構(gòu),由原先RU算法的6級(jí)降低為4級(jí);為了縮短編碼延時(shí),設(shè)計(jì)時(shí)安排每一級(jí)流水線計(jì)算所需的時(shí)鐘數(shù)大致相同。 這種碼字構(gòu)造和編碼聯(lián)合設(shè)計(jì)方案具有以下優(yōu)勢(shì):相比RU算法,新方案對(duì)可變碼長、可變碼率的支持更靈活,吞吐量也更大;相比基于生成矩陣的編碼算法,新方案節(jié)省了50%以上的寄存器和ROM資源,單位資源下的吞吐量更大;相比類似重復(fù)累積碼結(jié)構(gòu)的基于迭代譯碼的編碼算法,新方案使高性能LDPC碼的構(gòu)造更為方便。以上結(jié)果都在Xilinx Virtex II pro 70 FPGA上得到驗(yàn)證。 通過在實(shí)驗(yàn)板上實(shí)測(cè)表明,上述基于二次擴(kuò)展的QC-ldpc碼構(gòu)造和相應(yīng)的編碼方案能夠?qū)崿F(xiàn)高吞吐量LDPC碼收發(fā)端,在實(shí)際應(yīng)用中具有很高的價(jià)值。 目前,LDPC碼正向著非規(guī)則、自適應(yīng)、信源信道及調(diào)制聯(lián)合編碼方向發(fā)展。跨層聯(lián)合編碼的構(gòu)造方法,及其對(duì)應(yīng)的編碼算法,也必將成為信道編碼理論未來的研究重點(diǎn)。

    標(biāo)簽: LDPC FPGA 吞吐量 編碼

    上傳時(shí)間: 2013-07-26

    上傳用戶:qoovoop

  • LDPC已經(jīng)成為現(xiàn)在很流行的FEC碼

    LDPC已經(jīng)成為現(xiàn)在很流行的FEC碼,這是一篇講述QC-ldpc編碼的經(jīng)典論文,作者是IEEE終身會(huì)員林舒,對(duì)目前常用的QC-ldpc編碼作了詳盡的描述

    標(biāo)簽: LDPC FEC

    上傳時(shí)間: 2013-12-09

    上傳用戶:csgcd001

  • 基于FPGA的LDPC碼的實(shí)現(xiàn).rar

    低密度校驗(yàn)碼(LDPC)是一種能逼近Shannon容量限的漸進(jìn)好碼,其長碼性能甚至超過了Turbo碼。低密度校驗(yàn)碼以其迭代譯碼復(fù)雜度低,沒有錯(cuò)誤平層,碼率和碼長可靈活改變的優(yōu)點(diǎn)成為Turbo碼強(qiáng)有力的競爭對(duì)手。目前,LDPC碼已廣泛應(yīng)用于深空通信、光纖通信、衛(wèi)星數(shù)字視頻和音頻廣播等領(lǐng)域,因此LDPC碼編譯碼器的硬件實(shí)現(xiàn)已成為糾錯(cuò)編碼領(lǐng)域的研究熱點(diǎn)之一。 本文在分析LDPC碼的基本編碼結(jié)構(gòu)基礎(chǔ)上,首先研究了LDPC碼的隨機(jī)構(gòu)造方法,并給出了有效的PEG算法實(shí)現(xiàn)方法,重點(diǎn)分析了用環(huán)消除(cycle elimination)算法實(shí)現(xiàn)的準(zhǔn)循環(huán)LDPC碼的構(gòu)造。然后對(duì)LDPC碼的幾種不同譯碼算法進(jìn)行分析比較,討論了一種適合硬件實(shí)現(xiàn)的譯碼算法-TDMP算法,并對(duì)易于硬件實(shí)現(xiàn)的TDMP算法進(jìn)行了性能仿真,仿真結(jié)果表明TDMP算法作為硬件實(shí)現(xiàn)的譯碼算法具有優(yōu)異的性能優(yōu)勢(shì)。最后針對(duì)Altera公司的StratixEPIS25 FPGA芯片設(shè)計(jì)了一個(gè)基于TDMP算法的(4096,2048)非規(guī)則LDPC碼譯碼器,內(nèi)部用了4個(gè)單校驗(yàn)碼譯碼器并行譯1幀數(shù)據(jù),3幀同時(shí)譯碼,作者詳細(xì)介紹了該譯碼器芯片的設(shè)計(jì)過程和內(nèi)部結(jié)構(gòu)和工作流程。

    標(biāo)簽: FPGA LDPC

    上傳時(shí)間: 2013-05-23

    上傳用戶:fujun35303

  • 數(shù)字電視傳輸系統(tǒng)中LDPC碼編碼器的研究與FPGA實(shí)現(xiàn).rar

    自香農(nóng)先生于1948年開創(chuàng)信息論以來,經(jīng)過將近60年的發(fā)展,信道編碼技術(shù)已經(jīng)成為通信領(lǐng)域的一個(gè)重要分支,各種編碼技術(shù)層出不窮。目前廣泛研究的低密度奇偶校驗(yàn)(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農(nóng)限性能的優(yōu)秀糾錯(cuò)碼,并已在數(shù)字電視、無線通信、磁盤存儲(chǔ)等領(lǐng)域得到大量應(yīng)用。 目前數(shù)字電視已經(jīng)成為最熱門的話題之一,用手機(jī)看北京奧運(yùn),已經(jīng)成為每一個(gè)中國人的夢(mèng)想。最近兩年我國頒布了兩部與數(shù)字電視有關(guān)的通信標(biāo)準(zhǔn),分別是數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)和移動(dòng)多媒體(CMMB)即俗稱的手機(jī)電視標(biāo)準(zhǔn)。數(shù)字電視正與每個(gè)人走得越來越近,我國預(yù)期在2015年全面實(shí)現(xiàn)數(shù)字電視并停止模擬電視的播出。作為數(shù)字電視標(biāo)準(zhǔn)的核心技術(shù)之一的前向糾錯(cuò)碼技術(shù)已經(jīng)成為眾多科研單位的研究熱點(diǎn),相應(yīng)的編解碼芯片更成為重中之重。在DMB-TH標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級(jí)聯(lián)編碼方式,在CMMB標(biāo)準(zhǔn)中用到了LDPC碼和RS碼的級(jí)聯(lián)編碼方式,在DVB-S2標(biāo)準(zhǔn)中用到了LDPC碼和BCH碼的級(jí)聯(lián)編碼方式。 本論文以目前最重要的三個(gè)與數(shù)字電視相關(guān)的標(biāo)準(zhǔn):數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)(DMB-TH)、手機(jī)電視標(biāo)準(zhǔn)(CMMB)以及數(shù)字衛(wèi)星電視廣播標(biāo)準(zhǔn)(DVB-S2)為切入點(diǎn),深入研究它們的編碼方式,設(shè)計(jì)了這三個(gè)標(biāo)準(zhǔn)中的LDPC碼編碼器,并在FPGA上實(shí)現(xiàn)了前兩個(gè)標(biāo)準(zhǔn)的編碼芯片,實(shí)現(xiàn)了DMB-TH標(biāo)準(zhǔn)中0.4、0.6以及0.8三種碼率的復(fù)用。在研究CMMB標(biāo)準(zhǔn)中編碼器設(shè)計(jì)時(shí),提出一種改進(jìn)的LU分解算法,該分解方式適合任意的H矩陣,具有一定的廣泛性。測(cè)試結(jié)果表明,芯片邏輯功能完全正確,速度和資源消耗均達(dá)到了標(biāo)準(zhǔn)的要求,具有一定的商用價(jià)值。

    標(biāo)簽: LDPC FPGA 數(shù)字電視

    上傳時(shí)間: 2013-07-07

    上傳用戶:327000306

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