?? QUARTUSII技術(shù)資料

?? 資源總數(shù)：201
?? 技術(shù)文檔：1
?? 源代碼：233
QuartusII是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（AlteraHardware支持DescriptionLanguage）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。

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在QuartusII運用ＡＨＤＬ語言，首先設(shè)計出PN發(fā)生器來產(chǎn)生一個11位的數(shù)據(jù)流在整個周期內(nèi)有效數(shù)據(jù)有 =2047位；再設(shè)計狀態(tài)機用來檢測串行數(shù)據(jù)流中的序列。運用兩個個計數(shù)器分別對PN碼計數(shù)以及序列出現(xiàn)的次數(shù)計數(shù)。改變ＰＮ碼結(jié)構(gòu)可以作為通用數(shù)列檢測器...

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