Altera ModelSim 6.5仿真入門教程，需要的可自行下載。 平臺 軟件：ModelSim-Altera 6.5e （Quartus II 10.0） Starter Edition 內容 1 設計流程 使用ModelSim仿真的基本流程為： 圖1.1 使用 ModelSim仿真的基本流程 2 開始 2.1 新建工程 打開ModelSim后，其畫面如圖2.1所示。
上傳時間： 2014-12-31
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5種PCB電路PCB轉換軟件
上傳時間： 2013-10-16
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福昕閱讀器 3.1新功能 因特網搜索 福昕閱讀器 3.1支持因特網搜索功能。您可以選擇您要查找的文本，然后點擊彈出的查找圖標或者直接拖動鼠標以通過互聯網查找相關信息。 常用工具欄 福昕閱讀器 3.1允許用戶自行定制喜歡工具列為常用工具欄，這樣方便用戶快速地找到他們經常需要使用的工具。 注釋面板 注釋面板不僅列出PDF文檔中所有添加的批注，而且提供了許多常用選項來幫助用戶更 好地管理批注，例如，展開或折疊批注內容、分類批注內容等。 小結注釋 將PDF文檔內的所有批注概要生成一個PDF文檔，并允許用戶對該文檔進行文檔屬性設置，如紙張設置、紙張寬度的選擇等等，方便用戶輕松查閱文檔注釋。 文檔權限摘要 用戶可通過點擊 “屬性”對話框的安全標簽來查看當前文檔的相關權限。文檔的安全設置選項列舉了當前文檔的加密方法，而在文檔權限摘要中則詳細地列出了允許用戶操作的相關信息。 支持MSAA 部分用戶界面支持微軟主動式輔助（MSAA），MSAA是微軟針對視力有障礙的人所提供的一個基于COM的API接口，福昕閱讀器 3.1的UI界面信息可通過第三方軟件傳達給MSAA客戶端。 全新的用戶界面 福昕閱讀器 3.1對用戶界面進行了顯著更新，采用更加親近、方便、友好的設計方案，為用戶提供了更加簡潔雅致的使用感受。 點擊此處：福昕閱讀器 5.1 最新版下載 福昕PDF閱讀器是一款小巧、快速且功能豐富的PDF閱讀器，讓您能夠隨時打開、瀏覽及打印任何PDF文件。 不同于其他免費PDF閱讀器，它擁有各種簡單易用的功能，如：添加注釋、填寫表格及為PDF文檔添加文本等。
上傳時間： 2013-11-13
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5種PCB電路PCB轉換軟件
上傳時間： 2013-12-16
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福昕閱讀器 3.1新功能 因特網搜索 福昕閱讀器 3.1支持因特網搜索功能。您可以選擇您要查找的文本，然后點擊彈出的查找圖標或者直接拖動鼠標以通過互聯網查找相關信息。 常用工具欄 福昕閱讀器 3.1允許用戶自行定制喜歡工具列為常用工具欄，這樣方便用戶快速地找到他們經常需要使用的工具。 注釋面板 注釋面板不僅列出PDF文檔中所有添加的批注，而且提供了許多常用選項來幫助用戶更 好地管理批注，例如，展開或折疊批注內容、分類批注內容等。 小結注釋 將PDF文檔內的所有批注概要生成一個PDF文檔，并允許用戶對該文檔進行文檔屬性設置，如紙張設置、紙張寬度的選擇等等，方便用戶輕松查閱文檔注釋。 文檔權限摘要 用戶可通過點擊 “屬性”對話框的安全標簽來查看當前文檔的相關權限。文檔的安全設置選項列舉了當前文檔的加密方法，而在文檔權限摘要中則詳細地列出了允許用戶操作的相關信息。 支持MSAA 部分用戶界面支持微軟主動式輔助（MSAA），MSAA是微軟針對視力有障礙的人所提供的一個基于COM的API接口，福昕閱讀器 3.1的UI界面信息可通過第三方軟件傳達給MSAA客戶端。 全新的用戶界面 福昕閱讀器 3.1對用戶界面進行了顯著更新，采用更加親近、方便、友好的設計方案，為用戶提供了更加簡潔雅致的使用感受。 點擊此處：福昕閱讀器 5.1 最新版下載 福昕PDF閱讀器是一款小巧、快速且功能豐富的PDF閱讀器，讓您能夠隨時打開、瀏覽及打印任何PDF文件。 不同于其他免費PDF閱讀器，它擁有各種簡單易用的功能，如：添加注釋、填寫表格及為PDF文檔添加文本等。
上傳時間： 2013-11-11
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1.3.5 嵌入微處理器的FPGA設計流程。
上傳時間： 2015-01-01
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5款ALTERA FPGA開發板原理圖合集
上傳時間： 2013-12-19
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可編程邏輯器件（PLD）是嵌入式工業設計的關鍵元器件。在工業設計中，PLD已經從提供簡單的膠合邏輯發展到使用FPGA作為協處理器。該技術在通信、電機控制、I/O模塊以及圖像處理等應用中支持 I/O 擴展，替代基本的微控制器 （MCU） 或者數字信號處理器 （DSP）。 隨著系統復雜度的提高，FPGA還能夠集成整個芯片系統（SoC），與分立的 MCU、DSP、ASSP，以及 ASIC解決方案相比，大幅度降低了成本。不論是用作協處理器還是SoC，Altera FPGA在您的工業應用中都具有以下優點： 1. 設計集成——使用FPGA作為協處理器或者SoC，在一個器件平臺上集成 IP和軟件堆棧，從而降低成本。 2. 可重新編程能力——在一個公共開發平臺的一片 FPGA中，使工業設計能夠適應協議、IP以及新硬件功能的發展變化。 3. 性能調整——通過FPGA中的嵌入式處理器、定制指令和IP模塊，增強性能，滿足系統要求。 4. 過時保護——較長的 FPGA 產品生命周期，通過 FPGA 新系列的器件移植，延長工業產品的生命周期，保護硬件不會過時。 5. 熟悉的工具——使用熟悉的、功能強大的集成工具，簡化設計和軟件開發、IP集成以及調試。
上傳時間： 2013-11-18
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CadenceAllegro16.5-破解方法
標簽： CadenceAllegro 16.5 破解
上傳時間： 2013-11-02
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請注意軟件勿用于商業用途，否則后果自負！請不要做拿手黨，好用大家享！頂起吧！解壓不成功時請把你們解壓軟件升級到最新版本！ 附件也有本人學習PADS9.3、CadenceAllegro16.5、orcad軟件以及教程一塊上傳，下載時最好不要用第三方軟件，直接保存就可以了。 PADS9.3安裝說明（兼容win7、xp）： 1.參考“PADS9.3圖文安裝方法(WIN7_XP)”完成軟件安裝。 2.參考“PADS9.3”完成破解！破解需要dos環境下完成，具體操作步驟教程有。 3.安裝目錄和源文件都不能是中文目錄 CadenceAllegro16.5（兼容win7、xp）兩個文件下載完成才能解壓，： 1.參考“真正的cadence_16.5_破解方法”按照操作步驟即可。 2.安裝目錄和源文件都不能是中文目錄 注意！！！ 如果破解不成功有可能破解文件壞掉了，請把“Cadence_Allegro16.5crack-修正破解方法”文件解壓，用里面破解文件重新破解一遍！
標簽： CadenceAllegro PADS 16.5 win7
上傳時間： 2015-01-01
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