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Quartus

QuartusIIdesign是最高級(jí)和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計(jì)環(huán)境。QuartusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計(jì)流程。QuartusIIdesign是唯一一個(gè)包括以timingclosure和基于塊的設(shè)計(jì)流為基本特征的programmablelogicdevice(PLD)的軟件。QuartusII設(shè)計(jì)軟件改進(jìn)了性能、提升了功能性、解決了潛在的設(shè)計(jì)延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開(kāi)發(fā)的統(tǒng)一工作流程。

我剛完成的基于Quartus Two 開(kāi)發(fā)環(huán)境全部用Verilog硬件描述語(yǔ)言編譯無(wú)誤的MSK調(diào)制解調(diào)器

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標(biāo)簽： Quartus Verilog MSK Two

上傳時(shí)間： 2016-04-14

上傳用戶：CHINA526
華為內(nèi)部教程(比較早的) 對(duì)Quartus 流程中各階段進(jìn)行較為詳細(xì) 的介紹最后簡(jiǎn)要介紹了一下如何使用TCL進(jìn)行Quartus 流程的腳本方式運(yùn)行

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標(biāo)簽： Quartus TCL 流程華為

上傳時(shí)間： 2013-12-11

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USB芯片F(xiàn)T245BM讀寫(xiě)代碼,在Quartus II V7.2上測(cè)試成功!---Verilog語(yǔ)言.

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標(biāo)簽： Quartus Verilog USB 245

上傳時(shí)間： 2016-04-18

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這一資料詳細(xì)講解了如何在Quartus中使用modelsim

這一資料詳細(xì)講解了如何在Quartus中使用modelsim，具有一定的參考價(jià)值

標(biāo)簽： modelsim Quartus

上傳時(shí)間： 2013-12-09

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altera 公司的Quartus ii中文用戶指南

altera 公司的Quartus ii中文用戶指南

標(biāo)簽： Quartus altera 用戶

上傳時(shí)間： 2016-04-24

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一個(gè)完整的Quartus設(shè)計(jì)例子

一個(gè)完整的Quartus設(shè)計(jì)例子，初學(xué)Quartus的人必看！

標(biāo)簽： Quartus

上傳時(shí)間： 2014-01-24

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Quartus 的一個(gè)實(shí)例,希望對(duì)剛剛學(xué)習(xí)Quartus 的人有點(diǎn)幫助

Quartus 的一個(gè)實(shí)例,希望對(duì)剛剛學(xué)習(xí)Quartus 的人有點(diǎn)幫助

標(biāo)簽： Quartus

上傳時(shí)間： 2016-05-15

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sin波形信號(hào)發(fā)生起的程序 VHDL語(yǔ)言描述 Quartus

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標(biāo)簽： Quartus VHDL sin 波形

上傳時(shí)間： 2014-11-30

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Quartus開(kāi)發(fā)環(huán)境下開(kāi)發(fā)的Arinc 429總線收發(fā)器工程

Quartus開(kāi)發(fā)環(huán)境下開(kāi)發(fā)的Arinc 429總線收發(fā)器工程，由于產(chǎn)權(quán)問(wèn)題，提供的程序有刪減，標(biāo)號(hào)未盡規(guī)范。

標(biāo)簽： Quartus Arinc 429 開(kāi)發(fā)環(huán)境

上傳時(shí)間： 2016-05-19

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VHDL編寫(xiě)的異步通信串行口設(shè)計(jì)用Quartus工具編譯

VHDL編寫(xiě)的異步通信串行口設(shè)計(jì)用Quartus工具編譯

標(biāo)簽： Quartus VHDL 編寫(xiě) 異步通信

上傳時(shí)間： 2014-01-24

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Quartus

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VHDL編寫(xiě)的異步通信串行口設(shè)計(jì)用Quartus工具編譯