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  • 串口調試.rar

    一個很好而小巧的串口調試助手,支持常用的300-115200bps波特率,能設置校驗、數據位和停止位,能以ASCII碼或十六進制接收或發送任何數據或字符(包括中文),可以任意設定自動發送周期,并能將接收數據保存成文本文件,能發送任意大小的文本文件。

    標簽: 串口調試

    上傳時間: 2013-04-24

    上傳用戶:zxc23456789

  • 1.5_串口調試助手.rar

    一個很好而小巧的串口調試助手,支持常用的300-115200bps波特率,能設置校驗、數據位和停止位,能以ASCII碼或十六進制接收或發送任何數據或字符(包括中文),可以任意設定自動發送周期,并能將接收數據保存成文本文件,能發送任意大小的文本文件。

    標簽: 1.5 串口 調試助手

    上傳時間: 2013-06-25

    上傳用戶:z1191176801

  • 串口TT.rar

    偉納電子開發的串口調試軟件,功能強大,使用方便。

    標簽: TT 串口

    上傳時間: 2013-04-24

    上傳用戶:afeiafei309

  • 基于FPGA的遺傳算法硬件實現研究

    遺傳算法是基于自然選擇的一種魯棒性很強的解決問題方法。遺傳算法已經成功地應用于許多難優化問題,現已成為尋求滿意解的最佳工具之一。然而,較慢的運行速度也制約了其在一些實時性要求較高場合的應用。利用硬件實現遺傳算法能夠充分發揮硬件的并行性和流水線的特點,從而在很大程度上提高算法的運行速度。 本文對遺傳算法進行了理論介紹和分析,結合硬件自身的特點,選用了適合硬件化的遺傳算子,設計了標準遺傳算法硬件框架;為了進一步利用硬件自身的并行特性,同時提高算法的綜合性能,本文還對現有的一些遺傳算法的并行模型進行了研究,討論了其各自的優缺點及研究現狀,并在此基礎上提出一種適合硬件實現的粗粒度并行遺傳算法。 我們構建的基于FPGA構架的標準遺傳算法硬件框架,包括初始化群體、適應度計算、選擇、交叉、變異、群體存儲和控制等功能模塊。文中詳細分析了各模塊的功能和端口連接,并利用硬件描述語言編寫源代碼實現各模塊功能。經過功能仿真、綜合、布局布線、時序仿真和下載等一系列步驟,實現在Altera的Cyclone系列FPGA上。并且用它嘗試解決一些函數的優化問題,給出了實驗結果。這些硬件模塊可以被進一步綜合映射到ASIC或做成IP核方便其他研究者調用。 最后,本文對硬件遺傳算法及其在函數優化中的一些尚待解決的問題進行了討論,并對本課題未來的研究進行了展望。

    標簽: FPGA 算法 硬件 實現研究

    上傳時間: 2013-07-22

    上傳用戶:誰偷了我的麥兜

  • 多端口主從式多機通信系統的研究

    利用端口串行通信接口卡來擴展多個串行口是解決工業過程中集散控制系統的一種有效方法,文中介紹了利用MOXA公司生產的8端口串行通信接口板在PC機與89C51單片機之間進行串行通信的擴展方法,給出了使用多

    標簽: 多端口 多機通信

    上傳時間: 2013-07-20

    上傳用戶:風之驕子

  • 51串口通信計算器

    51串口通信計算器、51串口通信計算器 方便實用!!!

    標簽: 串口通信 計算器

    上傳時間: 2013-05-18

    上傳用戶:ziyu_job1234

  • FPGA的串口通信

    fpga與串口的不匹配問題的解決,通過這個實例做了一個講解。

    標簽: FPGA 串口通信

    上傳時間: 2013-05-17

    上傳用戶:qwe1234

  • 多功能車輛總線一類設備的FPGA實現

    多功能車輛總線一類設備是一個在列車通信網(TCN,TrainCommunication Network)中普遍使用的網絡接口單元。目前我國的新式列車大多采用列車通信網傳輸列車中大量的控制和服務信息。但使用的列車通信網產品主要為國外進口,因此迫切需要研制具有自主知識產權的列車通信網產品。 論文以一類設備控制器的設計為核心,采取自頂向下的模塊設計方法。將設備控制器分為同步層和數據處理層來分別實現對幀的發送與接收處理和對幀數據的提取與存儲處理。 同步層包含幀的識別模塊、曼徹斯特譯碼模塊、曼徹斯特編碼與幀封裝三個模塊。幀識別模塊檢測幀的起始位并對幀類型進行判斷。譯碼模塊根據采集的樣本值來判斷曼徹斯特編碼的值,采樣的難點在于非理想信號帶來的采樣誤差,論文使用結合位同步的多點采樣法來提高采樣質量。幀分界符中的非數據符不需要進行曼徹斯特編碼,編碼時在非數據符位關閉編碼電路使非數據符保持原來的編碼輸出。 數據處理層以主控單元(MCU,Main Control Unit)和通信存儲器為設計核心。MCU是控制器的核心,對接收的主幀進行分析,判斷是從通信存儲器相應端口取出應答從幀并發送,還是準備接收從幀并存入通信存儲器。通信存儲器存儲設備的通信數據,合適的地址分配能簡化MCU的控制程序,論文固定了通信存儲器端口大小使MCU可以根據一個固定的公式進行端口的遍歷從而簡化了MCU程序的復雜度。數據在傳輸中由于受到干擾和沖突等問題而出現錯誤,論文采用循環冗余檢驗碼結合偶檢驗擴展來對傳輸數據進行差錯控制。 最后,使用FPGA和硬件描述語言Verilog HDL開發出了MVB一類設備。目前該一類設備已運用在SS4G電力機車的制動控制單元(BCU.Brake Control Unit)中并在鐵道科學研究院通過了TCN通信測試。一類設備的成功研制為列車通信網中總線管理器等高類設備的開發奠定了堅實的基礎。

    標簽: FPGA 多功能 總線 設備

    上傳時間: 2013-07-27

    上傳用戶:qazxsw

  • 51單片機串口通信

    了解51單片機的串口通信的原理,以及如何去編程

    標簽: 51單片機 串口通信

    上傳時間: 2013-06-01

    上傳用戶:rishian

  • 在PC上用并行口模擬I2C總線的C源代碼

    在微機上模擬I2C總線的設計,用并行口的D0(PIN2)模擬SCL信號,用D1(PIN3)模擬SDA信號。

    標簽: I2C 并行口 模擬 總線

    上傳時間: 2013-07-14

    上傳用戶:xuanchangri

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