SAd
標(biāo)簽: SAd
上傳時間: 2015-01-09
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RAR密碼破解綠色版 軟件 很好用 不過是個暴力破解!SAd!
上傳時間: 2013-12-30
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標(biāo)簽: zhidao asfds SAd fds
上傳時間: 2014-11-30
上傳用戶:梧桐
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標(biāo)簽: SAdsdSAd rithm dsdsa SAdsa
上傳時間: 2017-04-07
上傳用戶:1101055045
SAd件 4.所選類別和開發(fā)環(huán)境不對 5.亂寫說明或說明不夠認(rèn)真 6.壓縮文件有密碼 7.源碼重復(fù)或已經(jīng)存在 請不要上傳有版權(quán)爭議
標(biāo)簽: SAd 開發(fā)環(huán)境 密碼 源碼
上傳時間: 2017-05-22
上傳用戶:ikemada
H.264/AVC是由ITU和ISO兩大組織聯(lián)合組成的JVT共同制定的一項新的視頻壓縮技術(shù)標(biāo)準(zhǔn),在較低帶寬上提供高質(zhì)量的圖像傳輸是H.264/AVC的應(yīng)用亮點。在同樣的視覺質(zhì)量前提下,H.264/AVC比H.263和MPEG-4節(jié)約了50%的碼率。但H.264獲得優(yōu)越性能的代價是計算復(fù)雜度的增加,據(jù)估計其編碼的計算復(fù)雜度大約為H.263的3倍,因此很難應(yīng)用于實時視頻處理領(lǐng)域。針對這一現(xiàn)狀,業(yè)內(nèi)做了大量的研究工作,力圖降低其計算復(fù)雜度和提高運行效率。比如在運動估計方面,國內(nèi)外在這方面的研究已經(jīng)很成熟。而針對幀內(nèi)/幀間預(yù)測編碼的研究卻較少。因此研究預(yù)測模式的快速算法具有理論意義和應(yīng)用價值。 本文在詳細(xì)研究H.264標(biāo)準(zhǔn)視頻壓縮編碼特點基礎(chǔ)上,分析了H.264幀內(nèi)編碼, 幀間編碼及變換,量化技術(shù)的原理及特點,提出了一種基于局部邊緣方向信息的快速幀內(nèi)模式判決算法,通過結(jié)合SAd的模式選擇方法來減少模式選擇數(shù)目。它采用了Sobel梯度算子計算當(dāng)前塊的邊緣信息,累加當(dāng)前塊中屬于同一方向像素點的邊緣矢量構(gòu)造不同模式下的邊緣方向直方圖,以便確定最可能的預(yù)測模式。該算法有效降低了編碼器的運算復(fù)雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸?shù)馁|(zhì)量。 另外在幀間預(yù)測模式選擇算法方面進行了改進研究:按順序?qū)Σ煌愋瓦M行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數(shù)量的同時,結(jié)合小塊模式搜索中途停止準(zhǔn)則來確定最優(yōu)模式。仿真表明:改進算法相對與原來算法能夠節(jié)省很多的編碼時間(平均下降了49.3%),但帶來的圖像質(zhì)星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數(shù)DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點數(shù)據(jù)做一次變換,只需通過8×8次加法和2×8次移位運算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運算復(fù)雜度。 最后介紹FPGA的特點及設(shè)計流程,并實現(xiàn)了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實現(xiàn)的H.264編碼視頻處理模塊設(shè)計具備了成本低,周期短,設(shè)計方法靈活等優(yōu)點,具有廣闊的市場應(yīng)用前景。 仿真表明,通過使用本文提出的幀內(nèi)/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實現(xiàn)實時編碼。
上傳時間: 2013-07-18
上傳用戶:zukfu
在當(dāng)今的廣播系統(tǒng)中,絕大部分的視頻信號是隔行采樣的。采用這種掃描格式,能夠大幅度地減少視頻的帶寬,但也會引起彩色爬行、畫面閃爍、邊緣模糊及鋸齒等現(xiàn)象。這種缺陷經(jīng)人尺寸屏幕放大后就更加明顯。為改善畫面的視覺效果,去隔行技術(shù)應(yīng)運而生。同時,視頻信號本身的低幀頻也會導(dǎo)致行抖動、線爬行以及大面積閃爍等視覺效果上的缺陷。增加掃描頻率會把這些視覺缺陷搬移到人眼不敏感的高頻區(qū)域上去從而產(chǎn)生較好的主觀圖象質(zhì)量。而為了適應(yīng)不同顯示終端以及對圖像大小變化的要求就必須對原始信號分辨率即每幀行數(shù)和每行像素數(shù)進行變換。因此去隔行、幀頻轉(zhuǎn)換、分辨率變換成為視頻格式轉(zhuǎn)換的基本內(nèi)容。 FPGA 的出現(xiàn)是VLSI技術(shù)和EDA技術(shù)發(fā)展的結(jié)果。FPGA器件集成度高、體積小,具有通過用戶編程實現(xiàn)專門應(yīng)用的功能。它允許電路設(shè)計者利用基于計算機的開發(fā)平臺,經(jīng)過設(shè)計輸入、仿真、測試和校驗,直到達到預(yù)期的結(jié)果。使用FPGA器件可以大大縮短系統(tǒng)的研制周期,減少資金投入。另外采用FPGA器件可以將原來的電路板級產(chǎn)品集成芯片級產(chǎn)品,從而降低了功耗,提高了可靠性,同時還可以很方便的對設(shè)計進行在線修改。 該文在介紹了視頻格式轉(zhuǎn)換中的主要算法后,重點對去隔行、幀頻轉(zhuǎn)換、分辨率變換的FPGA綜合實現(xiàn)方案進行了由簡單到復(fù)雜的深入研究,分別給出了最簡解決方案、基于非線性算法的解決方案和基于運動補償?shù)慕鉀Q方案。最簡解決方案利用線性算法將去隔行,幀頻轉(zhuǎn)換,分辨率變換三項處理同時實現(xiàn),達到FPGA內(nèi)部資源和外部RAM耗用量都為最小的要求,是后續(xù)復(fù)雜方案的基礎(chǔ)。其中去隔行采用場合并方式,幀頻轉(zhuǎn)換采用幀重復(fù)方式,分辨率變換采用均勻插值方式。基于非線性算法的解決方案中加入了對靜止區(qū)域的判斷,靜止區(qū)域的輸出像素值直接選用相應(yīng)位置的已存輸入數(shù)據(jù),非靜止區(qū)域的輸出像素值通過對已存輸入數(shù)據(jù)進行非線性運算得出。基于運動補償?shù)慕鉀Q方案在對靜止區(qū)域進行判斷和處理的基礎(chǔ)上,對欲生成的變頻后的場間插值幀進行運動估計,根據(jù)運動矢量得出非靜止區(qū)域的輸出像素值。其中為求得輸入場間相應(yīng)時間位置上的插值幀輸出數(shù)據(jù),該方案采用了自定義的前后向塊匹配運動估計方式,通過對三步搜索算法的高效實現(xiàn),將SAd 值進行比較得出運動矢量。
標(biāo)簽: FPGA 視頻格式轉(zhuǎn)換 算法研究
上傳時間: 2013-07-19
上傳用戶:米卡
本文采用基于運動補償?shù)乃惴?對去隔行系統(tǒng)及其FPGA設(shè)計作了深入的研究.該系統(tǒng)包括三個關(guān)鍵模塊運動估計模塊是去隔行系統(tǒng)的設(shè)計重點,設(shè)計為雙向運動估計,采用菱形快速搜索算法,主要分為計算和控制兩大部分.計算部分為SAd計算模塊,采用累加樹和流水線技術(shù);控制部分根據(jù)菱形搜索算法的第三步搜索的特點,對比較模塊、SAd暫存器等模塊做了具體的設(shè)計.對于運動補償模塊采用雙向補償?shù)乃惴?補償精度為半像素.根據(jù)半像素點的位置將運動補償計算分為四個狀態(tài),并通過對四個狀態(tài)計算特點的分析設(shè)計了加法器的結(jié)構(gòu)復(fù)用.同時基于視頻數(shù)據(jù)處理的需要,設(shè)計了四個具有雙體存儲結(jié)構(gòu)的內(nèi)部緩存器,由FPGA內(nèi)部的嵌入式陣列塊實現(xiàn).根據(jù)運動估計模塊和運動補償模塊的計算特點,分別對緩存器的結(jié)構(gòu)、讀寫時序和列序號控制進行設(shè)計,有效提高了數(shù)據(jù)的存取效率.本文對于這三個去隔行系統(tǒng)的關(guān)鍵模塊都給出了RTL級設(shè)計和模塊的功能仿真,并在最后一章中給出了去隔行系統(tǒng)的FPGA設(shè)計.
上傳時間: 2013-06-11
上傳用戶:han_zh
SAd
標(biāo)簽: 函數(shù)
上傳時間: 2013-11-18
上傳用戶:china97wan
本文詳細(xì)介紹了用于IPV6安全模塊中安全策略控制數(shù)據(jù)庫SPD和安全關(guān)聯(lián)控制數(shù)據(jù)庫SAd的設(shè)計方案,包括其硬件結(jié)構(gòu)和內(nèi)部存放數(shù)據(jù)格式的設(shè)置,因為在IPSec協(xié)議中,安全策略和安全關(guān)聯(lián)是不固定的,而是根據(jù)安全保護的需要而由設(shè)計者自行決定的,而這種設(shè)計既能保證系統(tǒng)訪問的高速性,同時又具備足夠的靈活性。
標(biāo)簽: K62100 62100 IDT 75K
上傳時間: 2013-11-04
上傳用戶:xuanjie
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