基于P87 C591的CAN總線系統(tǒng)智能節(jié)點(diǎn)設(shè)計(jì)Design of CAN System Intelligent Node Based on P87C591 給出了基于帶CAN控制器的單片8位微控制器P87C591的智能節(jié)點(diǎn)的硬件電路及軟件結(jié)構(gòu)，詳細(xì)介紹了設(shè)計(jì)中的難點(diǎn)及實(shí)現(xiàn)過(guò)程中應(yīng)注意的問(wèn)題。關(guān)鍵詞:CAN總線;智能節(jié)點(diǎn) Abstract:A h ardc ircuita nds oftw arec onfigurationo fth ei ntelligentnode based on a microcontroller with CAN controller P87C591 arepresented.E speciallyt hec ruxi nd esigninga ndt hep roblemst hatshould be paid attention in realizing are discussed in details.Keyw ords:C AN;in telligentn ode CA N 總線 是德國(guó)Bosch從20世紀(jì)80年代初為解決現(xiàn)代汽車中眾多的控制與測(cè)試儀器之間的數(shù)據(jù)交換而開發(fā)的一種串行數(shù)據(jù)通信協(xié)議，它是一種多主總線，通信介質(zhì)可以是雙絞線、同軸電纜或光導(dǎo)纖維。由于CAN總線具有較強(qiáng)的糾錯(cuò)能力，支持差分收發(fā)，因而適合高噪聲環(huán)境。并具有較遠(yuǎn)的傳輸距離，適用于許多領(lǐng)域的分布式測(cè)控系統(tǒng)。目前已在工業(yè)自動(dòng)化、建筑物環(huán)境控制、醫(yī)療設(shè)備等許多領(lǐng)域得到廣泛的應(yīng)用。CAN已成為國(guó)際標(biāo)準(zhǔn)化組織IS011898標(biāo)準(zhǔn)。
標(biāo)簽： P87C591 CAN 總線系統(tǒng) 智能節(jié)點(diǎn)
上傳時(shí)間： 2013-10-30
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7.1 并行接口概述并行接口和串行接口的結(jié)構(gòu)示意圖并行接口傳輸速率高，一般不要求固定格式，但不適合長(zhǎng)距離數(shù)據(jù)傳輸7.2 可編程并行接口芯片82C55 7.2.1 8255的基本功能 8255具有2個(gè)獨(dú)立的8位I/O口（A口和B口）和2個(gè)獨(dú)立的4位I/O（C口上半部和C口下半部），提供TTL兼容的并行接口。作為輸入時(shí)提供三態(tài)緩沖器功能，作為輸出時(shí)提供數(shù)據(jù)鎖存功能。其中，A口具有雙向傳輸功能。8255有3種工作方式，方式0、方式1和方式2，能使用無(wú)條件、查詢和中斷等多種數(shù)據(jù)傳送方式完成CPU與I/O設(shè)備之間的數(shù)據(jù)交換。B口和C口的引腳具有達(dá)林頓復(fù)合晶體管驅(qū)動(dòng)能力，在1.5V時(shí)輸出1mA電流，適于作輸出端口。C口除用做數(shù)據(jù)口外，當(dāng)8255工作在方式1和方式2時(shí)，C口的部分引腳作為固定的聯(lián)絡(luò)信號(hào)線。
標(biāo)簽： 并行接口
上傳時(shí)間： 2013-10-25
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并行接口電路：微處理器與I/O設(shè)備進(jìn)行數(shù)據(jù)傳輸時(shí)均需經(jīng)過(guò)接口電路實(shí)現(xiàn)系統(tǒng)與設(shè)備互連的匹配。并行接口電路中每個(gè)信息位有自己的傳輸線，一個(gè)數(shù)據(jù)字節(jié)各位可并行傳送，速度快，控制簡(jiǎn)單。由于電氣特性的限制，傳輸距離不能太長(zhǎng)。8255A是通用的可編程并行接口芯片，功能強(qiáng)，使用靈活。適合一些并行輸入/輸出設(shè)備的使用。8255A并行接口邏輯框圖三個(gè)獨(dú)立的8位I/O端口,口A、口B、口C。口A有輸入、輸出鎖存器及輸出緩沖器。口B與口C有輸入、輸出緩沖器及輸出鎖存器。在實(shí)現(xiàn)高級(jí)的傳輸協(xié)議時(shí)，口C的8條線分為兩組，每組4條線，分別作為口A與口B在傳輸時(shí)的控制信號(hào)線。口C的8條線可獨(dú)立進(jìn)行置1/置0的操作。口A、口B、口C及控制字口共占4個(gè)設(shè)備號(hào)。8255A并行接口的控制字工作模式選擇控制字：口A有三種工作模式，口B有二種工作模式。口C獨(dú)立使用時(shí)只有一個(gè)工作模式，與口A、口B配合使用時(shí)，作為控制信號(hào)線。三種工作模式命名為：模式0、模式1及模式2。模式 0 為基本I/O端口，模式1為帶選通的I/O端口，模式 2 為帶選通的雙向I/O端口。口A可工作在三種模式下，口B可工作在模式 0與模式 1下，口C可工作在模式0下或作為控制線配合口A、口B工作。
上傳時(shí)間： 2013-11-07
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微機(jī)接口技術(shù)試題：《微機(jī)接口技術(shù)》模擬試題 一、 選擇題：（每空1分，共20分）1． CPU與外設(shè)之間交換數(shù)據(jù)常采用 、 、 和 四種方式，PC機(jī)鍵盤接口采用 傳送方式。 ⒉ 當(dāng)進(jìn)行DMA方式下的寫操作時(shí)，數(shù)據(jù)是從 傳送到 __中。 ⒊ PC總線、ISA總線和EISA總線的地址線分別為： 、 和 根。 ⒋ 8254定時(shí)/計(jì)數(shù)器內(nèi)部有 個(gè)端口、共有 種工作方式。 ⒌8255的A1和A0引腳分別連接在地址總線的A1和A0，當(dāng)命令端口的口地址為317H時(shí)，則A口、B口、C口的口地址分別為 、 、 。 ⒍ PC微機(jī)中最大的中斷號(hào)是 、最小的中斷號(hào)是 。 ⒎PC微機(jī)中鍵盤是從8255的 口得到按鍵數(shù)據(jù)。 ⒏ 串行通信中傳輸線上即傳輸_________，又傳輸_________。 二、選擇題：（每題2分，共10分）⒈ 設(shè)串行異步通信每幀數(shù)據(jù)格式有8個(gè)數(shù)據(jù)位、無(wú)校驗(yàn)、一個(gè)停止位，若波特率為9600B/S，該方式每秒最多能傳送（ ）個(gè)字符。 ① 1200 ② 150 ③ 960 ④ 120 2．輸出指令在I/O接口總線上產(chǎn)生正確的命令順序是（ ）。① 先發(fā)地址碼，再發(fā)讀命令，最后讀數(shù)據(jù)。② 先發(fā)讀命令、再發(fā)地址碼，最后讀數(shù)據(jù)。③ 先送地址碼，再送數(shù)據(jù)，最后發(fā)寫命令。④ 先送地址碼，再發(fā)寫命令、最后送數(shù)據(jù)。3 使用8254設(shè)計(jì)定時(shí)器，當(dāng)輸入頻率為1MHZ并輸出頻率為100HZ時(shí)，該定時(shí)器的計(jì)數(shù)初值為（ ）。 ① 100 ② 1000 ③ 10000 ④ 其它 4 在PC機(jī)中5號(hào)中斷，它的中斷向地址是（ ）。 ① 0000H：0005H ② 0000H：0010H ③ 0000H：0014H ④ 0000H：0020H 5． 四片8259級(jí)聯(lián)時(shí)可提供的中斷請(qǐng)求總數(shù)為（ ）。 ① 29個(gè) ② 30個(gè) ③ 31個(gè) ④ 32個(gè) 6． 下述總線中，組內(nèi)都是外設(shè)串行總線為（ ）組。① RS-485、IDE、ISA。② RS-485、IEEE1394、USB。③ RS-485、PCI、IEEE1394。④ USB、SCSI、RS-232。 7. DMA在（ ）接管總線的控制權(quán)。① 申請(qǐng)階段 ② 響應(yīng)階段 ③ 數(shù)據(jù)傳送階段 ④ 結(jié)束階段 8. 中斷服務(wù)程序入口地址是（ ）。 ① 中斷向量表的指針 ② 中斷向量 ③ 中斷向量表 ④ 中斷號(hào)
上傳時(shí)間： 2013-11-16
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隨著 微 電 子技術(shù)的飛速發(fā)展，電子產(chǎn)品越來(lái)越微型化，集成化，自動(dòng)化，低廉化，進(jìn)而推動(dòng)著其它許多產(chǎn)業(yè)的發(fā)展。特別進(jìn)人21世紀(jì)以來(lái)，生物技術(shù)與電子技術(shù)的結(jié)合，成為高科技領(lǐng)域的研究熱點(diǎn)。199()年由瑞士的Manz和Widmer首先提出的“微全分析系統(tǒng)”〔’〕(microto talan alysissy stems，即ptTAS)，通俗地稱為“建在芯片上的實(shí)驗(yàn)室”(Lab on a chip)或簡(jiǎn)稱芯片實(shí)驗(yàn)室(Lab chip)，主要組成部分為電泳芯片，同時(shí)是進(jìn)樣，分離和檢測(cè)為一體的微型裝置，其在電泳實(shí)驗(yàn)中的高效檢測(cè)性能為生物化學(xué)分析儀器發(fā)展提供了一種借鑒。p.TAS廣泛應(yīng)用于生物醫(yī)學(xué)、環(huán)境檢測(cè)、食品衛(wèi)生、科學(xué)以及國(guó)防等眾多領(lǐng)域。目前 應(yīng) 用 的大多為多通道的毛細(xì)管電泳芯片，這也是芯片發(fā)展的一個(gè)必然趨勢(shì)。這不僅對(duì)電泳芯片本身的設(shè)計(jì)和制作提出了更高的要求，也對(duì)傳感器和數(shù)據(jù)處理技術(shù)提出了新的挑戰(zhàn)。考慮成本，集成度，控制能力以及可靠性方面的因素，本系統(tǒng)采用單片機(jī)作為實(shí)時(shí)數(shù)據(jù)處理、控制以及通訊的硬件平臺(tái)。如果系統(tǒng)中既有實(shí)時(shí)的通信任務(wù)，同時(shí)又有其他實(shí)時(shí)任務(wù)，采用一個(gè)廉價(jià)的單片機(jī)，資源會(huì)比較緊張，不僅實(shí)現(xiàn)困難，結(jié)構(gòu)復(fù)雜，而且效果可能不滿意。而采用高性能的處理器，又浪費(fèi)了其有效資源，所以本系統(tǒng)采用兩個(gè)MCU協(xié)同工作，以并行/分布式多機(jī)的思想，構(gòu)成了電泳芯 片核心的雙單片機(jī)系統(tǒng)結(jié)構(gòu)。微全 分 析 系 統(tǒng) 進(jìn)行的多項(xiàng)實(shí)時(shí)任務(wù)，可以劃分為以下 幾個(gè)模塊:①采集模塊。負(fù)責(zé)對(duì)外圍檢驗(yàn)設(shè)備進(jìn)行控 制以及對(duì)傳送過(guò)來(lái)的信號(hào)進(jìn)行采集和分析;②交互模 塊。通過(guò)液晶顯示，鍵盤掃描，以及打印等實(shí)現(xiàn)實(shí)驗(yàn)人 員對(duì)前端采集電路的交互操作;③雙單片機(jī)控制和通 信模塊。協(xié)調(diào)雙單片機(jī)之間的數(shù)據(jù)傳輸和指令傳輸 ;④網(wǎng)絡(luò)傳輸模塊。其中一個(gè)單片機(jī)通過(guò)以太網(wǎng)發(fā)送接 收數(shù)據(jù)到上位機(jī)。本文提出一種實(shí)時(shí)多任務(wù)的雙單片 機(jī)控制和通信系統(tǒng)[31的設(shè)計(jì)，一個(gè)MCU基于TCP /IP網(wǎng)絡(luò)模塊的實(shí)現(xiàn)。
標(biāo)簽： TCPIP 雙單片機(jī) 數(shù)據(jù)采集系統(tǒng) 網(wǎng)絡(luò)模塊
上傳時(shí)間： 2013-11-15
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一種基于ST62單片機(jī)的稱重顯示控制器A Weighing Display Controller Based on ST62 Single Chip Computer祛 FA(上海時(shí)博飛奧控制系統(tǒng)有限公司，上海201100)摘要在介紹了基于ST62單片機(jī)的基礎(chǔ)上，詳細(xì)描述了稱重顯控制器的硬件設(shè)計(jì)和軟件設(shè)計(jì)思路。該控制器結(jié)構(gòu)簡(jiǎn)單、操作方便、抗擾能力強(qiáng)等優(yōu)點(diǎn);具有較好的推廣應(yīng)用價(jià)值。關(guān)鍵詞稱重顯示控制儀ST62單片機(jī)硬件設(shè)計(jì)軟件設(shè)計(jì)Abstract Ont heb asiso fin torductiono fST 62s inglec hipc omputer,th ed esignc oncrptof h ardwarea nds oftwarefo rw eighingd isplayc ontorleris d escrbed.The controler features simple structure, ease operation, powerful capability of anti-interference, etc.，it is wealth to be promoted into practicalapplicationsKeywords We妙噸display0 引言ST62s inglec hip Hardwared esign Softwaer design備 份 振 蕩器，振蕩器保護(hù)電路，上電復(fù)位及低壓檢測(cè)復(fù)稱 重 顯 示控制器是一種具有數(shù)字顯示、開關(guān)量輸出、定值控制和通信功能的以微機(jī)為操作核心的稱重控制裝置。它是電子衡器的重要基礎(chǔ)部件，直接影響電子衡器及電子稱重系統(tǒng)的功能和性能。與合適的傳感器及承重傳力復(fù)位系統(tǒng)組合可組成配料秤、料斗秤、定值秤、平臺(tái)秤、汽車秤等，廣泛應(yīng)用于電力、化工、建筑、冶金、交通運(yùn)輸、食品、軍工等部門，是進(jìn)行自動(dòng)稱重配料控制和生產(chǎn)過(guò)程自動(dòng)化必不可少的重要檢測(cè)、控制裝置。隨著 稱 重 計(jì)量自動(dòng)化水平的提高，對(duì)稱重顯示控制器的要求也越來(lái)越高。為實(shí)現(xiàn)低漂移、高穩(wěn)定，本控制器采用低漂移、高增益放大器AD620和高分辨率的A/D轉(zhuǎn)換器CS5550。為提高穩(wěn)定性和可靠性，采用集成度高的、抗干擾能力強(qiáng)的ST62單片機(jī)。
上傳時(shí)間： 2013-10-29
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Designing withProgrammable Logicin an Analog WorldProgrammable logic devices revolutionizeddigital design over 25 years ago,promising designers a blank chip todesign literally any function and programit in the field. PLDs can be low-logicdensity devices that use nonvolatilesea-of-gates cells called complexprogrammable logic devices (CPLDs)or they can be high-density devicesbased on SRAM look-up tables (LUTs)
標(biāo)簽： Solutions Analog Altera FPGAs
上傳時(shí)間： 2013-11-08
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This application note describes how to build a system that can be used for determining theoptimal phase shift for a Double Data Rate (DDR) memory feedback clock. In this system, theDDR memory is controlled by a controller that attaches to either the OPB or PLB and is used inan embedded microprocessor application. This reference system also uses a DCM that isconfigured so that the phase of its output clock can be changed while the system is running anda GPIO core that controls that phase shift. The GPIO output is controlled by a softwareapplication that can be run on a PowerPC® 405 or Microblaze™ microprocessor.
上傳時(shí)間： 2013-10-15
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為了在CDMA系統(tǒng)中更好地應(yīng)用QDPSK數(shù)字調(diào)制方式，在分析四相相對(duì)移相（QDPSK)信號(hào)調(diào)制解調(diào)原理的基礎(chǔ)上，設(shè)計(jì)了一種QDPSK調(diào)制解調(diào)電路，它包括串并轉(zhuǎn)換、差分編碼、四相載波產(chǎn)生和選相、相干解調(diào)、差分譯碼和并串轉(zhuǎn)換電路。在MAX+PLUSⅡ軟件平臺(tái)上，進(jìn)行了編譯和波形仿真。綜合后下載到復(fù)雜可編程邏輯器件EPM7128SLC84-15中，測(cè)試結(jié)果表明，調(diào)制電路能正確選相，解調(diào)電路輸出數(shù)據(jù)與QDPSK調(diào)制輸入數(shù)據(jù)完全一致，達(dá)到了預(yù)期的設(shè)計(jì)要求。 Abstract: In order to realize the better application of digital modulation mode QDPSK in the CDMA system， a sort of QDPSK modulation-demodulation circuit was designed based on the analysis of QDPSK signal modulation-demodulation principles. It included serial/parallel conversion circuit, differential encoding circuit, four-phase carrier wave produced and phase chosen circuit, coherent demodulation circuit, difference decoding circuit and parallel/serial conversion circuit. And it was compiled and simulated on the MAX+PLUSⅡ software platform,and downloaded into the CPLD of EPM7128SLC84-15.The test result shows that the modulation circuit can exactly choose the phase，and the output data of the demodulator circuit is the same as the input data of the QDPSK modulate. The circuit achieves the prospective requirement of the design.
標(biāo)簽： QDPSK CPLD 調(diào)制解調(diào) 電路設(shè)計(jì)
上傳時(shí)間： 2014-01-13
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波長(zhǎng)信號(hào)的解調(diào)是實(shí)現(xiàn)光纖光柵傳感網(wǎng)絡(luò)的關(guān)鍵，基于現(xiàn)有的光纖光柵傳感器解調(diào)方法，提出一種基于FPGA的雙匹配光纖光柵解調(diào)方法，此系統(tǒng)是一種高速率、高精度、低成本的解調(diào)系統(tǒng)，并且通過(guò)引入雙匹配光柵有效地克服了雙值問(wèn)題同時(shí)擴(kuò)大了檢測(cè)范圍。分析了光纖光柵的測(cè)溫原理并給出了該方案軟硬件設(shè)計(jì)，綜合考慮系統(tǒng)的解調(diào)精度和FPGA的處理速度給出了基于拉格朗日的曲線擬合算法。 Abstract: Sensor is one of the most important application of the fiber grating. Wavelength signal demodulating is the key techniques to carry out fiber grating sensing network， based on several existing methods of fiber grating sensor demodulation inadequate， a two-match fiber grating demodulation method was presented. This system is a high-speed， high precision， low-cost demodulation system. And by introducing a two-match grating effectively overcomes the problem of double value while expands the scope of testing. This paper analyzes the principle of fiber Bragg grating temperature and gives the software and hardware design of the program. Considering the system of demodulation accuracy and processing speed of FPGA，this paper gives the curve fitting algorithm based on Lagrange.
標(biāo)簽： FPGA 光纖光柵 解調(diào)系統(tǒng)
上傳時(shí)間： 2014-07-24
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