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TI標(biāo)(biāo)準(zhǔn)(zhǔn)

  • TI公司推出的CCS3.3開發(fā)環(huán)境中文入門指導(dǎo)書

    TI公司推出的CCS3.3開發(fā)環(huán)境中文入門指導(dǎo)書

    標(biāo)簽: CCS 3.3 TI公司 開發(fā)環(huán)境

    上傳時(shí)間: 2013-10-20

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  • 用TI dsp做變頻器的資料

    用TI dsp做變頻器的資料

    標(biāo)簽: dsp 變頻器

    上傳時(shí)間: 2013-11-14

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  • 數(shù)字陷波器的設(shè)計(jì)

    陷波器是無(wú)限沖擊響應(yīng)(IIR)數(shù)字濾波器,該濾波器可以用以下常系數(shù)線性差分方程表示:ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中: x(n)和y(n)分別為輸人和輸出信號(hào)序列;和為濾波器系數(shù)。 iaib對(duì)式(1)兩邊進(jìn)行z變換,得到數(shù)字濾波器的傳遞函數(shù)為: ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中:和分別為傳遞函數(shù)的零點(diǎn)和極點(diǎn)。 izip由傳遞函數(shù)的零點(diǎn)和極點(diǎn)可以大致繪出頻率響應(yīng)圖。在零點(diǎn)處,頻率響應(yīng)出現(xiàn)極小值;在極點(diǎn)處,頻率響應(yīng)出現(xiàn)極大值。因此可以根據(jù)所需頻率響應(yīng)配置零點(diǎn)和極點(diǎn),然后反向設(shè)計(jì)帶陷數(shù)字濾波器。考慮一種特殊情況,若零點(diǎn)在第1象限單位圓上,極點(diǎn)在單位圓內(nèi)靠近零點(diǎn)的徑向上。為了防止濾波器系數(shù)出現(xiàn)復(fù)數(shù),必須在z平面第4象限對(duì)稱位置配置相應(yīng)的共軛零點(diǎn)、共軛極點(diǎn)。 izip∗iz∗ip這樣零點(diǎn)、極點(diǎn)配置的濾波器稱為單一頻率陷波器,在頻率ωo處出現(xiàn)凹陷。而把極點(diǎn)設(shè)置在零的的徑向上距圓點(diǎn)的距離為l-μ處,陷波器的傳遞函數(shù)為: ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小,極點(diǎn)越靠近單位圓,則頻率響應(yīng)曲線凹陷越深,凹陷的寬度也越窄。當(dāng)需要消除窄帶干擾而不能對(duì)其他頻率有衰減時(shí),陷波器是一種去除窄帶干擾的理想數(shù)字濾波器。當(dāng)要對(duì)幾個(gè)頻率同時(shí)進(jìn)行帶陷濾波時(shí),可以按(2)式把幾個(gè)單獨(dú)頻率的帶陷濾波器(3)式串接在一起。一個(gè)例子:設(shè)有一個(gè)輸入,它

    標(biāo)簽: 數(shù)字 陷波器

    上傳時(shí)間: 2013-10-18

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  • XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接

    XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標(biāo)簽: XAPP FPGA Bank 520

    上傳時(shí)間: 2013-11-19

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  • 采用高速串行收發(fā)器Rocket I/O實(shí)現(xiàn)數(shù)據(jù)率為2.5 G

    摘要: 串行傳輸技術(shù)具有更高的傳輸速率和更低的設(shè)計(jì)成本, 已成為業(yè)界首選, 被廣泛應(yīng)用于高速通信領(lǐng)域。提出了一種新的高速串行傳輸接口的設(shè)計(jì)方案, 改進(jìn)了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關(guān)鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議 為促使FPGA 芯片與串行傳輸技術(shù)更好地結(jié)合以滿足市場(chǎng)需求, Xilinx 公司適時(shí)推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級(jí)的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時(shí)鐘生成及恢復(fù)等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標(biāo)準(zhǔn)的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點(diǎn)到點(diǎn)串行數(shù)據(jù)傳輸, 同時(shí)其可擴(kuò)展的帶寬, 為系統(tǒng)設(shè)計(jì)人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會(huì)導(dǎo)致系統(tǒng)資源的浪費(fèi)。本文提出的設(shè)計(jì)方案可以改進(jìn)Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實(shí)現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應(yīng)用前景。

    標(biāo)簽: Rocket 2.5 高速串行 收發(fā)器

    上傳時(shí)間: 2013-11-06

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  • TI天線設(shè)計(jì)參考

    TI的天線設(shè)計(jì)參考,各個(gè)頻率段的都有。

    標(biāo)簽: 天線設(shè)計(jì)

    上傳時(shí)間: 2013-11-17

    上傳用戶:wuchunwu

  • 基于TI公司Cortex-M3的uart超級(jí)通信開發(fā)

    嵌入式 基于TI公司Cortex-M3的uart超級(jí)通信開發(fā) 實(shí)現(xiàn)兩個(gè)數(shù)相加求和

    標(biāo)簽: Cortex-M uart TI公司 超級(jí)

    上傳時(shí)間: 2013-11-18

    上傳用戶:shuizhibai

  • 基于TI+TMS320+DSP的軟件動(dòng)態(tài)鏈接技術(shù)

      介紹了軟件動(dòng)態(tài)鏈接技術(shù)的概念和特點(diǎn),提出了基于TI TMS320系列DSP的軟件動(dòng)態(tài)鏈接技術(shù)。該技術(shù)解決了可重配置的DSP系統(tǒng)中關(guān)于軟件二進(jìn)制目標(biāo)代碼的動(dòng)態(tài)加載和卸載的問(wèn)題。采用該技術(shù)的軟件重配置方案已成功運(yùn)用于某多功能通信系統(tǒng),為基于其他系列DSP的可重構(gòu)數(shù)字處理系統(tǒng)提供了一定的參考,在無(wú)人值守設(shè)備、多功能信號(hào)處理設(shè)備方面具有一定的應(yīng)用價(jià)值。

    標(biāo)簽: 320 DSP TMS TI

    上傳時(shí)間: 2013-10-14

    上傳用戶:lanwei

  • 2013年TI的最新的藍(lán)牙4.0芯片

    TI的藍(lán)牙4.0芯片

    標(biāo)簽: 2013 4.0 藍(lán)牙 芯片

    上傳時(shí)間: 2013-10-14

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  • 應(yīng)用于MIMO系統(tǒng)的天線選擇新算法

      提出一種在接收端結(jié)合最大比合并的發(fā)送天線選擇新算法。該算法中,發(fā)送端從N個(gè)可用天線中選擇信道增益最佳的L個(gè)天線,而接收端不進(jìn)行天線選擇并進(jìn)行最大比合并(MRC)。并對(duì)該算法在準(zhǔn)靜態(tài)瑞利衰落信道的成對(duì)差錯(cuò)(PEP)性能進(jìn)行了深入地分析。理論分析和仿真試驗(yàn)證明。盡管發(fā)送端天線選擇對(duì)MIMO系統(tǒng)的分級(jí)階數(shù)會(huì)造成一定程度的損傷,但同不進(jìn)行天線選擇O‘M)相比,應(yīng)用該算法仍能獲得較大的分級(jí)增益,并能明顯提高相同頻譜效率和相同分集階效條件下空時(shí)碼的性能。

    標(biāo)簽: MIMO 應(yīng)用于 天線

    上傳時(shí)間: 2013-10-11

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