amcc PPC405EP taihu 開發(fā)板 CPLD 源碼
標(biāo)簽： taihu amcc CPLD PPC
上傳時(shí)間： 2013-08-13
上傳用戶：invtnewer
通過 VLYNQ 把 Xilinx FPGA 作為 TI DSP 的外設(shè).rar
標(biāo)簽： Xilinx VLYNQ FPGA DSP
上傳用戶：lz4v4
TI 原裝開發(fā)板 DM6467 原理圖 CPLD 給需要的人
標(biāo)簽： 6467 DM 開發(fā)板 原理圖
上傳時(shí)間： 2013-08-14
上傳用戶：qingzhuhu
CPLD與8051的總線接口VHDL源碼
標(biāo)簽： CPLD 8051 VHDL 總線接口
上傳時(shí)間： 2013-08-15
上傳用戶：yuchunhai1990
ACTEL的FPGA完整開發(fā)文擋 含測試源碼
標(biāo)簽： ACTEL FPGA 測試 源碼
上傳時(shí)間： 2013-08-16
上傳用戶：kristycreasy
TMS3205402Verilog HDL源碼
標(biāo)簽： 3205402 Verilog TMS HDL
上傳時(shí)間： 2013-08-17
上傳用戶：shizhanincc
基于FPGA的交通燈的設(shè)計(jì) 有Verilog HDL 源碼、仿真圖與引腳配置圖，已下載實(shí)現(xiàn)\r\n
標(biāo)簽： Verilog FPGA HDL 交通燈
上傳時(shí)間： 2013-08-18
上傳用戶：BOBOniu
實(shí)現(xiàn)基于CPLD的CCD采集系統(tǒng)設(shè)計(jì)源碼
標(biāo)簽： CPLD CCD 采集 系統(tǒng)設(shè)計(jì)
上傳用戶：pkzz021
基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog FPGA HDL 多功能
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s3c2410開發(fā)板cpld源碼，希望有些參考價(jià)值
標(biāo)簽： s3c2410 cpld 開發(fā)板 源碼
上傳時(shí)間： 2013-08-20
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