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VDHL

  • 利用EDA工具MAX-PlusII的VDHL輸入法

    利用EDA工具MAX-PlusII的VDHL輸入法,輸入VHDL程序,實現2位計數器,在七段譯碼器上以十進制顯示:0、1、2、3、0、...。時鐘信號使用83管腳。采用自動機狀態轉換方式設計該計數器;建立相應仿真波形文件,并進行波形仿真;分析設計電路的正確性。

    標簽: MAX-PlusII VDHL EDA 輸入法

    上傳時間: 2014-01-25

    上傳用戶:ZJX5201314

  • VDHL寫的25階對稱FIR濾波器.

    VDHL寫的25階對稱FIR濾波器.適合新手學習參考

    標簽: VDHL fir濾波器

    上傳時間: 2022-04-24

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  • 用fpga實現的DA轉換器

    用fpga實現的DA轉換器,有說明和源碼,VDHL文件。\\r\\nA PLD Based Delta-Sigma DAC\\r\\nDelta-Sigma modulation is the simple, yet powerful,\\r\\ntechnique responsible for the extraordinary\\r\\nperformance and low cost of today s audio CD\\r\\nplayers. The simplest Delta-Sigm

    標簽: fpga DA轉換器

    上傳時間: 2013-08-22

    上傳用戶:dudu1210004

  • 用fpga實現的DA轉換器

    用fpga實現的DA轉換器,有說明和源碼,VDHL文件。 A PLD Based Delta-Sigma DAC Delta-Sigma modulation is the simple, yet powerful, technique responsible for the extraordinary performance and low cost of today s audio CD players. The simplest Delta-Sigma DAC consists of a Delta-Sigma modulator and a one bit DAC. Since, both of these components can be realized using digital circuits, it is possible to implement a low precision Delta-Sigma DAC using a PLD.

    標簽: fpga DA轉換器

    上傳時間: 2016-06-10

    上傳用戶:bjgaofei

  • 輸入輸入輸出的程序

    輸入輸入輸出的程序,是VDHL的,輸入輸出的程序,是VDHL的,輸入輸出的程序,是VDHL的,

    標簽: 輸入 程序 輸入輸出

    上傳時間: 2017-08-12

    上傳用戶:haohaoxuexi

  • 小波變換的VDHL

    小波變換的vhdl代碼實現,主要用于圖像去噪這塊,歡迎下載

    標簽: VDHL 小波變換

    上傳時間: 2017-04-15

    上傳用戶:恩佐cs

  • VDHL數字時鐘報告

    數字時鐘主要由:分頻器、掃描顯示譯碼器、六十進制計數器(或十進制計數器與六進制計數器)、十二進制計數器(或二十四進制計數器)電路組成。在整個秒表中最關鍵的是如何獲得一個精確的1Hz計時脈沖,除此之外,整個數字時鐘還需要有啟動信號和置數信號,以便使數字時鐘能隨意停止和啟動

    標簽: VDHL 數字時鐘 報告

    上傳時間: 2017-08-22

    上傳用戶:15873863579

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