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VHDL 計(jì)(jì)算器

本人自已寫的一個(gè)24點(diǎn)的計(jì)算器希望大家多多的幫我改正。有什麼更好的算法

本人自已寫的一個(gè)24點(diǎn)的計(jì)算器希望大家多多的幫我改正。有什麼更好的算法，還請(qǐng)指點(diǎn)!

標(biāo)簽： 家正算法

上傳時(shí)間： 2014-01-25

上傳用戶：z754970244
基于VHDL語(yǔ)言智力搶答器的設(shè)計(jì) 本人的課程設(shè)計(jì)

基于VHDL語(yǔ)言智力搶答器的設(shè)計(jì) 本人的課程設(shè)計(jì)

標(biāo)簽： VHDL 語(yǔ)言搶答器

上傳時(shí)間： 2013-08-27

上傳用戶：CHINA526
vhdl基于半加器的全加器描述及仿真

vhdl基于半加器的全加器描述及仿真

標(biāo)簽： vhdl 半加器全加器仿真

上傳時(shí)間： 2014-11-25

上傳用戶：zycidjl
用VHDL編的編碼器,具有多種功能,希望呢溫暖感跟大家共享~!

用VHDL編的編碼器,具有多種功能,希望呢溫暖感跟大家共享~!

標(biāo)簽： VHDL 編碼器家

上傳時(shí)間： 2015-10-22

上傳用戶：大三三
詳細(xì)描術(shù)日用汁算器健盤輸入自動(dòng)左移原理及錯(cuò)誤輸入時(shí)朻正(帶符號(hào)輸入)

詳細(xì)描術(shù)日用汁算器健盤輸入自動(dòng)左移原理及錯(cuò)誤輸入時(shí)朻正(帶符號(hào)輸入)

標(biāo)簽： 輸入自動(dòng) 正符號(hào)

上傳時(shí)間： 2015-12-28

上傳用戶：CSUSheep
基于VHDL語(yǔ)言智力搶答器的設(shè)計(jì) 本人的課程設(shè)計(jì)

基于VHDL語(yǔ)言智力搶答器的設(shè)計(jì) 本人的課程設(shè)計(jì)

標(biāo)簽： VHDL 語(yǔ)言搶答器

上傳時(shí)間： 2014-01-24

上傳用戶：1109003457
基于VHDL的分頻器設(shè)計(jì)

基于VHDL的分頻器設(shè)計(jì)，這是源碼希望對(duì)大家有用。

標(biāo)簽： VHDL 分頻器

上傳時(shí)間： 2014-01-25

上傳用戶：watch100
基于VHDL的LS138譯碼器的實(shí)現(xiàn) 一個(gè)很簡(jiǎn)單的程序

基于VHDL的LS138譯碼器的實(shí)現(xiàn) 一個(gè)很簡(jiǎn)單的程序

標(biāo)簽： VHDL 138 LS 譯碼器

上傳時(shí)間： 2016-07-25

上傳用戶：anng
這是一個(gè)利用MAX PULL 制作的VHDL的全加器的程序如果有需要仿真圖的請(qǐng)叫站長(zhǎng)聯(lián)系我

這是一個(gè)利用MAX PULL 制作的VHDL的全加器的程序如果有需要仿真圖的請(qǐng)叫站長(zhǎng)聯(lián)系我

標(biāo)簽： PULL VHDL MAX 全加器

上傳時(shí)間： 2016-07-30

上傳用戶：asdkin
VHDL router16通路選擇器基于實(shí)際模型的設(shè)計(jì)

VHDL router16通路選擇器基于實(shí)際模型的設(shè)計(jì)

標(biāo)簽： router VHDL 16 通路

上傳時(shí)間： 2014-01-24

上傳用戶：stampede