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VIRTEXII

  • XUPV2P User Guide VIRTEXII Pro

    XUPV2P User Guide VIRTEXII Pro

    標(biāo)簽: VIRTEXII XUPV2P Guide User

    上傳時間: 2014-08-28

    上傳用戶:huangld

  • Xilinx可編程邏輯器件的高級應(yīng)用與設(shè)計(jì)技巧 全面介紹Xilinx的CoolRunnerII Spartan-3 Virtex-II VIRTEXII pro等器件的結(jié)構(gòu)特性

    Xilinx可編程邏輯器件的高級應(yīng)用與設(shè)計(jì)技巧 全面介紹Xilinx的CoolRunnerII Spartan-3 Virtex-II VIRTEXII pro等器件的結(jié)構(gòu)特性,以及ISE6及其輔助設(shè)計(jì)工具。

    標(biāo)簽: Xilinx CoolRunnerII Virtex-II VIRTEXII

    上傳時間: 2017-02-18

    上傳用戶:sz_hjbf

  • 智能人臉識別算法及其FPGA的實(shí)現(xiàn).rar

    人臉自動識別技術(shù)是模式識別、圖像處理等學(xué)科的一個最熱門研究課題之一。隨著社會的發(fā)展,各方面對快速有效的自動身份驗(yàn)證的要求日益迫切,而人臉識別技術(shù)作為各種生物識別技術(shù)中最重要的方法之一,已經(jīng)越來越多的受到重視。對于具有實(shí)時,快捷,低誤識率的高性能算法以及對算法硬件加速的研究也逐漸展開。 本文詳細(xì)分析了智能人臉識別算法原理,發(fā)展概況和前景,包括人臉檢測算法,人眼定位算法,預(yù)處理算法,PCA和ICA 算法,詳細(xì)分析了項(xiàng)目情況,系統(tǒng)劃分,軟硬件平臺的資源和使用。并在ISE軟件平臺上,用硬件描述語言(verilog HDL)對算法部分嚴(yán)格按照FPGA代碼風(fēng)格進(jìn)行了RTL 硬件建模,并對C++算法進(jìn)行了優(yōu)化處理,通過仿真與軟件算法結(jié)果進(jìn)行比對,評估誤差,最后在VIRTEXII Pro FPGA 上進(jìn)行了綜合實(shí)現(xiàn)。 主要研究內(nèi)容如下: 首先,對硬件平臺xilinx的VIRTEXII Pro FPGA 上的系統(tǒng)資源進(jìn)行了描述和研究,對存儲器sdram,RS-232 串口,JTAG 進(jìn)行了研究和調(diào)試,對Coreconnect的OPB總線仲裁機(jī)理進(jìn)行了兩種算法的比較,RTL 設(shè)計(jì),仿真和綜合。利用ISE和VC++軟件平臺,對verilog和C++算法進(jìn)行同步比較測試,使每步算法對應(yīng)正確的結(jié)果。對軟硬件平臺的合理使用使得在項(xiàng)目中能盡可能多的充分利用硬件資源,制板時正確選型,以及加快設(shè)計(jì)和調(diào)試進(jìn)度。其次,對人臉識別算法流程中的人臉檢測,人眼定位,預(yù)處理,識別算法分別進(jìn)行了比較研究,選取其中各自性能最好的一種算法對其原理進(jìn)行了分析討論。人臉檢測采用adaboost 算法,因其速度和精度的綜合性能表現(xiàn)優(yōu)異。人眼定位采用小塊合并算法,因?yàn)樗哂锌焖伲瑴?zhǔn)確,弱時實(shí)的特點(diǎn)。預(yù)處理算法采用直方圖均衡加平滑的算法,簡單,高效。 識別算法采用PCA 加ICA 算法,它能最大的弱化姿態(tài)和光照對人臉識別的影響。 最后,使用Verilog HDL 硬件描述語言進(jìn)行算法的RTL 建模,在C++算法的基礎(chǔ)上,保證原來效果的前提下,根據(jù)FPGA 硬件特點(diǎn)對算法進(jìn)行了優(yōu)化。視頻輸入輸出是人臉識別的前提,它提供FPGA 上算法需要處理的數(shù)據(jù),預(yù)處理算法在C++算法的基礎(chǔ)上進(jìn)行了優(yōu)化,最大的減少了運(yùn)算量,提高了運(yùn)算速度,16 位計(jì)算器模塊使得在算法實(shí)現(xiàn)時可以根據(jù)系統(tǒng)要求,在FPGA的ip 核和自己設(shè)計(jì)的模塊之間選擇性能更好的一個來調(diào)用,F(xiàn)IFO的設(shè)計(jì)提供同步和異步時鐘域的數(shù)據(jù)緩存。設(shè)計(jì)在ISE和VC++軟件平臺同時進(jìn)行,隨時對verilog和C++數(shù)據(jù)進(jìn)行監(jiān)測和比對。全部設(shè)計(jì)模塊通過仿真,達(dá)到預(yù)定的性能要求,并在FPGA 上綜合實(shí)現(xiàn)。

    標(biāo)簽: FPGA 人臉識別 算法

    上傳時間: 2013-07-13

    上傳用戶:李夢晗

  • 加密卡的研制與加密算法的FPGA實(shí)現(xiàn)

    隨著安全通信數(shù)據(jù)速率的提高,關(guān)鍵數(shù)據(jù)加密算法的軟件實(shí)施成為重要的系統(tǒng)瓶頸.基于FPGA的高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力,并且可以達(dá)到所要求的加密處理性能(每秒的SSL或RSA運(yùn)算次數(shù))基準(zhǔn).網(wǎng)絡(luò)的迅速發(fā)展,對安全性的需要變得越來越重要.然而,盡管網(wǎng)絡(luò)技術(shù)進(jìn)步很快,安全性問題仍然相對落后.由于FPGA所提供的設(shè)計(jì)優(yōu)勢,特別是新的高速版本,網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員可以在這些網(wǎng)絡(luò)設(shè)備中經(jīng)濟(jì)地實(shí)現(xiàn)安全性支持.FPGA是實(shí)現(xiàn)設(shè)計(jì)靈活性和功能升級的關(guān)鍵,對于容錯、IPSec協(xié)議和系統(tǒng)接口問題而言這兩點(diǎn)非常重要.而且,FPGA還為網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員提供了適應(yīng)不同安全處理功能以及隨著安全技術(shù)的發(fā)展方便地增加對新技術(shù)支持的能力.標(biāo)準(zhǔn)加密/解決以及認(rèn)證算法,如RC-4、DES、三次DES、MD-5以及安全哈希算法-1(SHA-1)被廣泛用于全球網(wǎng)絡(luò)安全系統(tǒng)中.本文介紹了基于PCI總線的加密卡的研制,硬件板卡的結(jié)構(gòu),著重論述了加密卡上加密模塊的實(shí)現(xiàn),即用FPGA實(shí)現(xiàn)3DES及IDEA、MD5算法的過程,加密卡的工作原理,加密卡中多種密碼算法的配置原理,最后對3DES算法及IDEA、MD5算法的實(shí)現(xiàn)進(jìn)行仿真,并繪制了板卡的原理圖,對PCI接口原理進(jìn)行了闡述.在論文中,首先闡述了數(shù)據(jù)加密原理.介紹了數(shù)據(jù)加密的算法和數(shù)據(jù)加密的技術(shù)發(fā)展趨勢,并重點(diǎn)說明了3DES的算法.由于加密卡的生存空間在于其高速的加密性能與便捷的使用方式,所以,我們的加密卡采用的是基于PCI插槽的結(jié)構(gòu),遵從的是PCI2.2規(guī)范,理解并掌握PCI總線的規(guī)范是了解整個系統(tǒng)的重要一環(huán),本文講述了PCI總線的特點(diǎn)和性能,以及總線的信號.由于遵從高速性的要求,我們在硬件選型的時候,選用的是TI公司高速DSP T M S 3 2 0 C 5 4 x:T I公司新推出的T M S 3 2 0 C 6 x系列D S P功能強(qiáng),速度也非常快,但目前價格仍然太高,不適合一般加解密使用.而TMS3 2 0 C 5 4 x系列具有性能適中,價格低廉,產(chǎn)品成熟等特點(diǎn),是較好的選擇.FPGA選用的XILINX公司的XC2V3000,在隨后的文章中,我們將會對這些器件特性做相應(yīng)說明.并由此得出電路原理圖的繪制.文章的重點(diǎn)之一在于3DES算法及IDEA、MD5算法的FPGA實(shí)現(xiàn),以Xilinx公司VIRTEXII結(jié)構(gòu)的VXC2V3000為例,闡述用FPGA高速實(shí)現(xiàn)3DES算法及IDEA、MD5算法的設(shè)計(jì)要點(diǎn)及關(guān)鍵部分的設(shè)計(jì).

    標(biāo)簽: FPGA 加密卡 加密算法

    上傳時間: 2013-04-24

    上傳用戶:qazwsc

  • 基于FPGA的GPS中頻數(shù)字接收機(jī)

    本文進(jìn)行了基于FPGA的GPS直序偽碼擴(kuò)頻接收機(jī)的設(shè)計(jì)和數(shù)字化硬件實(shí)現(xiàn)。論文首先對GPS衛(wèi)星導(dǎo)航定位系統(tǒng)進(jìn)行了分析,并對與數(shù)字化接收機(jī)直接相關(guān)聯(lián)的GPS信號中頻部分結(jié)合實(shí)際系統(tǒng)要求進(jìn)行了設(shè)計(jì)和分析,由此確定了數(shù)字化偽碼捕獲跟蹤接收機(jī)研制的具體要求,之后完成了接收機(jī)中頻數(shù)字化方案設(shè)計(jì)。同時對偽碼捕獲跟蹤后端的載波捕獲跟蹤的實(shí)現(xiàn)方案進(jìn)行了描述和分析。最后利用EDA工具在FPGA芯片上實(shí)現(xiàn)了GPS數(shù)字化接收機(jī)的偽碼捕獲跟蹤。 受工作環(huán)境的制約,GPS衛(wèi)星接收機(jī)系統(tǒng)首先表現(xiàn)為功率受限系統(tǒng),接收機(jī)必須滿足在低信噪比條件下工作。同時接收機(jī)與衛(wèi)星間高動態(tài)產(chǎn)生的多普勒頻率,給接收機(jī)實(shí)現(xiàn)快速捕獲帶來了難度。通過仿真分析,綜合了實(shí)現(xiàn)難度和性能兩方面因素,針對小信噪比工作條件提出了改進(jìn)型的序貫偽碼捕獲實(shí)施方案。同時按照捕獲概率和時間的要求,對接收機(jī)偏壓、上、下門限、NCO增益等進(jìn)行了設(shè)計(jì)和仿真分析,確定了捕獲的數(shù)字化實(shí)現(xiàn)方案,偽碼跟蹤采用超前滯后環(huán)方案。捕獲完成后可使本地偽碼與接收偽碼的相對誤差保持在±1/4碼元范圍內(nèi),而跟蹤環(huán)路的跟蹤范圍為±4/3碼元,保證了捕獲到跟蹤的可靠銜接,同時采用可變環(huán)路帶寬措施解決了跟蹤速度和精度的矛盾。 在數(shù)字化實(shí)現(xiàn)設(shè)計(jì)中,給出了詳細(xì)的數(shù)字化實(shí)現(xiàn)方案和分析,這樣在保證工作精度的同時盡量減少硬件資源的開銷,利用EDA工具,采用Veilog設(shè)計(jì)語言在Xilinx的VIRTEXII系列的XC2V500fg256的FPGA上完成數(shù)字化接收機(jī)偽碼捕獲跟蹤的實(shí)現(xiàn),并在其開發(fā)平臺上對數(shù)字化接收機(jī)進(jìn)行了仿真驗(yàn)證,在給定的工作條件下達(dá)到了設(shè)計(jì)性能和指標(biāo)要求。

    標(biāo)簽: FPGA GPS 中頻 數(shù)字接收機(jī)

    上傳時間: 2013-04-24

    上傳用戶:15510133306

  • 基于FPGA的電梯群控系統(tǒng)的分析與設(shè)計(jì)

    電梯群控系統(tǒng)是一種控制三臺或以上電梯的控制系統(tǒng),旨在提高對電梯乘客的服務(wù)質(zhì)量并減少成本,如:電梯的功耗。目前大多數(shù)的電梯群控系統(tǒng)采用的是“大廳呼叫指派”的方法來指派電梯去響應(yīng)乘客的呼梯。在這種方法中,電梯群控系統(tǒng)將根據(jù)目前建筑內(nèi)的客流量來選擇最合適的電梯。在充分研究了當(dāng)前普遍應(yīng)用的電梯群控算法后,本文提出了一種基于模糊算法的電梯群控算法,該算法可根據(jù)不同的客流量模式對整個建筑中的電梯群進(jìn)行派梯策略的調(diào)整,并在此基礎(chǔ)上,加入了經(jīng)驗(yàn)調(diào)整參數(shù),使該算法增加了記憶調(diào)整功能。 本文在Matlab上對改進(jìn)的算法進(jìn)行了相關(guān)建模驗(yàn)證。驗(yàn)證結(jié)果表明,相比只是應(yīng)用類似模糊算法的電梯群控算法,本算法對于客流量模式相對穩(wěn)定的大型寫字樓等對群控系統(tǒng)要求比較嚴(yán)格的樓宇更為適用,即擁有更好的應(yīng)用前景。 本文還對所提出的算法在工程上采用FPGA進(jìn)行應(yīng)用做了一定的研究。在用C程序建立該算法的基礎(chǔ)上采用了在Xilinx VIRTEXII Pro開發(fā)板上運(yùn)行MicroBlaze軟IP核的方法對該算法進(jìn)行了調(diào)試并運(yùn)行成功。得到的運(yùn)行結(jié)果與用Matlab驗(yàn)證的結(jié)果一致。證明了該算法在工程上的可應(yīng)用性。

    標(biāo)簽: FPGA 電梯群控系統(tǒng)

    上傳時間: 2013-07-02

    上傳用戶:壞壞的華仔

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