Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計
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VeriLOg技術(shù)資料
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VerilogHDL是一種硬件描述語言，以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。VerilogHDL和VHDL是世界上最流行的兩種硬件描述語言，都是在20世紀(jì)80年代中期開發(fā)出來的。前者由GatewayDesignAutomation公司（該公司于1989年被Cadence公司收購）開發(fā)。兩種HDL均為IEEE標(biāo)準(zhǔn)。[1]
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查看全部3077個資源 ?精通Verilog HDL：IC設(shè)計核心技術(shù)實(shí)例詳解
精通Verilog HDL：IC設(shè)計核心技術(shù)實(shí)例詳解...
Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.rar
專輯類----可編程邏輯器件相關(guān)專輯 Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.rar...
Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.pdf
專輯類-可編程邏輯器件相關(guān)專輯-96冊-1.77G Verilog-HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計-210頁-18.0M.pdf...
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