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Verilog-RISC

CRC校驗串行實現方法,verilog源碼,利用反饋線性移位寄存器的方法,實現簡單,適用于串行通信協議中的CRC校驗.

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CRC校驗并行實現,Verilog源碼.8位數據輸入,實現速度快,適用與各種類型的器件.

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我剛完成的基于Quartus Two 開發環境全部用Verilog硬件描述語言編譯無誤的MSK調制解調器

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具備GMII接口和ARP協議功能的千兆以太網控制器。經過Xilinx SPATAN-III FPGA驗證, Verilog描述

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一個通用串口的verilog源程序

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關于雙口RAM的Verilog HDL源碼

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VERILOG電子書第一章非常經典的東西

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小例子,關于Verilog HDL語言的一些小練習,可供參考.

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小例子,關于Verilog HDL語言的一些小練習,可供初學者進行參考.

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