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Verilog-hdl

Verilog HDL高級(jí)數(shù)字設(shè)計(jì)

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基于Verilog的SRAM讀寫控制

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Verilog HDL實(shí)踐與應(yīng)用系統(tǒng)設(shè)計(jì)

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HDL的可綜合設(shè)計(jì)簡介

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Verilog HDL的基本語法--周立功Actel產(chǎn)品線

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Verilog入門教程

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verilog HDL中wire和reg的區(qū)別

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Verilog基本電路設(shè)計(jì)指導(dǎo)書

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