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Xilinx-FPGA-<b>MATlAB</b>-Simulate

  • 用于Xilinx FPGA的Maxim參考設(shè)計(jì)

    MAX8686 25A Buck穩(wěn)壓器

    標(biāo)簽: Xilinx Maxim FPGA 參考設(shè)計(jì)

    上傳時(shí)間: 2013-11-15

    上傳用戶:旭521

  • 基于AXI總線的MicroBlaze雙核SoPC系統(tǒng)設(shè)計(jì)

    目的是利用嵌入在Xilinx FPGA中的MicroBlaze核實(shí)現(xiàn)基于AXI總線的雙核嵌入式系統(tǒng)設(shè)計(jì)以及共享實(shí)現(xiàn)LED燈的時(shí)控.

    標(biāo)簽: MicroBlaze SoPC AXI 總線

    上傳時(shí)間: 2014-12-30

    上傳用戶:stewart·

  • 基于Xilinx FPGA的多分辨率頻譜分析儀設(shè)計(jì)

      頻譜分析儀的主要工作原理   接收到的中頻模擬信號(hào)經(jīng)過(guò)A/D轉(zhuǎn)換為14位的數(shù)字信 號(hào),首先對(duì)數(shù)字信號(hào)進(jìn)行數(shù)字下變頻(DDC),得到I路、Q路信號(hào),然后根據(jù)控制信號(hào)對(duì)I路、Q路信號(hào)進(jìn)行抽取濾波,使用CIC抽取濾波器完成,然后在分 別對(duì)I路、Q路信號(hào)分別進(jìn)行低通濾波,濾波器采用FIR濾波器和半帶濾波器相結(jié)合的方式,然后對(duì)信號(hào)進(jìn)行加窗、FFT(對(duì)頻譜進(jìn)行分析時(shí)進(jìn)行FFT運(yùn)算, 對(duì)功率譜進(jìn)行分析時(shí)不進(jìn)行FFT運(yùn)算)、I路和Q路平方求和、求平均。最后將輸出的數(shù)據(jù)送入到DSP中進(jìn)行顯示與控制的后續(xù)處理。

    標(biāo)簽: Xilinx FPGA 多分辨率 頻譜分析儀

    上傳時(shí)間: 2013-11-14

    上傳用戶:leixinzhuo

  • 基于Xilinx FPGA的HDUSec-網(wǎng)絡(luò)行為分析監(jiān)控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)(含源代碼)

      系統(tǒng)實(shí)現(xiàn)計(jì)劃:   1、首先是熟悉NetFPGA平臺(tái),并進(jìn)行平臺(tái)搭建,NetFPGA通過(guò)計(jì)算機(jī)的PCI接口與上位機(jī)進(jìn)行數(shù)據(jù)交互和系統(tǒng)設(shè)置等工作;   2、根據(jù)NetFPGA的路由器功能對(duì)其進(jìn)行硬件代碼的編寫(xiě)和改進(jìn);   3、接下來(lái)是使用C語(yǔ)言編寫(xiě)網(wǎng)絡(luò)行為記錄器;   4、設(shè)計(jì)管理系統(tǒng)、Web服務(wù)器、數(shù)據(jù)庫(kù)。

    標(biāo)簽: Xilinx HDUSec FPGA 網(wǎng)絡(luò)

    上傳時(shí)間: 2013-10-11

    上傳用戶:2404

  • WP151 - Xilinx FPGA的System ACE配置解決方案

    Design techniques for electronic systems areconstantly changing. In industries at the heart of thedigital revolution, this change is especially acute.Functional integration, dramatic increases incomplexity, new standards and protocols, costconstraints, and increased time-to-market pressureshave bolstered both the design challenges and theopportunities to develop modern electronic systems.One trend driving these changes is the increasedintegration of core logic with previously discretefunctions to achieve higher performance and morecompact board designs.

    標(biāo)簽: System Xilinx FPGA 151

    上傳時(shí)間: 2013-11-23

    上傳用戶:kangqiaoyibie

  • XAPP483 - 利用 Platform Flash PROM 實(shí)現(xiàn)多重啟動(dòng)功能

      一些應(yīng)用利用 Xilinx FPGA 在每次啟動(dòng)時(shí)可改變配置的能力,根據(jù)所需來(lái)改變 FPGA 的功能。Xilinx Platform Flash XCFxxP PROM 的設(shè)計(jì)修訂 (Design Revisioning) 功能,允許用戶在單個(gè)PROM 中將多種配置存儲(chǔ)為不同的修訂版本,從而簡(jiǎn)化了 FPGA 配置更改。在 FPGA 內(nèi)部加入少量的邏輯,用戶就能在 PROM 中存儲(chǔ)的多達(dá)四個(gè)不同的修訂版本之間進(jìn)行動(dòng)態(tài)切換。多重啟動(dòng)或從多個(gè)設(shè)計(jì)修訂進(jìn)行動(dòng)態(tài)重新配置的能力,與 Spartan™-3E FPGA 和第三方并行 flashPROM 一起使用時(shí)所提供的 MultiBoot 選項(xiàng)相似。本應(yīng)用指南將進(jìn)一步說(shuō)明 Platform Flash PROM 如何提供附加選項(xiàng)來(lái)增強(qiáng)配置失敗時(shí)的安全性,以及如何減少引腳數(shù)量和板面積。此外,Platform Flash PROM 還為用戶提供其他優(yōu)勢(shì):iMPACT 編程支持、單一供應(yīng)商解決方案、低成本板設(shè)計(jì)和更快速的配置加載。本應(yīng)用指南還詳細(xì)地介紹了一個(gè)包含 VHDL 源代碼的參考設(shè)計(jì)。

    標(biāo)簽: Platform Flash XAPP PROM

    上傳時(shí)間: 2013-10-10

    上傳用戶:wangcehnglin

  • 題目:利用條件運(yùn)算符的嵌套來(lái)完成此題:學(xué)習(xí)成績(jī)>=90分的同學(xué)用A表示

    題目:利用條件運(yùn)算符的嵌套來(lái)完成此題:學(xué)習(xí)成績(jī)>=90分的同學(xué)用A表示,60-89分之間的用B表示,60分以下的用C表示。 1.程序分析:(a>b)?a:b這是條件運(yùn)算符的基本例子。

    標(biāo)簽: gt 90 運(yùn)算符 嵌套

    上傳時(shí)間: 2015-01-08

    上傳用戶:lifangyuan12

  • RSA算法 :首先, 找出三個(gè)數(shù), p, q, r, 其中 p, q 是兩個(gè)相異的質(zhì)數(shù), r 是與 (p-1)(q-1) 互質(zhì)的數(shù)...... p, q, r 這三個(gè)數(shù)便是 person_key

    RSA算法 :首先, 找出三個(gè)數(shù), p, q, r, 其中 p, q 是兩個(gè)相異的質(zhì)數(shù), r 是與 (p-1)(q-1) 互質(zhì)的數(shù)...... p, q, r 這三個(gè)數(shù)便是 person_key,接著, 找出 m, 使得 r^m == 1 mod (p-1)(q-1)..... 這個(gè) m 一定存在, 因?yàn)?r 與 (p-1)(q-1) 互質(zhì), 用輾轉(zhuǎn)相除法就可以得到了..... 再來(lái), 計(jì)算 n = pq....... m, n 這兩個(gè)數(shù)便是 public_key ,編碼過(guò)程是, 若資料為 a, 將其看成是一個(gè)大整數(shù), 假設(shè) a < n.... 如果 a >= n 的話, 就將 a 表成 s 進(jìn)位 (s

    標(biāo)簽: person_key RSA 算法

    上傳時(shí)間: 2013-12-14

    上傳用戶:zhuyibin

  • 數(shù)字運(yùn)算

    數(shù)字運(yùn)算,判斷一個(gè)數(shù)是否接近素?cái)?shù) A Niven number is a number such that the sum of its digits divides itself. For example, 111 is a Niven number because the sum of its digits is 3, which divides 111. We can also specify a number in another base b, and a number in base b is a Niven number if the sum of its digits divides its value. Given b (2 <= b <= 10) and a number in base b, determine whether it is a Niven number or not. Input Each line of input contains the base b, followed by a string of digits representing a positive integer in that base. There are no leading zeroes. The input is terminated by a line consisting of 0 alone. Output For each case, print "yes" on a line if the given number is a Niven number, and "no" otherwise. Sample Input 10 111 2 110 10 123 6 1000 8 2314 0 Sample Output yes yes no yes no

    標(biāo)簽: 數(shù)字 運(yùn)算

    上傳時(shí)間: 2015-05-21

    上傳用戶:daguda

  • 源代碼用動(dòng)態(tài)規(guī)劃算法計(jì)算序列關(guān)系個(gè)數(shù) 用關(guān)系"<"和"="將3個(gè)數(shù)a

    源代碼\用動(dòng)態(tài)規(guī)劃算法計(jì)算序列關(guān)系個(gè)數(shù) 用關(guān)系"<"和"="將3個(gè)數(shù)a,b,c依次序排列時(shí),有13種不同的序列關(guān)系: a=b=c,a=b<c,a<b=v,a<b<c,a<c<b a=c<b,b<a=c,b<a<c,b<c<a,b=c<a c<a=b,c<a<b,c<b<a 若要將n個(gè)數(shù)依序列,設(shè)計(jì)一個(gè)動(dòng)態(tài)規(guī)劃算法,計(jì)算出有多少種不同的序列關(guān)系, 要求算法只占用O(n),只耗時(shí)O(n*n).

    標(biāo)簽: lt 源代碼 動(dòng)態(tài)規(guī)劃 序列

    上傳時(shí)間: 2013-12-26

    上傳用戶:siguazgb

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