MP3 for XPLA3 XILINX.CPLD,必須在XILINX的FPGA芯片下使用,因為IP核是xilinx
標(biāo)簽： XILINX xilinx XPLA3 CPLD
上傳時間： 2017-02-05
上傳用戶：erkuizhang
華為 FPGA 設(shè)計高級技巧 Xilinx 篇， 涉及 FPGA 綜合、時序優(yōu)化、編碼風(fēng)格
標(biāo)簽： Xilinx FPGA 華為 高級技巧
上傳時間： 2014-12-06
上傳用戶：manking0408
采用FPGA實現(xiàn)色彩空間轉(zhuǎn)換R’G’B’ to Y’CbCr的VHDL和verilog源代碼,支持xilinx的各種器件.
標(biāo)簽： verilog xilinx FPGA CbCr
上傳時間： 2013-12-12
上傳用戶：lps11188
xilinx Virtex-4 fpga開發(fā)板（ML402,ML403等）的使用入門手冊
標(biāo)簽： xilinx Virtex ML fpga
上傳時間： 2013-12-26
上傳用戶：mpquest
how to infer ram for fpga altera xilinx
標(biāo)簽： altera xilinx infer fpga
上傳時間： 2013-12-25
上傳用戶：dongbaobao
How to infer a finite state machine for fpga altera xilinx
標(biāo)簽： machine finite altera xilinx
上傳時間： 2014-01-10
上傳用戶：鳳臨西北
how to infer a shift register for fpga altera xilinx
標(biāo)簽： register altera xilinx infer
上傳時間： 2014-01-22
上傳用戶：zl5712176
提出了一個采用(2,1,7)卷積碼+QPSK的中頻調(diào)制解調(diào)方案,并在Xilinx公司的100萬 門FPGA芯片上實現(xiàn)了該系統(tǒng)。該系統(tǒng)在信噪比SNR為6dB左右時可實現(xiàn)速率超過1Mbit/s、誤碼率 小于10-5的數(shù)據(jù)傳輸。
標(biāo)簽： Xilinx QPSK FPGA Mbit
上傳時間： 2014-01-05
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xilinx公司出的FPGA開發(fā)板和原理圖
標(biāo)簽： xilinx FPGA 開發(fā)板 原理圖
上傳時間： 2017-04-02
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用于FPGA實現(xiàn)單總線測溫電阻DS18b20時序。在xilinx spartan 3中試過。
標(biāo)簽： spartan xilinx FPGA 18b
上傳時間： 2017-06-07
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