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H.264高清視頻編解碼系統中ARM控制模塊的軟件設計.pdf

隨著數字電視日益深入人心，高清概念越來越為人所熟知。帶有高清視頻功能的產品已經逐步走向人們的工作和生活，高清視頻處理已經從理論研究走向系統實際應用。毫無疑問，無論是從觀眾的視覺還是從產業的角度來看，高清視頻已經成為數字視頻技術發展的必然趨勢。本文研究了整個編解碼系統中ARM控制模塊的軟件設計，最終完成以PC機為終端控制平臺，經ARM控制模塊將命令發送給核心編解碼芯片MB86H51，使其完成相應的操作。、本文主要的工作有如下幾個方面： 1、根據ARM各型號芯片的特點，結合本系統的實際需求，最終選定Atmel公司的AT91SAM9261作為ARM控制板的核心處理芯片，并深入了解該芯片的工作原理和內部結構。 2、根據本系統中所選用的DataFlash型號及外圍電路連接情況等諸多因素，并結合Atmel公司所提供的AT91SAM9261一級BootLoader參考代碼，編寫調試符合本系統啟動運行的一級BootLoader引導程序，也稱為Bootstrap引導程序，最終成功實現引導U-Boot程序。 3、深入分析了U-Boot和Linux的體系結構和編譯過程，結合AT91SAM9261芯片的特點和實際外圍電路的連接情況，修改U-Boot和Linux中主要的編譯參數，并進行重新編譯，最終成功移植到系統板中。 4、在ITU-T提供的H.264標準的參考解碼程序JM8.6的基礎上，詳細研究了H.264視頻編碼標準以及具體的解碼器結構和解碼流程，并結合DirectX技術，開發了一款基于PC機的H.264解碼播放器，用于驗證存儲在PC機上的H.264壓縮碼流的正確性。

標簽： 264 ARM 高清視頻

上傳時間： 2013-04-24

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51單片機C語言常用模塊與綜合系統設計實例精講

51單片機C語言常用模塊與綜合系統設計實例精講，包含源代碼和電路原理圖

標簽： 51單片機C語言模塊設計實例

上傳時間： 2013-05-20

上傳用戶：songyuncen
10100M以太網芯片的I2C接口模塊的FPGA設計

該文結合"10M/100M以太網交換芯片的設計"課題,介紹了以太網技術發展的概況和IP CORE、SoC的設計方法,闡述了以太網交換原理及關鍵技術,研究了CSMA/CD協議、交換機、VLAN的原理和數據流優先技術及流量控制,在此基礎上完成了10M/100M以太網交換芯片的主要模塊的設計方案和實現框圖.同時結合Philip公司的IC總線的工作原理,給出了10M/100M以太網交換芯片的設計方案中的IC接口模塊的FPGA設計的驗證和仿真,并對仿真結果進行分析比較,驗證了IC接口模塊可以作為一個軟核來使用.

標簽： 10100M FPGA I2C 以太網

上傳時間： 2013-07-18

上傳用戶：jichenxi0730
圖形LCD模塊的菜單方式人機交互界面

在以單片機為核心的嵌入式應用中，友好的人機交互界面起著十分重要的作用。筆者在設計中使用WGM-12864B 圖形LCD 模塊實現一種中文窗口菜單界面，設計中使用的方法具有普遍性意義。

標簽： LCD 圖形人機交互模塊

上傳時間： 2013-04-24

上傳用戶：hj_18
ZLG500/ZLG500A 讀卡模塊簡介

本文檔描述了MIFARE 串行讀卡模塊ZLG500A 與主機微處理器之間的串行通信軟件的通信協議和命令.ZLG500A 是一個簡單的串行讀寫模塊它可以讀寫MIFARE ,無線智能

標簽： ZLG 500 讀卡模塊

上傳時間： 2013-04-24

上傳用戶：liansi
OFDM信道估計模塊運算部件的FPGA設計

正交頻分復用(OnIlogonaJ Frequency Division Multiplexing，OFDM)技術通過將整個信道分為多個帶寬相等并行傳輸的子信道，通過將信息經過子信道獨立傳輸來實現通信，子信道的正交性可以保證最大限度的利用頻譜資源。OFDM系統通過循環前綴來消除符號間干擾(ISI)，通過IDFT/DFT調制解調降低了系統實現的復雜度。由于其頻譜利用率高，抗多徑能力強，在多種通信場合中都得到了應用。雖然有著上述優點，但為了準確的恢復信號，信道估計是OFDM系統中必須實現的一環。本文正是針對OFDM接收機中的信道估計模塊的運算部件的實現進行了研究。首先，研究了OFDM信道估計的LS算法，一階線性插值算法，二次多項式插值算法，建立了適用于寬帶通信系統的信道估計模塊模型。其次研究了加法器電路和乘法器電路的實現，包括進位行波加法器，曼徹斯特進位鏈，超前進位加法器和乘法原理，陣列乘法器，wallace樹乘法器及BOOTH編碼算法，并分析了各種電路的特性及優缺點。接著研究了幾種主要的除法器設計算法，包括數字循環算法，基于函數迭代的算法，以及CORDIC算法，結合信道估計的特點選擇了函數迭代和CORDIC算法作為具體實現的方法。最后，在前面的設計的基礎上在FPGA芯片上實現了前面的設計方案。

標簽： OFDM FPGA 信道估計模塊

上傳時間： 2013-06-06

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H.264幀內預測算法優化及幾個重要模塊的FPGA實現

H.264作為新一代視頻編碼標準，相比上一代視頻編碼標準MPEG2，在相同畫質下，平均節約64﹪的碼流。該標準僅設定了碼流的語法結構和解碼器結構，實現靈活性極大，其規定了三個檔次，每個檔次支持一組特定的編碼功能，并支持一類特定的應用，因此。H.264的編碼器的設計可以根據需求的不同而不同。 H.264雖然具有優異的壓縮性能，但是其復雜度卻比一般編碼器高的多。本文對H.264進行了編碼復雜度分析，并統計了整個軟件編碼中計算量的分布。H.264中采用了率失真優化算法，提高了幀內預測編碼的效率。在該算法下進行幀內預測時，為了得到一個宏塊的預測模式，需要進行592次率失真代價計算。因此為了降低幀內預測模式選擇的計算復雜度，本文改進了幀內預測模式選擇算法。實踐證明，在PSNR值的損失可以忽略不計的情況下，該算法相比原算法，幀內編碼時間平均節約60﹪以上，對編碼的實時性有較大幫助。為了實現實時編碼，考慮到FPGA的高效運算速度和使用靈活性，本文還研究了H.264編碼器基本檔次的FPGA實現。首先研究了H.264編碼器硬件實現架構，并對影響編碼速度，且具有硬件實現優越性的幾個重要部分進行了算法研究和FPGA.實現。本文主要研究了H.264編碼器中整數DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數DCT變換等部分。分別對這些模塊進行了綜合和時序仿真，并將驗證后通過的系統模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中，進行了在線測試，驗證了該系統對輸入的殘差數據實時壓縮編碼的功能。本文對H.264編碼器幀內預測模式選擇算法的改進，算法實現簡單，對軟件編碼的實時性有很大幫助。本文對在單片FPGA上實現H.264編碼器做出了探索性嘗試，這對H.264編碼器芯片的設計有著積極的借鑒性。

標簽： FPGA 264 幀內預測算法優化

上傳時間： 2013-05-25

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64位MIPS微處理器的模塊設計和FPGA驗證

　　作為嵌入式系統核心的微處理器，是SOC不可或缺的“心臟”，微處理器的性能直接影響著整個SOC的性能。　　與國際先進技術相比，我國在這一領域的研究和開發工作還相當落后，這直接影響到我國信息產業的發展。本著趕超國外先進技術，填補我國在該領域的空白以擺脫受制于國外的目的，我國很多科研單位和公司進行了自己的努力和嘗試。經過幾年的探索，已經有多種自主知識產權的處理器芯片完成了設計驗證并逐漸進入市場化階段。我國已結束無“芯”的歷史，并向設計出更高性能處理器的目標邁進。　　艾科創新微電子公司的VEGA處理器，是公司憑借自己的技術力量和科研水平設計出的一款64位高性能RSIC微處理器。該處理器基于MIPSISA構架，采用五級流水線的設計，并且使用了高性能處理器所廣泛采用的虛擬內存管理技術。設計過程中采用自上而下的方法，根據其功能將其劃分為取指、譯碼、算術邏輯運算、內存管理、流水線控制和cache控制等幾個功能塊，使得我們在設計中能夠按照其功能和時序要求進行。　　本文的首先介紹了MIPS微處理器的特點，通過對MIPS指令集和其五級流水線結構的介紹使得對VEGA的設計有了一個直觀的認識。在此基礎上提出了VEGA的結構劃分以及主要模塊的功能。作為采用虛擬內存管理技術的處理器，文章的主要部分介紹了VEGA的虛擬內存管理技術，將VEGA的內存管理單元(MMU)尤其是內部兩個翻譯后援緩沖(TLB)的設計作為重點給出了流水線處理器設計的方法。結束總體設計并完成仿真后，并不能代表設計的正確性，它還需要我們在實際的硬件平臺上進行驗證。作為論文的又一重點內容，介紹了我們在VEGA驗證過程中使用到的FPGA的主要配置單元，FPGA的設計流程。VEGA的FPGA平臺是一完整的計算機系統，我們利用在線調試軟件XilinxChipscope對其進行了在線調試，修正其錯誤。　　經過模塊設計到最后的FPGA驗證，VEGA完成了其邏輯設計，經過綜合和布局布線等后端流程，VEGA采用0.18工藝流片后達到120MHz的工作頻率，可在其平臺上運行Windows-CE和Linux嵌入式操作系統，達到了預計的設計要求。　　

標簽： MIPS FPGA 微處理器模塊設計

上傳時間： 2013-07-07

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基于IEEE80211a的OFDM基帶傳輸系統的研究及其部分模塊的FPGA實現

IEEE802旗下的無線網絡協議引領了無線網絡領域的新革命，其不斷提升的速度優勢滿足了人們對于高速無線接入的迫切要求，在這其中，OFDM技術所起的作用不可小覷。隨著FPGA、信號處理和通信技術的發展，OFDM的應用得到了長足的進步。在此情況下，以OFDM技術為核心實現數據傳輸的原型機系統顯得應情應景而且必要。本課題在深入理解OFDM技術的同時，結合相應的EDA工具對系統進行建模并基于IEEE802.11a物理層標準給出了一種OFDM基帶傳輸的系統實現方案。整個設計采用目前主流的自頂向下的設計方法，由總體設計至詳細設計逐步細化。在系統功能模塊的FPGA實現過程中，針對XilinxVirtex-Ⅱ芯片對各個模塊進行了詳細設計，通過采用雙端口RAM、流水、乒乓結構等處理實現高速的同步的信道編碼的功能模塊；通過比較符號定時的不同算法，給出了基于MultiplierlessCorrelator的實現結構并給出了仿真波形圖，驗證了采用該算法后符號定時模塊的資源耗費大大降低而功能卻依然和基于乘法器的符號定時模塊相當；通過對Viterbi算法進行簡化，給出了(2，1，6)卷積碼的4比特軟判決Viterbi解碼器的設計和實現。最后根據系統所選芯片XC2V3000給出了具有較高配置靈活性的基于SystemACE配置方案的FPGA的硬件原理圖設計和PCB設計。本文首先以無線局域網和IEEE802無線網絡家族引出OFDM技術發展、研究價值及OFDM的優缺點，接下來從OFDM原理入手，簡要說明了OFDM的基本要素以及目前的研究熱點，之后在介紹完IEEE802.11a物理層標準的同時給出了本原型機系統的總體設計方案，并從硬件語言設計和FPGA硬件原理設計兩方面給出了該系統的詳細設計。隨著OFDM技術的普及以及未來通信技術對OFDM的青睞，相信本論文的工作對OFDM基帶傳輸系統的原型設計和實現具有一定的參考價值。

標簽： 80211a 80211 IEEE FPGA

上傳時間： 2013-07-13

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高清視頻編解碼系統控制模塊設計

在航空航天，遙感測量，安全防衛以及家用影視娛樂等領域，要求能及時保存高清晰度的視頻信號供后期分析、處理、研究和欣賞。因此，研究一套處理速度快，性能可靠，使用方便，符合行業相關規范的高清視頻編解碼系統是十分必要的。本文首先介紹了高清視頻的發展歷史。并就當前相關領域的發展闡述了高清視頻編解碼系統的設計思路，提出了可行的系統設計方案。基于H.264的高清視頻編碼系統對處理器的要求非常高，一般的DSP和通用處理器難以達到性能要求。本系統選擇富士通公司最新的專用視頻編解碼芯片MB86H51，實時編解碼分辨率達到1080p的高清視頻。芯片具有壓縮率高，功耗低，體積小等優點。系統的控制設備由三塊FPGA芯片和ARM控制器共同完成。FPGA芯片分別負責視頻輸入輸出，碼流輸入輸出和主編解碼芯片的控制。ARM作為上層人機交互的控制器，向系統使用者提供操作界面，并與主控FPGA相連。方案實現了高清視頻的輸入，實時編碼和碼流存儲輸出等功能于一體，能夠編碼1080p的高清視頻并存儲在硬盤中。系統開發的工作難點在于FPGA的程序設計與調試工作。其次，詳細介紹了FPGA在系統中的功能實現，使用的方法和程序設計。使用VHDL語言編程實現I2C總線接口和接口控制功能，利用stratix系列FPGA內置的M4K快速存儲單元實現128K的命令存儲ROM，并對設計元件模塊化，方便今后的功能擴展。編程實現了PIO模式的硬盤讀寫和SDRAM接口控制功能，實現高速的數據存儲功能。利用時序狀態機編程實現主芯片編解碼控制功能，完成編解碼命令的發送和狀態讀取，并對設計思路，調試結果和FPGA資源使用情況進行分析。著重介紹設計中用到的最新芯片及其工作方式，分析設計過程中使用的最新技術和方法。有很強的實用價值。最后，論文對系統就不同的使用情況提出了可供改進的方案，并對與高清視頻相關的關鍵技術作了分析和展望。

標簽： 高清視頻編解碼系統控制模塊設計

上傳時間： 2013-07-26

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