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atM

自動取款機又稱atM(AutomatedTellerMachine的縮寫),意思是自動柜員機,因大部分用于取款,又稱自動取款機。它是一種高度精密的機電一體化裝置,利用磁性代碼卡或智能卡實現金融交易的自助服務,代替銀行柜面人員的工作。可提取現金、查詢存款余額、進行賬戶之間資金劃撥、余額查詢等工作;還可以進行現金存款(實時入賬)、支票存款(國內無)、存折補登、中間業務等工作。持卡人可以使用信用卡或儲蓄卡,根據密碼辦理自動取款、查詢余額、轉賬、現金存款,存折補登,購買基金,更改密碼,繳納手機話費等業務。
  • atM取款

    atM簡易取款,可完成查詢、取款、存款等操作。 搜索 復制

    標簽: atM

    上傳時間: 2015-06-01

    上傳用戶:tingchong

  • atM系統取款系統

    當今時代是飛速發展的信息時代,使用計算機進行信息控制,不僅提高了工作效率,而且大大的提高了其安全性。尤其對于atM復雜的信息管理,計算機能夠充分發揮它的優越性。計算機進行信息管理與信息管理系統的開發密切相關,系統的開發是系統管理的前提。本系統就是為了管理好管理員和用戶的信息而設計的。

    標簽: atM 系統

    上傳時間: 2017-11-11

    上傳用戶:狂暴老戴

  • atM機C++語言實現源碼

      用C++實現atM機登陸系統

    標簽: atM C++ 源碼

    上傳時間: 2017-11-26

    上傳用戶:494958578

  • atM機,C++實現

    用C++實現atM機登陸系統,包含多個類,簡單易懂

    標簽: atM C++ 源碼

    上傳時間: 2017-11-26

    上傳用戶:494958578

  • 簡易atM系統

    基于客戶端和服務端的atM系統,具有查詢和一定的存款,取款功能。

    標簽: atM 系統

    上傳時間: 2017-12-24

    上傳用戶:AY13

  • JAVA-atM觸屏

    java編寫的atM觸屏,查詢余額、轉賬、修改密碼、取錢和存款功能。

    標簽: JAVA-atM 觸屏

    上傳時間: 2019-05-11

    上傳用戶:xsx65

  • atM柜臺管理模擬程序

    TM柜員機模擬程序,其功能為: 當輸入給定的卡號和密碼(初始卡號和密碼為123456)時,系統能登錄atM柜員機系統,用戶可以進行: 1 查詢余額:初始余額為10000元 2 atM取款:每次取款金額為100的倍數,總額不超過5000元,支取金額不允許透支。 3 atM存款:不能出現負存款。 4 修改密碼:新密碼長度不小于6位,不允許出現6位完全相同的情況,只有舊密碼正確,新密碼符合要求,且兩次輸入相同的情況下才可以成功修改密碼。

    標簽: atM 模擬 程序

    上傳時間: 2021-12-07

    上傳用戶:18776564594

  • 模擬atM(C++程序代碼)

    模擬atM(C++程序代碼),有需要的可以參考!

    標簽: C++ atM

    上傳時間: 2022-03-11

    上傳用戶:ttalli

  • 相關協議的FPGA和網絡處理器上的實現

    由于集成電路產業在中國的飛速發展,FPGA設計技術,作為一種靈活性很強的芯片設計技術,在國內得到廣泛的應用.由于芯片的可升級性和開發自主知識產權芯片的必要性,在北京郵電大學寬帶通信網絡實驗室開發的三層以太網交換機項目中,以太網口和atM口之間的數據通道的實現上采用了FPGA設計方法.該文主要集中在atM口之間的數據通道的HEC頭校驗的FPGA實現.并完成了硬件設計、配置、硬件測試聯調工作以及論文撰寫工作.硬件的設計和開發基于Protel99和Tornado/VxWorks,軟件的設計和開發采用了標準的VHDL語言,開發環境是WINDOWS,開發工具是Xilinx公司的iSE4.1i集成開發環境.隨著網絡設備的發展,位于網絡邊緣的設備將會變得更加靈巧,更加迎合網絡發展的需要,在網絡設備上越來越多地引入了網絡處理器.我們實驗室和Intel建立了聯合實驗室,在此基礎上,我們要把網絡處理器評估板硬件上,運行軟件,使其成為路由器,首先要加載的就是網絡路由協議.由于Linux的開放源代碼,所以我們決定采用Linux做嵌入式系統,在上面運行zebra的路由協議.Zebra是linux上面的開放源代碼的路由軟件.

    標簽: FPGA 協議 網絡處理器

    上傳時間: 2013-07-08

    上傳用戶:yhm_all

  • 用SignalTapII邏輯分析儀調試FPGA

     SignalTap II 內嵌邏輯分析儀是Altera 公司Quartus II 軟件中內嵌的一種調試程序,通過把一段執行邏輯分析功能 的代碼和客戶的設計組合在一起編譯、布局布線,完成傳統邏輯分析儀的功能。介紹了SignalTap II 的基本內容、實現原理以及 在實際工程中的應用環境。結合atM交換矩陣的設計實例,詳細闡述了用SignalTapII 對FPGA 調試的具體方法和調試步驟, 以及在工程中的使用全過程。分析比較了該方法與傳統的外置式邏輯分析儀的優劣,對SignalTap II 應用條件進行了闡述。

    標簽: SignalTapII FPGA 邏輯分析儀 調試

    上傳時間: 2013-07-13

    上傳用戶:古谷仁美

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