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block-oriented

  • 一共有三種方式來發送和接收SMS信息:Block Mode, Text Mode和PDU Mode。其中PDU Mode被所有手機支持

    一共有三種方式來發送和接收SMS信息:Block Mode, Text Mode和PDU Mode。其中PDU Mode被所有手機支持,可以使用任何字符集,這也是手機默認的編碼方式。其中又分7bit-160,8bit-140,16bit-70的方式,我們中文用16bit70的方式。

    標簽: Mode PDU Block Text

    上傳時間: 2014-12-06

    上傳用戶:bakdesec

  • Linux那些事兒之我是Block層

    Linux那些事兒之我是Block層,對于block層的一些通俗解釋

    標簽: linux

    上傳時間: 2015-12-06

    上傳用戶:qiubingfu

  • 基于DSP的三相交流異步電機矢量控制系統.rar

    隨著電力電子技術、微處理器技術以及新的電機控制技術的發展,交流調速性能日益提高。變頻調速技術的出現使交流調速系統有取代直流調速系統的趨勢。但是國民經濟的快速發展要求交流變頻調速系統具有更高的調速精度、更大的調速范圍和更快的響應速度,一般的通用變頻器已經不能滿足工業應用的需求,而交流電機矢量控制調速系統能夠很好的滿足這個要求。矢量控制(Field Oriented Control),能夠實現交流電機電磁轉矩的快速控制,本文對三相交流異步電機的矢量控制系統進行了研究和分析,以高性能數字信號處理器為硬件平臺設計了基于DSP的三相交流異步電機的矢量控制系統,并分析了逆變器死區效應的產生,實現了逆變器死區的補償。 本文介紹了交流調速及其相關技術的發展,變頻調速的方案以及國內外對矢量控制的研究狀況。以三相交流異步電機在三相靜止坐標系下的數學模型為基礎,通過Clarke變換和Parke變換得到三相交流異步電機在兩相旋轉坐標系下的數學模型,并利用轉子磁場定向的方法,對該模型進行分析,設計了轉子磁鏈觀測器,以實現交流電機電流量的有效解耦,得到定子電流的轉矩分量和勵磁分量。仿照直流電機的控制方法,設計了矢量控制算法的電流與速度雙閉環控制系統。設計了以TMS320LF2407A為主控制器的硬件平臺,在此基礎上實現了矢量控制算法,論述了電壓空間矢量調制(SVPWM)的原理和方法,并對其進行了改進。最后對逆變器的死區進行了補償。 實驗表明基于轉子磁場定向的矢量控制(FOC)系統,結構簡單,電流解耦方便,動態性能好,精度較高,能夠基本滿足現代交流電機控制系統的轉矩和速度要求。

    標簽: DSP 三相交流 異步電機

    上傳時間: 2013-05-24

    上傳用戶:李彥東

  • FPGA中多標準可編程IO端口的設計.rar

    現場可編程門陣列(FPGA,Field Programmable Gate Array)是可編程邏輯器件的一種,它的出現是隨著微電子技術的發展,設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC,Application Specific Integrated Circuit).芯片,而且希望ASIC的設計周期盡可能短,最好是在實驗室里就能設計出合適的ASIC芯片,并且立即投入實際應用之中。現在,FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一,它的主要作用是提供封裝引腳到CLB之間的接口,將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路,并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能,在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言,可選的I/O資源的特性包括:IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現,該課題是成都華微電子系統有限公司FPGA大項目中的一子項,目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊;同時針對以前設計的I/O模塊不支持雙端標準的缺點,要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路,與單端標準比較,LVDS具有很多優點: (1)LVDS傳輸的信號擺幅小,從而功耗低,一般差分線上電流不超過4mA,負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小,從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化,單端信號擺幅為400mV,這樣允許輸入共模電壓從0.2V到2.2V范圍內變化,也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝,輔助Xilinx公司FPGA開發軟件ISE,設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構,它有靈活的可配置性和出色的適應能力,能支持大量的I/O標準,其中包括單端標準,也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征,這些特點可以改進和簡化系統級的設計,為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證,性能參數已達到預期標準。

    標簽: FPGA 標準 可編程

    上傳時間: 2013-05-15

    上傳用戶:shawvi

  • 基于FPGA技術的微弱GPS信號實時處理的實現.rar

    普通GPS接收機在特殊環境下,如在高樓林立的城市中心,林木遮擋的森林公路,特別是在隧道和室內環境的情況下,由于衛星信號非常微弱,載噪比(Carrier Noise Ratio,C/No)通常都在34dB-Hz以下,很難有效捕獲到衛星信號,導致無法正常定位。惡劣條件下的定位有廣闊的發展和應用前景,特別是在交通事故、火災和地震等極端環境下,快速準確定位當事者所處位置對于降低事態損失和營救受傷者是極為重要的。歐美和日本等發達國家也都制定了相應的提高惡劣條件下高靈敏度定位能力的發展政策。而高靈敏度GPS接收機定位的關鍵在于GPS微弱信號的處理。 本課題的主要研究內容是針對GPS微弱信號改進處理方法。針對傳統GPS接收機信號捕獲中的串行搜索方法提出了基于批處理的微弱信號捕獲方法,來提高低信噪比情況下微弱信號的捕獲能力,實現快速高靈敏度的準確捕獲;針對捕獲微弱信號處理大量數據導致的運算量激增,運用雙塊零拓展(Double Block Zero Padding,DBZP)處理方法減少運算量同時縮短捕獲時間。針對傳統GPS接收機延遲鎖相環跟蹤算法提出了基于卡爾曼濾波的新型捕獲算法,減小延遲鎖相環失鎖造成的信號跟蹤丟失概率,來提高惡劣環境下低信噪比信號的跟蹤能力,實現微弱信號的連續可靠跟蹤。通過提高GPS微弱信號的捕獲與跟蹤能力,進而使GPS接收機在惡劣環境下衛星信號微弱時能夠實現較好的定位與導航。 通過擬合GPS接收機實際接收到的原始數據,構造出不同載噪比的數字信號,分別對提出的針對微弱信號的捕獲與跟蹤算法進行仿真比較驗證,結果表明,對接收機后端信號處理部分作出的算法改進使得GPS接收機可以更好的處理微弱信號,并且具有較高的靈敏度和精度。文章同時針對提出的數據處理特征使用FPGA技術對算法主要的數據處理部分進行了初步的構架實現并進行了板級驗證,結果表明,利用FPGA技術可以較好的實現算法的數據處理功能。文章最后給出了結論,通過提出的基于批處理和基于DBZP方法的捕獲算法以及基于卡爾曼濾波的信號跟蹤算法,可以有效地解決微弱GPS信號處理的難題,進而實現微弱信號環境下的定位與導航。

    標簽: FPGA GPS 信號實時處理

    上傳時間: 2013-05-31

    上傳用戶:cccole0605

  • 基于FPGA的調制解調器的研究和設計.rar

    當今電子系統的設計是以大規模FPGA為物理載體的系統芯片的設計,基于FPGA的片上系統可稱為可編程片上系統(SOPC)。SOPC的設計是以知識產權核(IPCore)為基礎,以硬件描述語言為主要設計手段,借助以計算機為平臺的EDA工具進行的。 本文在介紹了FPGA與SOPC相關技術的基礎上,給出了SOPC技術開發調制解調器的方案。在分析設計軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發軟件進行SOPC(System On a Programmable Chip)設計流程后,依據調制解調算法提出了一種基于DSP Builder調制解調器的SOPC實現方案,模塊化的設計方法大大縮短了調制解調器的開發周期。 在SOPC技術開發調制解調器的過程中,用MATLAB/Simulink的圖形方式調用Altera DSP Builder和其他Simulink庫中的圖形模塊(Block)進行系統建模,在Simulink中仿真通過后,利用DSP Builder將Simulink的模型文件(.mdl)轉化成通用的硬件描述語言VHDL文件,從而避免了VHDL語言手動編寫系統的煩瑣過程,將精力集中于算法的優化上。 基于DSP Builder的開發功能,調制解調器電路中的低通濾波器可直接調用FIRIP Core,進一步提高了開發效率。 在進行編譯、仿真調試成功后,經過QuartusⅡ將編譯生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6,完成器件編程,從而給出了一種調制解調器的SOPC系統實現方案。

    標簽: FPGA 調制解調器

    上傳時間: 2013-06-24

    上傳用戶:liuchee

  • 基于FPGA的磁盤陣列控制器的硬件設計與實現.rar

    隨著存儲技術的迅速發展,存儲業務需求的不斷增長,獨立的磁盤冗余陣列可利用多個磁盤并行存取提高存儲系統的性能。磁盤陣列技術采用硬件和軟件兩種方式實現,軟件RAID(Redundant Array of Independent Disks)主要利用操作系統提供的軟件實現磁盤冗余陣列功能,對系統資源利用率高,節省成本。硬件RAID將大部分RAID功能集成到一塊硬件控制器中,系統資源占用率低,可移植性好。 分析了軟件RAID的性能瓶頸,使用硬件直接完成部分計算提高軟件RAID性能。針對RAID5采用FPGA(Field Programmable Gate Array)技術實現RAID控制器硬件設計,完成磁盤陣列啟動、數據緩存(Cache)以及數據XOR校驗等功能。基于硬件RAID的理論,提出一種基于Virtex-4的硬件RAID控制器的系統設計方案:獨立微處理器和較大容量的內存;實現RAID級別遷移,在線容量擴展,在線數據熱備份等高效、用戶可定制的高級RAID功能;利用Virtex-4內置硬PowerPC完成RAID服務器部分配置和管理工作,運行Linux操作系統、RAID管理軟件等。控制器既可以作為RAID控制卡在服務器上使用,也可作為一個獨立的系統,成為磁盤陣列的調試平臺。 隨著集成電路的發展,芯片的體積越來越小,電路的布局布線密度越來越大,信號的工作頻率也越來越高,高速電路的傳輸線效應和信號完整性問題越來越明顯。RAID控制器屬于高速電路的范疇,在印刷電路板(Printed Circuit Block, PCB)實現時分別從疊層設計、布局、電源完整性、阻抗匹配和串擾等方面考慮了信號完整性問題,并基于IBIS(I/O Buffer Information Specification)模型進行了信號完整性分析及仿真。

    標簽: FPGA 磁盤陣列 控制器

    上傳時間: 2013-04-24

    上傳用戶:jeffery

  • 基于FPGA的調制解調器

    當今電子系統的設計是以大規模FPGA為物理載體的系統芯片的設計,基于FPGA的片上系統可稱為可編程片上系統(SOPC)。SOPC的設計是以知識產權核(IPCore)為基礎,以硬件描述語言為主要設計手段,借助以計算機為平臺的EDA工具進行的。 本文在介紹了FPGA與SOPC相關技術的基礎上,給出了SOPC技術開發調制解調器的方案。在分析設計軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發軟件進行SOPC(System On a Programmable Chip)設計流程后,依據調制解調算法提出了一種基于DSP Builder調制解調器的SOPC實現方案,模塊化的設計方法大大縮短了調制解調器的開發周期。 在SOPC技術開發調制解調器的過程中,用MATLAB/Simulink的圖形方式調用Altera DSP Builder和其他Simulink庫中的圖形模塊(Block)進行系統建模,在Simulink中仿真通過后,利用DSP Builder將Simulink的模型文件(.mdl)轉化成通用的硬件描述語言VHDL文件,從而避免了VHDL語言手動編寫系統的煩瑣過程,將精力集中于算法的優化上。 基于DSP Builder的開發功能,調制解調器電路中的低通濾波器可直接調用FIRIP Core,進一步提高了開發效率。 在進行編譯、仿真調試成功后,經過QuartusⅡ將編譯生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6,完成器件編程,從而給出了一種調制解調器的SOPC系統實現方案。

    標簽: FPGA 調制解調器

    上傳時間: 2013-05-28

    上傳用戶:koulian

  • FPGA技術的微弱GPS信號實時處理

    普通GPS接收機在特殊環境下,如在高樓林立的城市中心,林木遮擋的森林公路,特別是在隧道和室內環境的情況下,由于衛星信號非常微弱,載噪比(Carrier Noise Ratio,C/No)通常都在34dB-Hz以下,很難有效捕獲到衛星信號,導致無法正常定位。惡劣條件下的定位有廣闊的發展和應用前景,特別是在交通事故、火災和地震等極端環境下,快速準確定位當事者所處位置對于降低事態損失和營救受傷者是極為重要的。歐美和日本等發達國家也都制定了相應的提高惡劣條件下高靈敏度定位能力的發展政策。而高靈敏度GPS接收機定位的關鍵在于GPS微弱信號的處理。 本課題的主要研究內容是針對GPS微弱信號改進處理方法。針對傳統GPS接收機信號捕獲中的串行搜索方法提出了基于批處理的微弱信號捕獲方法,來提高低信噪比情況下微弱信號的捕獲能力,實現快速高靈敏度的準確捕獲;針對捕獲微弱信號處理大量數據導致的運算量激增,運用雙塊零拓展(Double Block Zero Padding,DBZP)處理方法減少運算量同時縮短捕獲時間。針對傳統GPS接收機延遲鎖相環跟蹤算法提出了基于卡爾曼濾波的新型捕獲算法,減小延遲鎖相環失鎖造成的信號跟蹤丟失概率,來提高惡劣環境下低信噪比信號的跟蹤能力,實現微弱信號的連續可靠跟蹤。通過提高GPS微弱信號的捕獲與跟蹤能力,進而使GPS接收機在惡劣環境下衛星信號微弱時能夠實現較好的定位與導航。 通過擬合GPS接收機實際接收到的原始數據,構造出不同載噪比的數字信號,分別對提出的針對微弱信號的捕獲與跟蹤算法進行仿真比較驗證,結果表明,對接收機后端信號處理部分作出的算法改進使得GPS接收機可以更好的處理微弱信號,并且具有較高的靈敏度和精度。文章同時針對提出的數據處理特征使用FPGA技術對算法主要的數據處理部分進行了初步的構架實現并進行了板級驗證,結果表明,利用FPGA技術可以較好的實現算法的數據處理功能。文章最后給出了結論,通過提出的基于批處理和基于DBZP方法的捕獲算法以及基于卡爾曼濾波的信號跟蹤算法,可以有效地解決微弱GPS信號處理的難題,進而實現微弱信號環境下的定位與導航。

    標簽: FPGA GPS 信號實時處理

    上傳時間: 2013-04-24

    上傳用戶:變形金剛

  • System Generator 9.10

    System Generator 8.1。用戶將很快發現新版本帶來的全新感覺。新版本中大大增強了Block Dialog Boxes的功能,許多模塊的參數選擇功能也得到了加強。

    標簽: Generator System 9.10

    上傳時間: 2013-07-09

    上傳用戶:heminhao

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