cadense allegro pcb 15.2 new function
標簽： function cadense allegro 15.2
上傳時間： 2013-09-09
上傳用戶：jackandlee
* DESCRIPTION: DDS design BY PLD DEVICES.\r\n *\r\n * AUTHOR: Sun Yu\r\n *\r\n * HISTORY: 12/06/2002 \r\n *
標簽： DESCRIPTION DEVICES design DDS
上傳用戶：jokey075
一個關于allegro常見問題集錦,規那的很詳細 希望對大家有所幫助
標簽： allegro 集錦
上傳用戶：edisonfather
標簽： Cadence nbsp CIC 文檔
上傳時間： 2013-11-03
上傳用戶：taox
適用范圍： Cadence Allegro 15.2 Mentor CAM350 8.7
標簽： allegro gerber CAM 350
上傳時間： 2013-11-16
上傳用戶：洛木卓
15.2 已經加入了有關貫孔及銲點的Z軸延遲計算功能. 先開啟 Setup - Constraints - Electrical constraint sets 下的 DRC 選項. 點選 Electrical Constraints dialog box 下 Options 頁面 勾選 Z-Axis delay欄.
標簽： Allegro 15.2 SPB
上傳時間： 2013-10-08
上傳用戶：王慶才
Cadence Allegro印制電路板設計610，作為Allegro系統互連設計平臺的一個600系列產品，是一個完整的、高性能印制電路板設計套件。通過頂尖的技術，它為創建和編輯復雜、多層、高速、高密度的印制電路板設計提供了一個交互式、約束驅動的設計環境。它允許用戶在設計過程的任意階段定義、管理和驗證關鍵的高速信號，并能抓住今天最具挑戰性的設計問題。Allegro印制電路板設計610提高了設計效率和縮短設計周期,讓你的產品盡快進入量產。
標簽： Allegro 610 印制 電路板設計
上傳時間： 2013-10-31
上傳用戶：牧羊人8920
Trademarks: Trademarks and service marks of Cadence Design Systems, Inc. (Cadence) contained in
標簽： Allegro-Design-Editor-Tutorial_ad e_tut
上傳時間： 2014-08-09
上傳用戶：龍飛艇
基于CSMC的0.5 μmCMOS工藝，設計了一個高增益、低功耗、恒跨導軌到軌CMOS運算放大器，采用最大電流選擇電路作為輸入級，AB類結構作為輸出級。通過cadence仿真，其輸入輸出均能達到軌到軌，整個電路工作在3 V電源電壓下，靜態功耗僅為0.206 mW，驅動10pF的容性負載時，增益高達100.4 dB，單位增益帶寬約為4.2 MHz，相位裕度為63°。
標簽： CMOS 增益 低功耗 軌到軌
上傳時間： 2013-11-04
上傳用戶：xlcky
提出了一種基于gm /ID方法設計的可變增益放大器。設計基于SMIC90nmCMOS工藝模型，可變增益放大器由一個固定增益級、兩個可變增益級和一個增益控制器構成。固定增益級對輸入信號預放大，以增加VGA最大增益。VGA的增益可變性由兩個受增益控制器控制的可變增益級實現。運用gm /ID的綜合設計方法，優化了任意工作范圍內，基于gm /ID和VGS關系的晶體管設計，實現了低電壓低功耗。為得到較寬的增益范圍，應用了一種新穎的偽冪指函數。利用Cadence中spectre工具仿真，結果表明，在1.2 V的工作電壓下，具有76 dB的增益，控制電壓范圍超過0.8 V，帶寬范圍從34 MHz到183.6 MHz，功耗為0.82 mW。
標簽： gm_ID 可變增益放大器
上傳時間： 2013-11-10
上傳用戶：笨小孩
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