通過BWDSP模擬器對目前常用的幾種替換算法和大小不同的指令caCHe塊進行仿真實驗得出不同缺失率。實驗結(jié)果表明，所提出的PLRU替換算法性能高于LRU、LFU、FIFO替換算法，并使BWDSP整體性能提高到為其他三種替換算法的1.12倍左右。
標(biāo)簽： BWDSP caCHe PLRU 指令
上傳時間： 2013-11-07
上傳用戶：skfreeman
caCHe對于CPU來說非常重要，它們是處理器和內(nèi)存等數(shù)據(jù)交換的高速緩沖地帶，可以對使用過的數(shù)據(jù)和指令進行有選擇的保留，以便以后直接調(diào)用，這樣將大大提高系統(tǒng)的速度。
標(biāo)簽： caCHe
上傳時間： 2013-11-22
上傳用戶：wcl168881111111
計算機體系結(jié)構(gòu)中caCHe實現(xiàn)原理及解決方案的模擬程序.
標(biāo)簽： caCHe 計算機體系結(jié)構(gòu) 方案 模擬
上傳時間： 2015-03-29
上傳用戶：ls530720646
caCHe測試軟件，通過該小程序可以了解一些有關(guān)caCHe工作原理．
標(biāo)簽： caCHe 測試軟件
上傳時間： 2015-03-31
上傳用戶：SimonQQ
一個不錯的caCHe，不但能夠?qū)崿F(xiàn)map的所有操作，而卻具有內(nèi)嵌的集群支持能力
上傳時間： 2015-05-12
上傳用戶：從此走出陰霾
使用LRU方法更新caCHe 結(jié)合數(shù)據(jù)結(jié)構(gòu)的相關(guān)知識，使用LRU的策略，對一組訪問序列進行內(nèi)部的caCHe更新 并附實驗報告
標(biāo)簽： caCHe LRU 更新 數(shù)據(jù)結(jié)構(gòu)
上傳時間： 2014-08-14
上傳用戶：nanxia
Arm9指令caCHe緩存模塊的verilog代碼，對一些做ARM硬件開發(fā)的朋友有參考價值。
標(biāo)簽： verilog caCHe Arm9 指令
上傳時間： 2015-06-12
上傳用戶：一諾88
caCHe: you will be given a char at will and you should simulate the computer s memory and caCHe .
標(biāo)簽： caCHe will and you
上傳時間： 2015-07-04
上傳用戶：CSUSheep
Blakcfin processor caCHe code example
標(biāo)簽： processor Blakcfin example caCHe
上傳時間： 2015-07-20
上傳用戶：wfeel
一個32位微處理器的verilog實現(xiàn)源代脈,采用5級流水線和caCHe技術(shù).
標(biāo)簽： verilog caCHe 微處理器 流水線
上傳時間： 2014-12-21
上傳用戶：yimoney
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