通過(guò)VERILOG HDL語(yǔ)言使用CPLD連接PS2鍵盤.
標(biāo)簽： VERILOG CPLD HDL PS2
上傳時(shí)間： 2013-08-21
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cpld max7128s控制3路AD7472采樣，希望對(duì)大家有幫助。
標(biāo)簽： 7128s cpld 7128 7472
上傳時(shí)間： 2013-08-22
上傳用戶：hn891122
使用CPLD仿真8088核,內(nèi)有源程序和說(shuō)明,可以參考
標(biāo)簽： CPLD 8088 仿真 有源
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CPLD數(shù)字電路設(shè)計(jì)——使用MAX+plusⅡ入門篇.rar 不能錯(cuò)過(guò)的書籍
標(biāo)簽： CPLD plus MAX
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一種基于CPLD 的PWM控制電路設(shè)計(jì)，僅供參考
標(biāo)簽： CPLD PWM 控制 電路設(shè)計(jì)
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5分鐘學(xué)會(huì)使用CPLD,經(jīng)典資料，有想學(xué)習(xí)CPLD的朋友有福了
標(biāo)簽： CPLD 分
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用CPLD實(shí)現(xiàn)DSP與PLX9054之間的連接
標(biāo)簽： CPLD 9054 DSP PLX
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基于 MAXII 的CPLD 對(duì)mobil dram 的讀寫操作，內(nèi)帶源碼和測(cè)試激勵(lì)文件
標(biāo)簽： MAXII mobil CPLD dram
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基于 MAXII CPLD的對(duì)Compact_Flash的讀寫，擦出操作，內(nèi)附測(cè)試激勵(lì)文件
標(biāo)簽： Compact_Flash MAXII CPLD 讀寫
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介紹FPGA/CPLD設(shè)計(jì)的指導(dǎo)性原則，如FPGA設(shè)計(jì)的基本原則，基本思想，基本操作技巧，常用模塊等。
標(biāo)簽： FPGA CPLD
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