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eclipse配置

關(guān)于CADENCE文件配置

關(guān)于CADENCE文件配置，共有四個部分。

標(biāo)簽： CADENCE

上傳時間： 2013-09-05

上傳用戶：sqq
探討PROE的配置文件——系統(tǒng)配置文件config.pro

PROE的配置文件讓不少初學(xué)者感到煩惱，盡管不少教材里都會提到關(guān)于PROE的配置文件。但大多數(shù)顯得過于理論化，而不便于初學(xué)者理解，可操作性不強(qiáng)。本文力求以通俗的語言結(jié)合實(shí)際運(yùn)用向大家介紹PROE的配置文件，希望能給各位帶來幫助。

標(biāo)簽： config PROE pro 系統(tǒng)配置

上傳時間： 2013-11-16

上傳用戶：drink！
GC6016配置與應(yīng)用分析

GC6016 是TI針對數(shù)字直放站應(yīng)用而推出的一款數(shù)字中頻處理芯片。本文主要描述了GC6016 的加載流程，初始化配置，數(shù)據(jù)采集配置，以及和上下游芯片的配合調(diào)試方法。

標(biāo)簽： 6016 GC 分

上傳時間： 2014-12-24

上傳用戶：kongrong
變壓器的零序保護(hù)的配置原則

　　變壓器的零序保護(hù)的配置原則是什么?答：(1)中性點(diǎn)直接接地電網(wǎng)的變壓器應(yīng)裝設(shè)零序(接地)保護(hù)作為變壓器主保護(hù)的后備保護(hù)和相鄰元件接地短路的后備保護(hù)。　　(2)當(dāng)變壓器中性點(diǎn)同時裝設(shè)有避雷器和放電間隙時，應(yīng)裝設(shè)零序電流保護(hù)作為變壓器中性點(diǎn)直接接地運(yùn)行時的保護(hù)，并增設(shè)一套反映間隙放電電流的零序電流保護(hù)和一套零序電壓保護(hù)作為變壓器中性點(diǎn)不接地運(yùn)行時的保護(hù)。后者作為間隙放電電流的零序電流保護(hù)的后備保護(hù)。　　(3)自耦變壓器的零序保護(hù)的不能接在中性線回路的電流互感器上，應(yīng)接在本側(cè)的零序電流濾過器上，并且高、中壓側(cè)加裝方向元件，以保證選擇性。

標(biāo)簽： 變壓器零序保護(hù)

上傳時間： 2013-12-03

上傳用戶：lhll918
ATMEGA16L熔絲配置詳解

ATMEGA16L熔絲配置詳解

標(biāo)簽： ATMEGA 16L 16 熔絲配置

上傳時間： 2013-10-09

上傳用戶：lixqiang
PIC18的配置位學(xué)習(xí)

關(guān)于PIC18F的配置位，非常有用

標(biāo)簽： PIC 18

上傳時間： 2013-10-09

上傳用戶：南國時代
C8051F系列配置工具

c8051f系列單片機(jī)配置工具，方便對c8051f系列單片機(jī)內(nèi)部各個寄存器進(jìn)行配置。親測非常的方便。

標(biāo)簽： C8051F 配置工具

上傳時間： 2013-11-01

上傳用戶：tyler
AVR STUDIO熔絲配置

本文介紹AVR Studio環(huán)境下對AVR芯片熔絲的配置，AVR單片機(jī)的熔絲配置項(xiàng)比較多也比較復(fù)雜，好在AVR Studio將各種配置進(jìn)行了組合，這樣配置起來就方便多了。基本上不需要查數(shù)據(jù)手冊，能看懂一點(diǎn)英文就可以根據(jù)功能需求直接配置了。下面在ATmega16芯片基礎(chǔ)上進(jìn)行說明，不同芯片之間可能有一點(diǎn)不同。

標(biāo)簽： STUDIO AVR 熔絲配置

上傳時間： 2014-12-27

上傳用戶：蒼山觀海
NDAM 配置軟件 V2.07

NDAM 配置軟件 V2.07 安裝程序

標(biāo)簽： NDAM 2.07 軟件

上傳時間： 2014-01-12

上傳用戶：123456wh
基于單片機(jī)的現(xiàn)場可編程門陣列的配置

本文介紹了基于SRAM 查找表的現(xiàn)場可重配置FPGA 的結(jié)構(gòu)和原理，及其配置方法，通過對多種配置方法的比較，提出了由單片機(jī)和EPROM 存儲器組成的串行配置方式。這種方式結(jié)構(gòu)簡單，設(shè)計保密性好，易于升級，降低設(shè)計成本。在大規(guī)模可編程邏輯器件出現(xiàn)以前，把器件焊接在電路板上是設(shè)計數(shù)字系統(tǒng)的最后一步。當(dāng)設(shè)計存在問題并解決后，設(shè)計者往往不得不重新設(shè)計印制電路板。設(shè)計周期長，設(shè)計效率低。CPLD 、FPGA 出現(xiàn)后，利用其在系統(tǒng)可編程或可重配置功能，設(shè)計者可以在進(jìn)行邏輯設(shè)計而未進(jìn)行電路設(shè)計時就把CPLD、FPGA 焊接在電路板上，然后在設(shè)計調(diào)試時可一次次隨心所欲的改變電路的硬件邏輯關(guān)系，而不用改變電路板的結(jié)構(gòu)。

標(biāo)簽： 單片機(jī) 現(xiàn)場可編程門陣列

上傳時間： 2013-10-29

上傳用戶：born2007