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egg源碼加處理方法

  • 基于FPGA的電力系統(tǒng)諧波檢測(cè)方法

    隨著技術(shù)的飛速發(fā)展,電力電子裝置如變頻設(shè)備、變流設(shè)備等容量日益擴(kuò)大,數(shù)量日益增多。由于非線性器件的廣泛使用,使得電網(wǎng)中的諧波污染日益嚴(yán)重,給電力系統(tǒng)和各類(lèi)用電設(shè)備帶來(lái)危害,輕則增加能耗,縮短設(shè)備使用壽命,重則造成用電事故,影響安全生產(chǎn),電力諧波已經(jīng)成為電力系統(tǒng)的公害。除了傳統(tǒng)的濾波方法,例如,無(wú)源濾波、改變系統(tǒng)的拓補(bǔ)結(jié)構(gòu)來(lái)抑制諧波外,人們已廣泛應(yīng)用有源濾波器(APF)來(lái)消除注入電網(wǎng)的諧波,而實(shí)現(xiàn)有源濾波策略的前提就是能夠?qū)崟r(shí)、精確地檢測(cè)出諧波電流。諧波檢測(cè)是諧波研究中的一個(gè)重要的分支,是解決其他相關(guān)諧波問(wèn)題的基礎(chǔ),因此進(jìn)行諧波檢測(cè)的研究具有重要的理論意義和實(shí)用價(jià)值。設(shè)計(jì)一種精度高、實(shí)時(shí)性好且適用范圍寬的諧波電流檢測(cè)方法是國(guó)內(nèi)外眾多學(xué)者致力研究的目標(biāo)。 本文主要從諧波檢測(cè)理論和實(shí)現(xiàn)方法上探討了高精度、高實(shí)時(shí)性諧波檢測(cè)數(shù)字系統(tǒng)的相關(guān)問(wèn)題。論文中闡述了電力系統(tǒng)諧波的相關(guān)概念和產(chǎn)生原理,并分析了電力諧波的特點(diǎn),對(duì)國(guó)內(nèi)外各種諧波檢測(cè)方法進(jìn)行了分析和研究。在檢測(cè)理論上,本文采用FFT理論來(lái)計(jì)算諧波含量,研究了Radix-2 FFT在諧波檢測(cè)中的應(yīng)用,綜述了可編程元器件的發(fā)展過(guò)程、工藝發(fā)展及目前的應(yīng)用情況,并介紹了一種主流硬件描述語(yǔ)言VHDL。最后以FPGA芯片XC2S200為硬件平臺(tái),以ISE6.0為軟件平臺(tái),利用VHDL語(yǔ)言描述的方式實(shí)現(xiàn)了512點(diǎn)16Bit的快速傅立葉變換系統(tǒng),并進(jìn)行了仿真、綜合等工作。仿真結(jié)果表明其計(jì)算結(jié)果達(dá)到了一定的精度,運(yùn)行速度可以滿足一般實(shí)時(shí)信號(hào)處理的要求。

    標(biāo)簽: FPGA 電力系統(tǒng) 檢測(cè)方法 諧波

    上傳時(shí)間: 2013-06-02

    上傳用戶:moshushi0009

  • 基于FPGA的紅外圖像非均勻性校正方法

    隨著紅外焦平面陣列的不斷發(fā)展,紅外技術(shù)的應(yīng)用范圍將越來(lái)越廣泛。焦平面面陣探測(cè)器的一個(gè)最大的缺點(diǎn)是固有的非均勻性。本文首先介紹了紅外熱成像技術(shù)的發(fā)展,討論了紅外焦平面陣列的基本原理和工作方式,分析了紅外非均勻性產(chǎn)生的原因。其次研究了幾種主要的非均勻校正方法以及焦平面陣列元的盲元檢測(cè)和補(bǔ)償?shù)姆椒ǎ瑢?duì)紅外圖像處理技術(shù)做了研究。 本文研究的探測(cè)器是法國(guó)ULIS公司的320×240非制冷微測(cè)輻射熱計(jì)焦平面陣列探測(cè)器。主要研究對(duì)其輸出信號(hào)進(jìn)行非均勻性校正和圖像增強(qiáng)。最后針對(duì)這一課題編寫(xiě)了基于FPGA的兩點(diǎn)校正、兩點(diǎn)加一點(diǎn)校正、全局非均勻校正算法和紅外圖像直方圖均衡化增強(qiáng)程序,并對(duì)三種校正方法做了比較。

    標(biāo)簽: FPGA 紅外圖像 非均勻性校正

    上傳時(shí)間: 2013-08-03

    上傳用戶:qq442012091

  • 多種高效編碼和調(diào)制技術(shù)

    本論文介紹了幾種編碼和調(diào)制技術(shù)的基本原理和課題的總體實(shí)現(xiàn)結(jié)構(gòu),重點(diǎn)分析和討論了滾降系數(shù)可調(diào)的成形濾波、內(nèi)插技術(shù)以及濾波器中乘法器、加法器的實(shí)現(xiàn)方法。通過(guò)外部控制器可對(duì)FPGA內(nèi)部設(shè)計(jì)的多項(xiàng)參數(shù)進(jìn)行設(shè)置,可支持32.000kbps~4.096Mbps范圍內(nèi)的多速率數(shù)據(jù)傳輸,適用于各種信道限帶性能要求的傳輸系統(tǒng)。本論文使用一片F(xiàn)PGA芯片實(shí)現(xiàn)了信道編碼(包括數(shù)據(jù)加擾、差分編碼、卷積碼、RS碼、交織等)、多種調(diào)制方式(BPSK、QPSK、π/4-QPSK、TC8PSK、16QAM)、成形濾波器、多級(jí)內(nèi)插、上變頻器、具有連續(xù)/突發(fā)信號(hào)模式的數(shù)據(jù)源。將本論文的成果移植到某單位的信號(hào)源研制平臺(tái),基本上可以滿足現(xiàn)階段研制和維修解調(diào)設(shè)備對(duì)信號(hào)源的需求,因此具有較高的使用價(jià)值。

    標(biāo)簽: 編碼 調(diào)制技術(shù)

    上傳時(shí)間: 2013-07-27

    上傳用戶:feichengweoayauya

  • 基于FPGA的有源濾波器系統(tǒng)硬件設(shè)計(jì)

    由于各種非線性電力電子裝置的和功率開(kāi)關(guān)器件的廣泛應(yīng)用產(chǎn)生了諧波。隨著對(duì)電能質(zhì)量要求的不斷提高,各種治理諧波的電力電子裝置就產(chǎn)生了。諧波治理的方法主要有無(wú)源濾波技術(shù)和有源電力濾波器技術(shù)。傳統(tǒng)的方法采用LC 無(wú)源濾波器,與無(wú)源濾波器相比有源電力濾波器具有很大的優(yōu)越性,因此越來(lái)越多的應(yīng)用到治理諧波污染中。隨著以DSP 和FPGA 的高速發(fā)展,以全數(shù)字化控制技術(shù)實(shí)現(xiàn)的有源電力濾波器必將更多的應(yīng)用到諧波裝置中去。本文深入分析了諧波治理的研究背景意義和有源濾波器的研究現(xiàn)狀和發(fā)展趨勢(shì)。介紹了有源濾波器的基本的工作原理;分類(lèi);諧波的檢測(cè)方法和控制策略,在各個(gè)方法的比較上選用基于瞬時(shí)無(wú)功功率理論的諧波檢測(cè)法對(duì)諧波電流進(jìn)行了檢測(cè)。并提出了一種基于 DSP 及FPGA 控制的有源電力濾波器的設(shè)計(jì)方案,重點(diǎn)研究了三相并聯(lián)型有源濾波器的控制系統(tǒng)及硬件設(shè)計(jì)。本文還對(duì)系統(tǒng)的功率器件進(jìn)行了分析并選用IGBT 作為其開(kāi)關(guān)器件。設(shè)計(jì)了IGBT 驅(qū)動(dòng)及保護(hù)電路,利用理論分析和仿真結(jié)果設(shè)定了系統(tǒng)直流側(cè)電容和輸出電感的參數(shù)。對(duì)整個(gè)系統(tǒng)進(jìn)行了Simulink 仿真實(shí)驗(yàn),選用DSP 和和FPGA 作為核心處理芯片,DSP 用來(lái)采集數(shù)據(jù)并檢測(cè)諧波,F(xiàn)PGA 用來(lái)實(shí)現(xiàn)PWM 脈沖的輸出。設(shè)計(jì)并調(diào)試出非線性負(fù)載,傳感器采集,電流電壓調(diào)理電路,主電路,過(guò)零檢測(cè)電路,IGBT 的驅(qū)動(dòng)及吸收緩沖電路。并在此基礎(chǔ)上搭建出了試驗(yàn)平臺(tái)。給出了DSP 及FPGA 的軟件設(shè)計(jì)思想和流程。

    標(biāo)簽: FPGA 有源濾波器 硬件設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:youth25

  • 三相電壓源型PWM整流器的DSP控制

    ·摘要:描述了三相電壓源型PWM整流器的工作原理,基于整流器網(wǎng)側(cè)電流矢量推導(dǎo)出同步旋轉(zhuǎn)坐標(biāo)系下系統(tǒng)的數(shù)學(xué)模型,給出了一種電流前饋解耦控制算法。同時(shí)詳細(xì)介紹了基于電流前饋解耦的PWM整流器雙環(huán)控制系統(tǒng)設(shè)計(jì)方法。并且應(yīng)用TMS320LF2407A建立了PWM整流器的DSP數(shù)字化實(shí)驗(yàn)系統(tǒng)。實(shí)驗(yàn)結(jié)果表明,該整流器能獲得單位功率因數(shù)的正弦輸入電流、穩(wěn)定的直流輸出電壓和快速的動(dòng)態(tài)響應(yīng)。

    標(biāo)簽: PWM DSP 三相 電壓源

    上傳時(shí)間: 2013-06-03

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  • 全加器verilog程序

    四位全加器verilog源碼,簡(jiǎn)單實(shí)用!歡迎下載

    標(biāo)簽: verilog 全加器 程序

    上傳時(shí)間: 2013-05-16

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  • 一種基于FPGA 實(shí)現(xiàn)的全并行結(jié)構(gòu)FFT 設(shè)計(jì)方法

    一種基于FPGA 實(shí)現(xiàn)的全并行結(jié)構(gòu)FFT 設(shè)計(jì)方法,采用全并行加流水結(jié)構(gòu), 可在一個(gè)時(shí)鐘節(jié)拍內(nèi)完成32 點(diǎn)FFT 運(yùn)算的功能, 設(shè)計(jì)最高運(yùn)算速度可達(dá)11ns

    標(biāo)簽: FPGA FFT 并行 設(shè)計(jì)方法

    上傳時(shí)間: 2013-08-16

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  • 采用FPGA模擬高動(dòng)態(tài)GPS信號(hào)源中的C/A碼產(chǎn)生器

    本文:采用了FPGA方法來(lái)模擬高動(dòng)態(tài)(Global Position System GPS)信號(hào)源中的C/A碼產(chǎn)生器。C/A碼在GPS中實(shí)現(xiàn)分址、衛(wèi)星信號(hào)粗捕和精碼(P碼)引導(dǎo)捕獲起著重要的作用,通過(guò)硬件描述語(yǔ)言VERILOG在ISE中實(shí)現(xiàn)電路生成,采用MODELSIM、SYNPLIFY工具分別進(jìn)行仿真和綜合。

    標(biāo)簽: FPGA GPS 模擬 動(dòng)態(tài)

    上傳時(shí)間: 2013-08-31

    上傳用戶:pwcsoft

  • fpga實(shí)現(xiàn)CAN總線控制器源碼(含詳細(xì)說(shuō)明)

    fpga實(shí)現(xiàn)CAN總線控制器源碼,每個(gè)項(xiàng)目都有說(shuō)明文件,介紹使用方法。

    標(biāo)簽: fpga CAN 總線控制器 源碼

    上傳時(shí)間: 2013-08-31

    上傳用戶:1079836864

  • 制作CPLD電路實(shí)驗(yàn)板的方法及步驟

    本文詳細(xì)介紹了制作電路板的方法及步驟.\r\n實(shí)驗(yàn)板的功能\r\n這個(gè)實(shí)驗(yàn)板可以做如下實(shí)驗(yàn):\r\n1.可以進(jìn)行運(yùn)算器(加、減、乘和除法)、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實(shí)驗(yàn)\r\n2.可以進(jìn)行觸發(fā)器、寄存器、計(jì)數(shù)器和一般時(shí)序電路的實(shí)驗(yàn)\r\n3.可以進(jìn)行頻率計(jì)電路、時(shí)鐘電路、計(jì)時(shí)電路、交通燈等復(fù)雜數(shù)字系統(tǒng)的實(shí)驗(yàn)\r\n4.加擴(kuò)展板可以進(jìn)行A/D、D/A、串行E2ROM和8031單片機(jī)等方面的實(shí)驗(yàn)\r\n

    標(biāo)簽: CPLD 電路 實(shí)驗(yàn)板

    上傳時(shí)間: 2013-09-01

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