詳細(xì)的說(shuō)明了FPGA設(shè)計(jì)的整個(gè)流程\r\nFPGA設(shè)計(jì)全流程Modelsim>>Synplify.Pro>>ISE
標(biāo)簽： Modelsim Synplify FPGA ISE
上傳時(shí)間： 2013-08-09
上傳用戶：hzakao
基于DAC0832的示波器顯示電路(FPGA)
標(biāo)簽： 0832 FPGA DAC 示波器
上傳用戶：wfeel
基于DSP＋FPGA的實(shí)時(shí)圖像識(shí)別系統(tǒng)硬件與算法設(shè)計(jì)
標(biāo)簽： FPGA DSP 實(shí)時(shí)圖像 識(shí)別系統(tǒng)
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FPGA實(shí)現(xiàn) DDS_講的非常詳細(xì),師兄的一片論文
標(biāo)簽： FPGA DDS
上傳用戶：caixiaoxu26
如何使用ISE和FPGA使用指南里面附帶許多實(shí)驗(yàn)
標(biāo)簽： FPGA ISE 如何使用 使用指南
上傳用戶：lml1234lml
用于USB20芯片CY7C68013和FPGA之間的通信
標(biāo)簽： C68013 68013 FPGA USB
上傳用戶：wmwai1314
VHDL 高速基于分布式濾波器FPGA設(shè)計(jì)論文
標(biāo)簽： VHDL FPGA 分布式 濾波器
上傳用戶：qwerasdf
FPGA&CPLD數(shù)字電路設(shè)計(jì) 數(shù)字濾波電路 設(shè)計(jì)
標(biāo)簽： FPGA CPLD 數(shù)字 電路設(shè)計(jì)
上傳用戶：文993
介紹樂(lè)關(guān)于fpga一些使用例子，對(duì)fpga的一些開(kāi)發(fā)和使用做樂(lè)介紹，
標(biāo)簽： fpga
上傳用戶：bvdragon
FPGA之間的LVDS傳輸，采用serdes接口，傳輸速率達(dá)到400m
標(biāo)簽： FPGA LVDS 傳輸
上傳用戶：hoperingcong
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