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fpga-jpeg-<b>VeriLog</b>

< B語(yǔ)言與方法：實(shí)用形式化開發(fā)指南>> 本書介紹了B抽象機(jī)符號(hào)語(yǔ)言以及用于支持形式化規(guī)格說(shuō)明和高集成系統(tǒng)開發(fā)的方掛。首先

< B語(yǔ)言與方法：實(shí)用形式化開發(fā)指南>> 本書介紹了B抽象機(jī)符號(hào)語(yǔ)言以及用于支持形式化規(guī)格說(shuō)明和高集成系統(tǒng)開發(fā)的方掛。首先，介紹了B 語(yǔ)言的發(fā)展歷史及與其他語(yǔ)言的關(guān)系，然后，從集合、序列等基本數(shù)學(xué)符號(hào)表示到B 語(yǔ)言的結(jié)構(gòu)化機(jī)制，再到它所支持的大型程序設(shè)計(jì)方法，全面地介細(xì)了B 符號(hào)語(yǔ)言的描述方法。

標(biāo)簽： gt 語(yǔ)言 lt 開發(fā)指南

上傳時(shí)間： 2014-11-29

上傳用戶：康郎
uclinux 中如何使用b核的文章,經(jīng)典

uclinux 中如何使用b核的文章,經(jīng)典

標(biāo)簽： uclinux 如何使用

上傳時(shí)間： 2016-04-11

上傳用戶：jqy_china
采用基于B/S結(jié)構(gòu)進(jìn)行開發(fā)學(xué)生管理信息系統(tǒng),本系統(tǒng)采用Servlet+Jsp+JavaBean+MySQL 的設(shè)計(jì)方式

采用基于B/S結(jié)構(gòu)進(jìn)行開發(fā)學(xué)生管理信息系統(tǒng),本系統(tǒng)采用Servlet+Jsp+JavaBean+MySQL 的設(shè)計(jì)方式

標(biāo)簽： JavaBean Servlet MySQL Jsp

上傳時(shí)間： 2013-11-26

上傳用戶：yuchunhai1990
該系統(tǒng)是一個(gè)B/S結(jié)構(gòu)的公司定飯系統(tǒng),整套軟件由JSP編制,希望大家能夠多提寶貴意見,但請(qǐng)不要將它應(yīng)用于商業(yè)環(huán)境,如實(shí)在要使用的話,請(qǐng)與作者聯(lián)系!(使用此系統(tǒng)無(wú)比要有ORACLE8i以上版本數(shù)據(jù)庫(kù)!)

該系統(tǒng)是一個(gè)B/S結(jié)構(gòu)的公司定飯系統(tǒng),整套軟件由JSP編制,希望大家能夠多提寶貴意見,但請(qǐng)不要將它應(yīng)用于商業(yè)環(huán)境,如實(shí)在要使用的話,請(qǐng)與作者聯(lián)系!(使用此系統(tǒng)無(wú)比要有ORACLE8i以上版本數(shù)據(jù)庫(kù)!)

標(biāo)簽： ORACLE8i JSP 家

上傳時(shí)間： 2014-01-25

上傳用戶：壞壞的華仔
全新的B/S結(jié)構(gòu)開發(fā)方式,用純JS+HTML實(shí)現(xiàn)了類似C/S的強(qiáng)大瀏覽器交互,查詢及分頁(yè)瀏覽速度提高幾倍,可以成批錄入數(shù)據(jù),有完整的數(shù)據(jù)庫(kù)表訪問和純web打印

全新的B/S結(jié)構(gòu)開發(fā)方式,用純JS+HTML實(shí)現(xiàn)了類似C/S的強(qiáng)大瀏覽器交互,查詢及分頁(yè)瀏覽速度提高幾倍,可以成批錄入數(shù)據(jù),有完整的數(shù)據(jù)庫(kù)表訪問和純web打印

標(biāo)簽： HTML web JS 方式

上傳時(shí)間： 2014-01-20

上傳用戶：lacsx
提出了利用FPGA的現(xiàn)場(chǎng)可編程以及可并行處理的特性

提出了利用FPGA的現(xiàn)場(chǎng)可編程以及可并行處理的特性，對(duì)基于人工神經(jīng)網(wǎng)絡(luò)的圖像處理結(jié)構(gòu)進(jìn)行自動(dòng)生成的一種技術(shù)。作者：Andre B. Soares, Altamiro A. Susin，Leticia V. Guimaraes

標(biāo)簽： FPGA 現(xiàn)場(chǎng)可編程并行處理

上傳時(shí)間： 2016-04-14

上傳用戶：gxf2016
具備GMII接口和ARP協(xié)議功能的千兆以太網(wǎng)控制器。經(jīng)過Xilinx SPATAN-III FPGA驗(yàn)證, Verilog描述

具備GMII接口和ARP協(xié)議功能的千兆以太網(wǎng)控制器。經(jīng)過Xilinx SPATAN-III FPGA驗(yàn)證, Verilog描述

標(biāo)簽： SPATAN-III Verilog Xilinx GMII

上傳時(shí)間： 2013-12-17

上傳用戶：manlian
QTP全名Quick Test Professional,是MI公司出品的一款測(cè)試工具.它的優(yōu)點(diǎn)是使用方便,功能強(qiáng)大并且可以通過與測(cè)試管理工具的互連達(dá)到自動(dòng)化功能測(cè)試的目的. QTP是專門針對(duì)B/S模

QTP全名Quick Test Professional,是MI公司出品的一款測(cè)試工具.它的優(yōu)點(diǎn)是使用方便,功能強(qiáng)大并且可以通過與測(cè)試管理工具的互連達(dá)到自動(dòng)化功能測(cè)試的目的. QTP是專門針對(duì)B/S模式的測(cè)試工具.它具有:識(shí)別能力強(qiáng),回放精確等優(yōu)點(diǎn),是進(jìn)行B/S模式下功能測(cè)試的首選工具

標(biāo)簽： Professional QTP Quick Test

上傳時(shí)間： 2016-04-21

上傳用戶：tyler
uart串口通信程序用VERILOG HDL　編寫　可以有效應(yīng)用于FPGA上

uart串口通信程序用VERILOG HDL　編寫　可以有效應(yīng)用于FPGA上

標(biāo)簽： VERILOG uart FPGA HDL

上傳時(shí)間： 2014-01-04

上傳用戶：頂?shù)弥?/p>
LCD的驅(qū)動(dòng)程序　用verilog HDL 編寫　可以用于FPGA上　經(jīng)過測(cè)試　可以使用

LCD的驅(qū)動(dòng)程序　用verilog HDL 編寫　可以用于FPGA上　經(jīng)過測(cè)試　可以使用

標(biāo)簽： verilog FPGA LCD HDL

上傳時(shí)間： 2013-11-29

上傳用戶：頂?shù)弥?/p>

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