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Programming Windows程式開發(fā)設(shè)計(jì)指南
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這個程式可以用來觀察其他程式的VCL組態(tài)、記憶體內(nèi)容。幫助設(shè)計(jì)時的runtime debug。 當(dāng)然也可以用來看別人程式中用了什麼元件、設(shè)計(jì)了什麼property
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FastReport3.0程序設(shè)計(jì)手冊,愛好編程的朋友可以參考本手冊.
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一本對象程序設(shè)計(jì) For Delphi的書籍,內(nèi)容詳細(xì)講解了Delphi的面向?qū)幊谭椒ㄅc技巧!
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詳細(xì)介紹了開關(guān)電源的設(shè)計(jì),再勵磁回路串接約為勵磁繞組電阻值10倍的附加電阻來構(gòu)成閉合電路
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設(shè)計(jì)一個比例控制器去對閉迴路轉(zhuǎn)移函數(shù)做控制。
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大型電子製造業(yè)后臺數(shù)據(jù)庫的詳細(xì)設(shè)計(jì)!絕對好東西!(部分刪減)
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設(shè)計(jì)VHDL24小時的時鐘
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Oracle9iデータベース物理設(shè)計(jì)方針表領(lǐng)域編
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PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率
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