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  • TCP-IP技術(shù)大全 PDF

    TCP-IP技術(shù)大全 PDF

    標(biāo)簽: TCP-IP 技術(shù)大全

    上傳時(shí)間: 2013-04-15

    上傳用戶(hù):eeworm

  • 移動(dòng)IP技術(shù)指南 PDF

    移動(dòng)IP技術(shù)指南 PDF

    標(biāo)簽: 移動(dòng) IP技術(shù)

    上傳時(shí)間: 2013-06-23

    上傳用戶(hù):eeworm

  • TCP-IP技術(shù)大全-71.6M-PDF.zip

    專(zhuān)輯類(lèi)-網(wǎng)絡(luò)及電腦相關(guān)專(zhuān)輯-114冊(cè)-4.31G TCP-IP技術(shù)大全-71.6M-PDF.zip

    標(biāo)簽: TCP-IP M-PDF 71.6 zip

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):jiiszha

  • TCP-IP詳解.CISCO詳解-273M.zip

    專(zhuān)輯類(lèi)-網(wǎng)絡(luò)及電腦相關(guān)專(zhuān)輯-114冊(cè)-4.31G TCP-IP詳解.CISCO詳解-273M.zip

    標(biāo)簽: TCP-IP CISCO 273 zip

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):關(guān)外河山

  • ip地址管理與子網(wǎng)劃分-5.3M-PDF.zip

    專(zhuān)輯類(lèi)-網(wǎng)絡(luò)及電腦相關(guān)專(zhuān)輯-114冊(cè)-4.31G ip地址管理與子網(wǎng)劃分-5.3M-PDF.zip

    標(biāo)簽: M-PDF 5.3 zip ip地址

    上傳時(shí)間: 2013-07-21

    上傳用戶(hù):bg6jsx

  • 高級(jí)網(wǎng)絡(luò)操作系統(tǒng)及其應(yīng)用——TCP~IP協(xié)議與分組無(wú)線網(wǎng)-10.1M-PDF.pdf

    專(zhuān)輯類(lèi)-網(wǎng)絡(luò)及電腦相關(guān)專(zhuān)輯-114冊(cè)-4.31G 高級(jí)網(wǎng)絡(luò)操作系統(tǒng)及其應(yīng)用——TCP~IP協(xié)議與分組無(wú)線網(wǎng)-10.1M-PDF.pdf

    標(biāo)簽: M-PDF 10.1 TCP

    上傳時(shí)間: 2013-06-22

    上傳用戶(hù):hehuaiyu

  • 移動(dòng)IP技術(shù)指南-7.7M-PDF.zip

    專(zhuān)輯類(lèi)-網(wǎng)絡(luò)及電腦相關(guān)專(zhuān)輯-114冊(cè)-4.31G 移動(dòng)IP技術(shù)指南-7.7M-PDF.zip

    標(biāo)簽: M-PDF 7.7 zip 移動(dòng)

    上傳時(shí)間: 2013-06-17

    上傳用戶(hù):huyanju

  • USB20設(shè)備控制器IP核的設(shè)計(jì)與FPGA驗(yàn)證.rar

    隨著計(jì)算機(jī)及其外圍設(shè)備的發(fā)展,傳統(tǒng)的并行接口和串行接口在靈活性和接口擴(kuò)展等方面存在的缺陷愈來(lái)愈不可回避,并逐漸成為計(jì)算機(jī)通信的瓶頸。在這種情況下,通用串行總線(Universal Serial Bus,USB)誕生了。USB由于具有傳輸速率高、價(jià)格便宜、使用方便、靈活性高、支持熱插拔、接口標(biāo)準(zhǔn)化和易于擴(kuò)展等優(yōu)點(diǎn),目前已經(jīng)成為計(jì)算機(jī)外設(shè)接口的主流技術(shù),在計(jì)算機(jī)外圍設(shè)備和消費(fèi)類(lèi)電子領(lǐng)域正獲得越來(lái)越多的應(yīng)用。 @@ 本文基于USB2.0協(xié)議規(guī)范,設(shè)計(jì)了一款支持高速和全速傳輸?shù)腢SB2.0設(shè)備控制器IP核。文中著重介紹了這款設(shè)備控制器IP核的設(shè)計(jì)和FPGA驗(yàn)證工作,詳細(xì)研究并分析了USB2.0規(guī)范,根據(jù)規(guī)范提出了一種USB2.0設(shè)備控制器整體構(gòu)架方案,描述了各個(gè)功能子模塊硬件電路的功能及實(shí)現(xiàn)。從可重用的角度出發(fā),對(duì)設(shè)備控制器模塊進(jìn)行優(yōu)化設(shè)計(jì),增加多個(gè)靈活的配置選項(xiàng),根據(jù)不同的應(yīng)用對(duì)硬件進(jìn)行配置,使其在滿(mǎn)足要求的情況下去除冗余電路,以減少占用面積和功耗,從而使其靈活地應(yīng)用于各種USB系統(tǒng)。本文還研究了IP核的驗(yàn)證方法,并對(duì)所設(shè)計(jì)的USB2.0設(shè)備控制器建立了功能完備的ModelSim仿真驗(yàn)證環(huán)境,搭建了FPGA硬件驗(yàn)證平臺(tái),設(shè)計(jì)了具有AHB接口的設(shè)備控制器和帶有8051的設(shè)備控制器,并分別在FPGA平臺(tái)上進(jìn)行了功能驗(yàn)證。 @@ 本文所設(shè)計(jì)的USB2.0設(shè)備控制器IP核可配置性高,使用者可以自由配置所需端點(diǎn)的個(gè)數(shù)以及每個(gè)端點(diǎn)類(lèi)型等,可以集成于多種USB系統(tǒng)中,適于各類(lèi)USB設(shè)備的開(kāi)發(fā)。本課題所取得的成果為USB2.0設(shè)備類(lèi)的研究和開(kāi)發(fā)積累了經(jīng)驗(yàn),并為后來(lái)實(shí)驗(yàn)室某項(xiàng)目測(cè)試芯片的USB數(shù)據(jù)采集提供了參考方案,也為未來(lái)USB3.0接口IP核的開(kāi)發(fā)和應(yīng)用奠定了基礎(chǔ)。 @@關(guān)鍵詞USB2.0控制器;IP核;FPGA;驗(yàn)證

    標(biāo)簽: FPGA USB 20

    上傳時(shí)間: 2013-06-30

    上傳用戶(hù):nanfeicui

  • DDR2控制器IP的設(shè)計(jì)與FPGA實(shí)現(xiàn).rar

    DDR2 SDRAM是目前內(nèi)存市場(chǎng)上的主流內(nèi)存。除了通用計(jì)算機(jī)系統(tǒng)外,大量的嵌入式系統(tǒng)也紛紛采用DDR2內(nèi)存,越來(lái)越多的SoC系統(tǒng)芯片中會(huì)集成有DDR2接口模塊。因此,設(shè)計(jì)一款匹配DDR2的內(nèi)存控制器將會(huì)具有良好的應(yīng)用前景。 論文在研究了DDR2的JEDEC標(biāo)準(zhǔn)的基礎(chǔ)上,設(shè)計(jì)出DDR2控制器的整體架構(gòu),采用自項(xiàng)向下的設(shè)計(jì)方法和模塊化的思想,將DDR2控制器劃分為若干模塊,并使用Verilog HDL語(yǔ)言完成DDR2控制器IP軟核中初始化模塊、配置模塊、執(zhí)行模塊和數(shù)據(jù)通道模塊的RTL級(jí)設(shè)計(jì)。根據(jù)在設(shè)計(jì)中遇到的問(wèn)題,對(duì)DDR2控制器的整體架構(gòu)進(jìn)行改進(jìn)與完善。在分析了Altera數(shù)字PHY的基本性能的基礎(chǔ)上,設(shè)計(jì)DDR2控制器與數(shù)字PHY的接口模塊。搭建DDR2控制器IP軟核的仿真驗(yàn)證平臺(tái),針對(duì)設(shè)計(jì)的具體功能進(jìn)行仿真驗(yàn)證,并實(shí)現(xiàn)在Altera Stratix II GX90開(kāi)發(fā)板上對(duì)DDR2存儲(chǔ)芯片基本讀/寫(xiě)操作控制的FPGA功能演示。 論文設(shè)計(jì)的DDR2控制器的主要特點(diǎn)是: 1.支持?jǐn)?shù)字PHY電路,不需要實(shí)際的硬件電路就完成DDR2控制器與DDR2存儲(chǔ)芯片之間的物理層接口,節(jié)約了設(shè)計(jì)成本,縮小了硬件電路的體積。 2.將配置口從初始化模塊中分離出來(lái),簡(jiǎn)化了具體操作。 3.支持多個(gè)DDR2存儲(chǔ)芯片,使得DDR2控制器的應(yīng)用范圍更為廣闊。 4.支持DDR2的三項(xiàng)新技術(shù),充分發(fā)揮DDR2內(nèi)存的特性。 5.自動(dòng)DDR2刷新控制,方便用戶(hù)對(duì)DDR2內(nèi)存的控制。

    標(biāo)簽: DDR2 FPGA 控制器

    上傳時(shí)間: 2013-06-10

    上傳用戶(hù):ynzfm

  • 基于FPGA的GPIB控制器的IP核設(shè)計(jì).rar

    當(dāng)前,片上系統(tǒng)(SOC)已成為系統(tǒng)實(shí)現(xiàn)的主流技術(shù)。流片風(fēng)險(xiǎn)與費(fèi)用增加、上市時(shí)間壓力加大、產(chǎn)品功能愈加復(fù)雜等因素使得SOC產(chǎn)業(yè)逐漸劃分為IP提供者、SOC設(shè)計(jì)服務(wù)者和芯片集成者三個(gè)層次。SOC設(shè)計(jì)已走向基于IP集成的平臺(tái)設(shè)計(jì)階段,經(jīng)過(guò)嚴(yán)格驗(yàn)證質(zhì)量可靠的IP核成為SOC產(chǎn)業(yè)中的重要一環(huán)。 GPIB控制器芯片是組建自動(dòng)測(cè)試系統(tǒng)的核心,在測(cè)試領(lǐng)域應(yīng)用廣泛。本人通過(guò)查閱大量的技術(shù)資料,分析了集成電路在國(guó)內(nèi)外發(fā)展的最新動(dòng)態(tài),提出了基于FPGA的自主知識(shí)產(chǎn)權(quán)的GPIB控制器IP核的設(shè)計(jì)和實(shí)現(xiàn)。 本文首先討論了基于FPGA的GPIB控制器的背景意義,接著對(duì)FPGA開(kāi)發(fā)所具備的基本知識(shí)作了簡(jiǎn)要介紹。文中對(duì)GPIB總線進(jìn)行了簡(jiǎn)單的描述,根據(jù)芯片設(shè)計(jì)的主要思想,重點(diǎn)在于論述怎樣用FPGA來(lái)實(shí)現(xiàn)IEEE-488.2協(xié)議,并詳細(xì)闡述了GPIB控制器的十種接口功能及其狀態(tài)機(jī)的IP核實(shí)現(xiàn)。同時(shí),對(duì)數(shù)據(jù)通路也進(jìn)行了較為細(xì)致的說(shuō)明。在設(shè)計(jì)的時(shí)候采用基于模塊化設(shè)計(jì)思想,用VerilogHDL語(yǔ)言完成各模塊功能描述,通過(guò)Synplifv軟件的綜合,用Modelsim對(duì)設(shè)計(jì)進(jìn)行了前、后仿真。最后利用生成的模塊符號(hào)采取類(lèi)似畫(huà)電路圖的方法完成整個(gè)系統(tǒng)芯片的lP軟核設(shè)計(jì),并用EDA工具下載到了FPGA上。 為了更好地驗(yàn)證設(shè)計(jì)思想,借助EDA工具對(duì)GPIB控制器的工作狀態(tài)進(jìn)行了軟件仿真,給出仿真結(jié)果,仿真波形驗(yàn)證了GPIB控制器的工作符合預(yù)想。最后,本文對(duì)基于FPGA的GPIB控制器的IP核設(shè)計(jì)過(guò)程進(jìn)行了總結(jié),展望了當(dāng)前GPIB控制器設(shè)計(jì)的發(fā)展趨勢(shì),指出了開(kāi)展進(jìn)一步研究需要做的工作。

    標(biāo)簽: FPGA GPIB 控制器

    上傳時(shí)間: 2013-06-12

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