xilinx ise edk8.1注冊器
標(biāo)簽： xilinx ise edk 8.1
上傳時間： 2013-12-30
上傳用戶：kiklkook
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼7
標(biāo)簽： FPGA CPLD ise 集成開發(fā)環(huán)境
上傳時間： 2015-10-28
上傳用戶：sqq
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼8
上傳時間： 2014-12-04
上傳用戶：JIUSHICHEN
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼9
上傳用戶：凌云御清風(fēng)
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼10
上傳用戶：894898248
FPGA/CPLD集成開發(fā)環(huán)境ise的使用詳解 示例代碼
上傳時間： 2013-11-26
上傳用戶：anng
本程序以ise為開發(fā)平臺，采用VHDL為開發(fā)語言，實現(xiàn)了對一個時鐘信號延時的功能
標(biāo)簽： ise 程序 開發(fā)平臺
上傳時間： 2015-11-03
上傳用戶：450976175
本程序以XILINX公司的ise８.２為開發(fā)平臺，采用VHDL為開發(fā)語言，實現(xiàn)了對一個時鐘信號分頻的功能
標(biāo)簽： XILINX ise 程序 開發(fā)平臺
上傳用戶：Yukiseop
本程序以XILINX公司的ise８.２為開發(fā)平臺，采用VHDL為開發(fā)語言，實現(xiàn)了一個簡單的譯碼器，適合處學(xué)者
上傳用戶：葉山豪
用ise開發(fā)的VHDL隨機地址發(fā)生器,采用循環(huán)計數(shù)生成地址
標(biāo)簽： VHDL ise 地址 隨機
上傳時間： 2013-12-21
上傳用戶：xymbian
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