附件是一款PCB阻抗匹配計(jì)算工具，點(diǎn)擊CITS25.exe直接打開(kāi)使用，無(wú)需安裝。附件還帶有PCB連板的一些計(jì)算方法，連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議: 1.一般連板長(zhǎng)寬比率為1：1~2.5：1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm, 2.針對(duì)有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向?yàn)閮?yōu)先,考量對(duì)稱防呆,特殊情況另作處理. 4.連板掏空長(zhǎng)度超過(guò)板長(zhǎng)度的1/2時(shí),需加補(bǔ)強(qiáng)邊. 5.陰陽(yáng)板的設(shè)計(jì)需作特殊考量. 6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性. 7.FIDUCIAL MARK或稱光學(xué)定位點(diǎn),一般設(shè)計(jì)在對(duì)角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無(wú)氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對(duì)稱設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>. 10.使用針孔(郵票孔)聯(lián)接：需請(qǐng)考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無(wú)影響插件過(guò)軌道,及是否影響裝配組裝.
標(biāo)簽： PCB 阻抗匹配 計(jì)算工具 教程
上傳時(shí)間： 2014-12-31
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上傳時(shí)間： 2013-10-15
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Altium Designer 6.0保留了包括全面集成化的版本控制系統(tǒng)的圖形化團(tuán)隊(duì)設(shè)計(jì)功能，例如：內(nèi)嵌了文檔歷史管理系統(tǒng)、新增強(qiáng)大的可以檢測(cè)原理圖與PCB 文件的差異的工程比較修正功能、元件到文檔的鏈接功能。Altium Designer 6.0 存儲(chǔ)管理器可以幫助比較并恢復(fù)舊的工程文件功能的高級(jí)文件控制和易用的備份管理；比較功能不僅能查找電氣差異，也包括原理圖與PCB 文檔間圖形變化；還提供無(wú)需第三方版本控制系統(tǒng)的完整的本地文件歷史管理功能。強(qiáng)大的設(shè)計(jì)比較工具不僅可以隨時(shí)用于同步原理圖工程到PCB，也可以被用于比較兩個(gè)文檔，例如：兩個(gè)網(wǎng)表、兩張?jiān)韴D、網(wǎng)表和PCB等等。還可以是元件與連通性比較。
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上傳時(shí)間： 2014-12-08
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數(shù)字與模擬電路設(shè)計(jì)技巧IC與LSI的功能大幅提升使得高壓電路與電力電路除外，幾乎所有的電路都是由半導(dǎo)體組件所構(gòu)成，雖然半導(dǎo)體組件高速、高頻化時(shí)會(huì)有EMI的困擾，不過(guò)為了充分發(fā)揮半導(dǎo)體組件應(yīng)有的性能，電路板設(shè)計(jì)與封裝技術(shù)仍具有決定性的影響。 模擬與數(shù)字技術(shù)的融合由于IC與LSI半導(dǎo)體本身的高速化，同時(shí)為了使機(jī)器達(dá)到正常動(dòng)作的目的，因此技術(shù)上的跨越競(jìng)爭(zhēng)越來(lái)越激烈。雖然構(gòu)成系統(tǒng)的電路未必有clock設(shè)計(jì)，但是毫無(wú)疑問(wèn)的是系統(tǒng)的可靠度是建立在電子組件的選用、封裝技術(shù)、電路設(shè)計(jì)與成本，以及如何防止噪訊的產(chǎn)生與噪訊外漏等綜合考慮。機(jī)器小型化、高速化、多功能化使得低頻/高頻、大功率信號(hào)/小功率信號(hào)、高輸出阻抗/低輸出阻抗、大電流/小電流、模擬/數(shù)字電路，經(jīng)常出現(xiàn)在同一個(gè)高封裝密度電路板，設(shè)計(jì)者身處如此的環(huán)境必需面對(duì)前所未有的設(shè)計(jì)思維挑戰(zhàn)，例如高穩(wěn)定性電路與吵雜(noisy)性電路為鄰時(shí)，如果未將噪訊入侵高穩(wěn)定性電路的對(duì)策視為設(shè)計(jì)重點(diǎn)，事后反復(fù)的設(shè)計(jì)變更往往成為無(wú)解的夢(mèng)魘。模擬電路與高速數(shù)字電路混合設(shè)計(jì)也是如此，假設(shè)微小模擬信號(hào)增幅后再將full scale 5V的模擬信號(hào)，利用10bit A/D轉(zhuǎn)換器轉(zhuǎn)換成數(shù)字信號(hào)，由于分割幅寬祇有4.9mV，因此要正確讀取該電壓level并非易事，結(jié)果造成10bit以上的A/D轉(zhuǎn)換器面臨無(wú)法順利運(yùn)作的窘境。另一典型實(shí)例是使用示波器量測(cè)某數(shù)字電路基板兩點(diǎn)相隔10cm的ground電位，理論上ground電位應(yīng)該是零，然而實(shí)際上卻可觀測(cè)到4.9mV數(shù)倍甚至數(shù)十倍的脈沖噪訊(pulse noise)，如果該電位差是由模擬與數(shù)字混合電路的grand所造成的話，要測(cè)得4.9 mV的信號(hào)根本是不可能的事情，也就是說(shuō)為了使模擬與數(shù)字混合電路順利動(dòng)作，必需在封裝與電路設(shè)計(jì)有相對(duì)的對(duì)策，尤其是數(shù)字電路switching時(shí)，ground vance noise不會(huì)入侵analogue ground的防護(hù)對(duì)策，同時(shí)還需充分檢討各電路產(chǎn)生的電流回路(route)與電流大小，依此結(jié)果排除各種可能的干擾因素。以上介紹的實(shí)例都是設(shè)計(jì)模擬與數(shù)字混合電路時(shí)經(jīng)常遇到的瓶頸，如果是設(shè)計(jì)12bit以上A/D轉(zhuǎn)換器時(shí)，它的困難度會(huì)更加復(fù)雜。
標(biāo)簽： 數(shù)字 模擬電路 設(shè)計(jì)技巧
上傳時(shí)間： 2014-02-12
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信息管理系統(tǒng)，為一家國(guó)外網(wǎng)站寫的產(chǎn)品信息管理，包含產(chǎn)品資料收集，價(jià)格比較，在線資料比較等等。演示版為英文，未漢化，且功能有限 管理員帳號(hào)www.netfuwu.com 密碼wubin
標(biāo)簽： 信息管理系統(tǒng)
上傳時(shí)間： 2015-02-19
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一般認(rèn)為Windows CE是一個(gè)適合嵌入式應(yīng)用的通用作業(yè)系統(tǒng)，然而，從系統(tǒng)的角度來(lái)看，Windows CE並不只是一個(gè)作業(yè)系統(tǒng)，它還包括對(duì)多種目標(biāo)處理器以及週邊設(shè)備的支援，並提供了系統(tǒng)開(kāi)發(fā)工具、應(yīng)用開(kāi)發(fā)工具、整合的應(yīng)用程式
標(biāo)簽： Windows 嵌入式 系統(tǒng)
上傳時(shí)間： 2015-07-01
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用photoimpact來(lái)玩影像魔術(shù)，漸進(jìn)到多層次的影像處理，讓讀者盡情大玩影像魔術(shù)，在不可思議的數(shù)十分鐘，完成你異想天開(kāi)的想像
標(biāo)簽： photoimpact
上傳時(shí)間： 2013-12-09
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另一個(gè)AODV 程式，無(wú)cross-layer的考慮，完全single layer的方式處理，並可執(zhí)行於Ns2 上
上傳時(shí)間： 2015-09-18
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SIC_XE程式Pass 1:先對(duì)每個(gè)Source statement做定location，Pass 2：對(duì)每個(gè)細(xì)項(xiàng)做不同的處理，算出object code，最後轉(zhuǎn)成machine code輸出。
標(biāo)簽： statement location SIC_XE Source
上傳時(shí)間： 2013-12-20
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java程序，實(shí)現(xiàn)畫圖功能，使用可視化界面，功能齊全。
上傳時(shí)間： 2013-11-25
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