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mif文件生成

  • 正弦表mif

    10位,深度為4096,有符號數(shù),正弦表,mif文件,可導(dǎo)入quartus II生成ROM。

    標(biāo)簽: mif 正弦 10位 有符號數(shù)

    上傳時間: 2020-04-23

    上傳用戶:xflly

  • IAR ARM 破解文件絕對好用

    IAR ARM 破解文件絕對好用,我試驗(yàn)過,請下載WRARM4.42的30天限制版然后用這個破解文件生成注冊碼和序列號具體過程請看說明。

    標(biāo)簽: IAR ARM 破解文件

    上傳時間: 2017-01-05

    上傳用戶:wanghui2438

  • 這是一些ANTLR parser generator的grammar文件的例子

    這是一些ANTLR parser generator的grammar文件的例子,這些grammar文件生成用各種語言寫的編譯各種語言的編譯器

    標(biāo)簽: generator grammar parser ANTLR

    上傳時間: 2017-02-06

    上傳用戶:llandlu

  • 文件夾加密工具(開源代碼) 軟件作者:dyforc 發(fā)現(xiàn)文件夾加密的軟件較少

    文件夾加密工具(開源代碼) 軟件作者:dyforc 發(fā)現(xiàn)文件夾加密的軟件較少,而且都不大適合我用,所以寫了一個。主要是對指定文件夾和其子目錄下所有文件加密。 用到的加密算發(fā)是RC4。 本程序特色: 1. 可以指定加密長度(即只對文件的一部分進(jìn)行加密),(對大文件加密很有用) 2. 可以隨機(jī)生成動態(tài)密鑰 (即使加密目錄下某個文件的加密密鑰被破解了,不影響目錄下其他加密過的文件,因?yàn)槊總€文件加密密鑰不同,都由輸入的密鑰隨機(jī)計算產(chǎn)生) 3. 可以隨機(jī)化文件名,對文件生成MD5,以此來保障解密成功。 4. 加解密過程中程序允許執(zhí)行指定腳本。

    標(biāo)簽: dyforc 文件夾加密 軟件 開源

    上傳時間: 2017-08-19

    上傳用戶:love_stanford

  • 基于FPGA設(shè)計的字符VGA LCD顯示實(shí)驗(yàn)Verilog邏輯源碼Quartus工程文件+文檔說明

    基于FPGA設(shè)計的字符VGA  LCD顯示實(shí)驗(yàn)Verilog邏輯源碼Quartus工程文件+文檔說明,通過字符轉(zhuǎn)換工具將字符轉(zhuǎn)換為 8 進(jìn)制 mif 文件存放到單端口的 ROM IP 核中,再從ROM 中把轉(zhuǎn)換后的數(shù)據(jù)讀取出來顯示到 VGA 上,F(xiàn)PGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input                       clk, input                       rst_n, //vga output         output                      vga_out_hs, //vga horizontal synchronization          output                      vga_out_vs, //vga vertical synchronization                   output[4:0]                 vga_out_r,  //vga red output[5:0]                 vga_out_g,  //vga green output[4:0]                 vga_out_b   //vga blue );wire                            video_clk;wire                            video_hs;wire                            video_vs;wire                            video_de;wire[7:0]                       video_r;wire[7:0]                       video_g;wire[7:0]                       video_b;wire                            osd_hs;wire                            osd_vs;wire                            osd_de;wire[7:0]                       osd_r;wire[7:0]                       osd_g;wire[7:0]                       osd_b;assign vga_out_hs = osd_hs;assign vga_out_vs = osd_vs;assign vga_out_r  = osd_r[7:3]; //discard low bit dataassign vga_out_g  = osd_g[7:2]; //discard low bit dataassign vga_out_b  = osd_b[7:3]; //discard low bit data//generate video pixel clockvideo_pll video_pll_m0( .inclk0                (clk                        ), .c0                    (video_clk                  ));color_bar color_bar_m0( .clk                   (video_clk                  ), .rst                   (~rst_n                     ), .hs                    (video_hs                   ), .vs                    (video_vs                   ), .de                    (video_de                   ), .rgb_r                 (video_r                    ), .rgb_g                 (video_g                    ), .rgb_b                 (video_b                    ));osd_display  osd_display_m0( .rst_n                 (rst_n                      ), .pclk                  (video_clk                  ), .i_hs                  (video_hs                   ), .i_vs                  (video_vs                   ), .i_de                  (video_de                   ), .i_data                ({video_r,video_g,video_b}  ), .o_hs                  (osd_hs                     ), .o_vs                  (osd_vs                     ), .o_de                  (osd_de                     ), .o_data                ({osd_r,osd_g,osd_b}        ));endmodule

    標(biāo)簽: fpga vga lcd

    上傳時間: 2021-12-18

    上傳用戶:

  • stm8封裝文件

        該文件是器件官方元件封裝的文件,用cadence,打開后綴為bxl的文件?! ∠螺d的Ultra Librarian 軟件;       Ultra Librarian提供了一個基于云的庫,該庫中有超過 8 百萬種符號、封裝,以及帶有供貨商 ECAD 中性數(shù)據(jù)輸出選擇的 3D 模型。該庫以業(yè)內(nèi)最大的 ECAD 元器件庫為后盾,代表了 400 多家制造商。輕松找到您所需的零件,導(dǎo)出至 22 種不同的 CAD 工具。該庫每天更新,為您提供滿足 PCB 設(shè)計需求的最準(zhǔn)確零件?! 〈蜷_ Ultra Librarian軟件,導(dǎo)入bxl后綴文件,選擇需要轉(zhuǎn)換的文件類型,最后導(dǎo)出文件。  然后就可以用cadence或者AD打開該庫。該文件生成edf和cfg文件?! ≡儆胦rcad capture cis軟件打開,file>import design >edif> open(edf) configation(cfg)然后就可以生成dns工程,就會在目標(biāo)路徑下產(chǎn)生olb和obk文件,是原理圖文件,可以用orcad capture cis軟件打開。          附加導(dǎo)入Altium Designer:首先,按照所給鏈接下載ULib文件,解壓,并將解壓后的文件安裝。打開桌面上的Ultra應(yīng)用程序。打開后彈出一個對話框,選擇繼續(xù)免費(fèi)使用。然后彈出主程序窗口,在步驟一里面加載我們需要轉(zhuǎn)換的BXL文件。并且在下面選擇Altium designer,。選擇步驟三的export to selected tools ,并生成一個log.txt文件。用AD打開剛生成的UL_Import.PrjScr文件,。打開工程文件后,并將鼠標(biāo)光標(biāo)移動到UL_Import.Pas文件下且選中。點(diǎn)擊箭頭所指運(yùn)行按鈕。在彈出的對話框UL Import下,選擇剛生成的LOG.txt文件。最后點(diǎn)擊輸出start import按鈕,即可把bxl庫文件轉(zhuǎn)換為AD封裝庫文件。生成的庫文件。

    標(biāo)簽: stm8 封裝 cad

    上傳時間: 2022-06-01

    上傳用戶:xsr1983

  • 如何使用Cir文件進(jìn)行PSPice仿真

    如何使Cir文件進(jìn)行PSPice仿真當(dāng)Orcad仿真庫中找不到某些器件的時候,我們可以從這些器件的廠家網(wǎng)站上下載“.cir”格式的Spice Model,下面介紹一下如何使用這些“.cir”文件進(jìn)行仿真。以AD620.cir為例:1.下載Cir文件:從AD的網(wǎng)站上下載AD的cir格式文件,內(nèi)容如下:由PSPice Library 文件生成Capture Lib文件(.olb)File->Export to capture part library…本案例中源文件為:CAOrCADIOrCAD_10.5New_Lib_Files\AD620XAD620.Lib本案例中目標(biāo)文件為:C:\OrCAD\OrCAD_10.5\tools\capturelibrary\pspice\New_Models\AD620.olb在完成本操作后,就可以在Capture中使用AD620的庫繪制需要仿真的原理圖了。

    標(biāo)簽: cir文件 pspice

    上傳時間: 2022-07-03

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  • PRL更新原理講解

      PRL文件是存儲在UIM卡上的一個參數(shù)文件,全稱為:Preferred Roaming List,中文名稱為“優(yōu)選漫游列表”。 PRL系統(tǒng)軟件工作原理為:讀取特定的二進(jìn)制文件,此二進(jìn)制文件包含與本地運(yùn)營商簽訂有C網(wǎng)網(wǎng)絡(luò)漫游協(xié)議的其它國家運(yùn)營商列表及相關(guān)網(wǎng)絡(luò)參數(shù)(如SID及頻率),并根據(jù)此二進(jìn)制文件生成短信,用一種特殊格式的短信下發(fā)至用戶手機(jī),手機(jī)和UIM卡對特殊短信進(jìn)行處理,完成PRL信息更新。 目前PRL文件中存儲的是與中國電信簽訂協(xié)議的國外運(yùn)營商、中國電信800M/450M網(wǎng)絡(luò)的頻點(diǎn)信息、EVDO的頻點(diǎn)信息。

    標(biāo)簽: PRL 更新

    上傳時間: 2013-12-19

    上傳用戶:zhf01y

  • 使用EJB開發(fā)的圖書館讀者信息管理系統(tǒng)

    使用EJB開發(fā)的圖書館讀者信息管理系統(tǒng),請用戶使用所帶的SQL文件生成所需數(shù)據(jù)庫

    標(biāo)簽: EJB 圖書館 信息管理系統(tǒng)

    上傳時間: 2014-11-11

    上傳用戶:zhuoying119

  • 64位的DES加密解密

    64位的DES加密解密,加密111文件生成222,解密生成

    標(biāo)簽: DES 加密 解密

    上傳時間: 2014-10-25

    上傳用戶:linlin

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