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·Phase-Locked Loop Circuit Design
標(biāo)簽： nbsp Phase-Locked Circuit Design
上傳時(shí)間： 2013-04-24
上傳用戶：lhc9102
·利用OpenGL實(shí)現(xiàn)三維物體的平移旋轉(zhuǎn)
標(biāo)簽： OpenGL 旋轉(zhuǎn)
上傳時(shí)間： 2013-06-21
上傳用戶：01010101
·詳細(xì)說(shuō)明：OpenGL SDK。幫助讀者快速地了解OpenGL
標(biāo)簽： OpenGL nbsp SDK
上傳時(shí)間： 2013-06-12
上傳用戶：zhangsan123
資料->【E】光盤(pán)論文->【E5】英文書(shū)籍->CMOS Logic Circuit Design (英).pdf
標(biāo)簽： Circuit Design Logic CMOS
上傳時(shí)間： 2013-05-22
上傳用戶：ecooo
· [測(cè)試書(shū)籍]Design For Test
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上傳時(shí)間： 2013-06-28
上傳用戶：txfyddz
·SystemVerilog is a rich set of extensions to the IEEE 1364-2001 Verilog Hardware Description Language (Verilog HDL). These extensions address two major aspects of HDL-based design. First, modeling ver
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上傳時(shí)間： 2013-07-14
上傳用戶：ainimao
·HDL Chip Design
標(biāo)簽： nbsp Design Chip HDL
上傳時(shí)間： 2013-06-18
上傳用戶：lizhen9880
·詳細(xì)說(shuō)明：NeHe的OpenGL教程（中英文版），介紹了有關(guān)OpenGL的入門(mén)知識(shí)，適合初學(xué)者。
標(biāo)簽： OpenGL NeHe 教程 中英文
上傳時(shí)間： 2013-05-27
上傳用戶：維子哥哥
·Advanced ASIC Chip Synthesis Using Synopsys Design Compiler,Physical Compiler and Primetime
標(biāo)簽： nbsp Synthesis Advanced Synopsys
上傳用戶：alia
資料->【E】光盤(pán)論文->【E5】英文書(shū)籍->Design and Analysis of Analog Filters (英).pdf
標(biāo)簽： Analysis Filters Design Analog
上傳用戶：氣溫達(dá)上千萬(wàn)的
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