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pcie協(xié)議

  • 最新的 PCIe 4.0 標(biāo)準(zhǔn)文件

    最新的PCIe 4.0 spec， 希望對(duì)從事PCIe 相關(guān)工作的工程師有用。

    標(biāo)簽： PCIe 4.0

    上傳時(shí)間： 2022-07-10

    上傳用戶：jason_vip1

  • FPGA與PC間基于PCIe和千兆以太網(wǎng)的通信設(shè)計(jì)

    1.深入研究PCIe和千兆以太網(wǎng)，了解PCIe和千兆以太網(wǎng)的技術(shù)優(yōu)勢(shì)，具體分析PCle和千兆以太網(wǎng)的傳輸協(xié)議，詳細(xì)說明PCleTLP數(shù)據(jù)包格式和以太網(wǎng)標(biāo)2.完成PCIe DMA數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)。設(shè)計(jì)方案主要包括兩大部分，分別是FPGA端Verilog邏輯模塊開發(fā)以及PC端的驅(qū)動(dòng)和C應(yīng)用程序開發(fā)。FPGA端基于PCle IP Core完成了發(fā)送接收引擎模塊、寄存器讀寫控制模塊和FIFO讀寫控制模塊的設(shè)計(jì)。定義了相應(yīng)模塊的接口，并分析了數(shù)據(jù)傳輸?shù)臅r(shí)序。PC端采用WinDriver進(jìn)行PCle的驅(qū)動(dòng)開發(fā)，并根據(jù)WinDriver提供的驅(qū)動(dòng)API函數(shù)完成C應(yīng)用程序的設(shè)計(jì)。3.完成千兆以太網(wǎng)數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)。設(shè)計(jì)方案也主要包括兩大部分，分別是FPGA端Verilog邏輯模塊開發(fā)以及PC端Winpcap應(yīng)用程序開發(fā)。FPGA端基于嵌入式三態(tài)以太網(wǎng)MACIPCore，設(shè)計(jì)了發(fā)送接收引擎模塊、FIFO讀寫控制模塊和物理接口模塊。定義了相應(yīng)模塊的接口，并分析了數(shù)據(jù)傳輸經(jīng)過Locallink接口和Client用戶接口上的傳輸時(shí)序。PC端采用Winpcap提供的網(wǎng)絡(luò)編程完成了C應(yīng)用程序的設(shè)計(jì)，實(shí)現(xiàn)了捕獲FPGA端發(fā)送的數(shù)據(jù)包以及發(fā)送原始數(shù)據(jù)包至FPGA端的功能。4.PCIe DMA數(shù)據(jù)傳輸系統(tǒng)和千兆以太網(wǎng)數(shù)據(jù)傳輸系統(tǒng)在Xilinx ML507開發(fā)板上進(jìn)行了性能測(cè)試。記錄FPGA與PC間進(jìn)行讀寫測(cè)試的結(jié)果，驗(yàn)證這兩個(gè)系統(tǒng)的可用性和穩(wěn)定性，最后分析了影響系統(tǒng)傳輸速率的原因以及系統(tǒng)目前仍存在的不足。

    標(biāo)簽： fpga pc pcie 以太網(wǎng) 通信

    上傳時(shí)間： 2022-07-11

    上傳用戶：xsr1983

  • PCIE學(xué)習(xí)筆記.

    PCIE學(xué)習(xí)筆記                                    

    標(biāo)簽： pcie

    上傳時(shí)間： 2022-07-17

    上傳用戶：

  • PCIE物理層測(cè)試簡(jiǎn)介

    PCIE物理層測(cè)試簡(jiǎn)介                     

    標(biāo)簽： pcie 物理層

    上傳時(shí)間： 2022-07-17

    上傳用戶：zhanglei193

  • PCIe總線的超高速信號(hào)采集卡的設(shè)計(jì)

    基于PCIe總線的超高速信號(hào)采集卡的設(shè)計(jì)               

    標(biāo)簽： pcie總線 超高速信號(hào)采集卡

    上傳時(shí)間： 2022-07-17

    上傳用戶：

  • PCIE板卡PCB設(shè)計(jì)注意事項(xiàng)

    PCIE板卡PCB設(shè)計(jì)注意事項(xiàng)                         

    標(biāo)簽： pcie板卡 pcb

    上傳時(shí)間： 2022-07-17

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  • PCIe的原理及體系架構(gòu)-學(xué)習(xí)筆記

    PCIe的原理及體系架構(gòu)-學(xué)習(xí)筆記                 

    標(biāo)簽： pcie

    上傳時(shí)間： 2022-07-17

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  • PCIE數(shù)據(jù)采集系統(tǒng)的驅(qū)動(dòng)程序開發(fā)

    PCIE數(shù)據(jù)采集系統(tǒng)的驅(qū)動(dòng)程序開發(fā)               

    標(biāo)簽： pcie 數(shù)據(jù)采集 驅(qū)動(dòng) 程序

    上傳時(shí)間： 2022-07-17

    上傳用戶：jiabin

  • ?PCIe 5.0 最新標(biāo)準(zhǔn) PCI Express Base Specification Revision 5.0

    PCIe 5.0 最新標(biāo)準(zhǔn)，為物聯(lián)網(wǎng)設(shè)計(jì)提供最新支持。

    標(biāo)簽： PCIe 物聯(lián)網(wǎng)

    上傳時(shí)間： 2022-07-17

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  • PCB LAYOUT設(shè)計(jì)規(guī)范手冊(cè)

    　　PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 　　(1) ”PCB LAYOUT 基本規(guī)範(fàn)”:為R&D Layout時(shí)必須遵守的事項(xiàng), 否則SMT,DIP,裁板時(shí)無法生產(chǎn). 　　(2) “錫偷LAYOUT RULE建議規(guī)範(fàn)”: 加適合的錫偷可降低短路及錫球. 　　(3) “PCB LAYOUT 建議規(guī)範(fàn)”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout. 　　(4) ”零件選用建議規(guī)範(fàn)”: Connector零件在未來應(yīng)用逐漸廣泛, 又是SMT生產(chǎn)時(shí)是偏移及置件不良的主因,故製造希望R&D及採(cǎi)購在購買異形零件時(shí)能顧慮製造的需求, 提高自動(dòng)置件的比例.

    標(biāo)簽： LAYOUT PCB 設(shè)計(jì)規(guī)范

    上傳時(shí)間： 2013-10-28

    上傳用戶：zhtzht

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